数电课设-六进制同步加法计数器(无效态010-100)

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1、目录1.课程设计的目的与作用22.设计任务23.设计及仿真分析过程23.1六进制同步加法计数器（无效态010,100）23.1.1设计过程23.1.2输出转换设计43.1.3仿真分析53.274160构成50进制同步加法计数器并显示8.2.1设计要求83.2.274LS160功能简介83.2.3仿真分析84实验仪器95设计总结和体会96参考文献10101.课程设计的目的与作用1.加深对教材的理解和思考，并通过实验设计、验证证实理论的正确性。2.学习自行设计一定难度并有用途的计数器、加法器、寄存器等。3.检测自己的数字电子技术掌握能力。2.设计

2、任务1.设计分析六进制同步加法计数器（无效态010,100）2.74160构成50进制同步加法计数器并显示3.设计及仿真分析过程3.1六进制同步加法计数器（无效态010,100）000001011101110111排列：图1.状态图3.1.1设计过程1.选择触发器由于JK触发器功能齐全，使用灵活，这里选用3个CP下降沿触发的边沿JK触发器102.求时钟方程采用同步，CP0=CP1=CP2=CP（式1）3.求状态方程由图1所示的状态图可直接画出如图2所示电路次态的卡诺图。再分解开便可以得到图3所示的各触发器的卡诺图。显然，由图3所示各卡诺图便可

3、很容易得到状态方程：（式2）4.求驱动方程10JK触发器的特征方程为：（式3）变换状态方程（式2），使之与特征方程（式3）的形式一致，比较后得出驱动方程Q1nQ0n1Q2n(式4)5.检查电路能否自启动将无效态010,101代入状态方程（式2）进行计算，结果如下：010111100无效态不成循环，故此时序电路能自启动。3.1.2输出转换设计将设计好的计数器输出端Q2n+1、Q1n+1、Q0n+1所示数据信号通过门电路的组合转换成十位数输出，对应真值表列出如下表1表1输出状态转换表Q2n+1Q1n+1Q0n+1CBAY0000011001010

4、20110113101100411010151111106列出状态方程：C=Q2n+1B=Q2n+1Q0n+1+Q1n+1Q0n+1（式5）A=（Q2n+1Q1n+1+Q2n+1Q2n+1）Q0n+1+Q2n+1Q1n+1Q0n+1103.1.3仿真分析根据上步所设计的逻辑电路图，在Multisim中构建逻辑电路如下图所示图4图510图6图710图8图9103.274160构成50进制同步加法计数器并显示.2.1设计要求使用两片集成芯片74LS160以及一些必要的门电路设计一个50进制加法计数器。3.2.274LS160功能简介CLK是脉冲输

5、入端；RCO是进位信号输出端；ENP和ENT是计数器工作状态端；CLR是异步清零端；LOAD是置数端；VCC接正电源，GND接地；A～D是数据输入端，QA～QD是计数器状态输出端。电源电压5V，输入电压5V。其状态表下所示表274LS160状态表3.2.3仿真分析根据上步所设计的逻辑电路图，在Multisim中构建逻辑电路如图10所示10图10.50进制计数器仿真结果运行仿真电路，LED数码管从00开始依次计数，累计到49后又跳转到00，实现50进制计数器的功能。4实验仪器集成芯片：74LS112芯片2个（每个芯片包含2个JK触发器），74L

6、S00芯片1个（每个包含4个与非门电路），74LS08芯片1个（每个包含4个与门电路），74LS160芯片两片。数字原理教学系统试验台一台（含导线、脉冲、电源等）。5设计总结和体会经过本次课程设计，不仅使我学到了很多的知识而且大大的提升了我的动手实践能力，使我受益匪浅。比如，在设计过程中，稍有不慎就会出错，所以，我们一定要高度的重视，细心的去完成设计。接线过程是反映一个动手能力的平台，只要利用好它，对自己的动手能力很有帮助。因此，我们一定要本着一丝不苟的精神来完成每次课设，抓住锻炼自己的机会，逐渐提升自己的能力。106参考文献［1］《数字电子

7、技术基础简明教程》第三版.清华大学电子学教研室组编.余孟尝主编.高等教育出版社.2006［2］《数字逻辑实验指导书》信息学院数字逻辑实验室编.张利萍，张群芳主编.10