串并行通信和接口技术1

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1、第6章串并行通信和接口技术并行接口的基本概念一、并行通信和串行通信二、并行接口概述可编程并行接口8255A一、8255A引脚、编程结构二、8255A的控制字三、8255A的工作方式四、8255A的应用举例重点将数据的各位同时在多根并行传输线上进行传输。01010110D0D1D2D3D4D5D6D7目的D0D1D2D3D4D5D6D7源并行通信适于短距离、高速通信并行通信数据的各位同时由源到达目的地→快多根数据线→距离短、远程费用高数据的各位依次由源到达目的地→慢数据线少→远程,费用低串行通信将数据的各位按时间顺序依次在一根传输线上传输。RD目的TD

2、源串行通信适于长距离、中低速通信0101并行接口的典型硬件结构包括：1、两个或两个以上具有锁存或缓冲的数据端口2、与CPU进行数据交换所必须的控制和状态信号3、与外设进行数据交换所必须的控制和状态信号4、端口译码电路、中断电路5、选片、控制电路二、并行接口概述并行接口连接CPU与并行外设，实现两者的并行通信，在信息传送过程中，起到输出锁存或输入缓冲的作用。8255A教学重点8255A的引脚、编程8255A的应用并行接口电路8255A具有多种功能的可编程并行接口电路芯片最基本的接口电路：三态缓冲器和锁存器与CPU间、与外设间的接口电路：状态寄

3、存器和控制寄存器还有端口的译码和控制电路、中断控制电路分3个端口，共24个外设引脚共三种输入输出工作方式18255A的内部结构和引脚数据总线缓冲器内部控制线内部数据线D0～D7A组控制A组端口AA组端口C上部B组控制B组端口BB组端口C下部读写控制逻辑PC0～PC3PB0～PB7PC4～PC7PA0～PA7RDWRA0A1CSRESET1.数据端口A、B、C（1）端口A对应1个8位数据输入锁存器1个8位输出锁存器/缓冲器。（2）端口B对应1个8位数据输入缓冲器1个8位输出锁存器/缓冲器。（3）端口C对应1个8位数据输入缓冲器1个8位输出锁存器/缓冲器

4、。通常使用方法：端口A、B作为独立的输入或者输出端口；端口C配合端口A、B1.外设数据端口端口A：PA0～PA7A组，支持工作方式0、1、2端口B：PB0～PB7B组，支持工作方式0、1端口C：PC0～PC7仅支持工作方式0A组控制高4位PC4～PC7B组控制低4位PC0～PC3端口A：PA0～PA7常作数据端口，功能最强大端口B：PB0～PB7常作数据端口端口C：PC0～PC7可作数据、状态和控制端口分两个4位，每位可独立操作控制最灵活，最难掌握D0～D7数据总线缓冲器内部控制线内部数据线A组控制A组端口AA组端口C上部B组控制B组端口BB组端口C

5、下部读写控制逻辑PC0～PC3PB0～PB7PC4～PC7PA0～PA7RDWRA0A1CSRESET2.控制端口D(A组和B组控制电路)8位端口，无对外引脚控制端口的内容决定A口、B口、C口的工作状态(输入或输出)和工作方式（方式0、1、2）,起控制作用。由1个8位双向三态缓冲器构成8255A内各端口通过数据缓冲器与系统总线相连。CPU与端口A、B、C间传送的数据，以及CPU写入控制端口D中的控制字均通过数据缓冲器传送。3.数据总线缓冲器(引脚D0~D7)4.读写控制电路(引脚CS、RD、WR)控制数据总线缓冲器的状态数据总线缓冲器有3种状

6、态：输入、输出、高阻态Intel系列的8位并行接口芯片通用性强，使用灵活可用程序设置和改变芯片的工作方式是一种典型的可编程并行接口芯片8255APA3PA2PA1PA0RDCSGNDA1A0PC7PC6PC5PC4PC3PC2PC1PC0PB0PB1PB2PA4PA5PA6PA7WRRESETD0D1D2D3D4D5D6D7VccPB7PB6PB5PB4PB340个引脚，双列直插式5.8255A端口寻址选择表8255A的工作方式8255A与系统的连接示意图D0~D7WRRDA1A0CSDBIOWIORA1A0译码器8255A口B口C口D0~D7外设1

7、A19～A2系统总线外设2外设38255A的工作方式方式0：基本输入输出方式适用于无条件传送和查询方式的接口电路方式1：选通输入输出方式适用于查询和中断方式的接口电路方式2：双向选通传送方式适用于与双向传送数据的外设适用于查询和中断方式的接口电路8255A的工作方式方式0：基本输入输出方式特点：8255A相当于三个独立的8位数据口。各端口既可设置为输入口，也可设置为输出口，但不能同时实现输入及输出。C端口即可以是一个8位的简单接口，也可以分为两个独立的4位端口。设置为输出口时有锁存能力，设置为输入口时无锁存能力。适用于：无条件输入输出方式。查询输入

8、输出方式：把A、B口作为8位数据的输入或输出口，C口的高/低4位分别定义为A、B口的控制位和状态位。方式0输