eda技术与应用实验报告模板

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CENTRAL SOUTH UN I VERS ITYEDA实验报告题目:实验一 应用Quarts II完成LED的驱动姓名班级学号成员1:朱梦电科1405140210528成员2:李嘉欣电科1405102140522成员3:樊志立电科14051402140521联系电话15273159031物理与电子学院2017年4月 实验平台说明特征说明计算机配置(机器型号,主板型号可选)处理器,内存,硬盘,显卡,显示器操作系统Windows 7 64 bit enterprise editionEDA软件Quartus II 9.1 64 bit开发板编号盒子编号验证图清单特征图编号RTL图图5,图10,图12仿真图硬件运行图在线调试图状态机图实验一 应用Quartus II完成LED的驱动一、 实验目的通过实验让用户逐步了解、熟悉和掌握FPGA开发软件Quartus II的使用方 法及VHDL的编程方法。本实验力求以详细的步骤和讲解让读者以最快的方式了解EDA技术开发以 及软件的使用而快速入门,并激起读者对EDA技术的兴趣。二、 实验内容SmartSOPC实验箱上有8个发光二极管LED1?LED8,在QuikSOPC核心板上 LED1?LED8分别于FPGA芯片的第50、53?55、176和第47?49引脚相连(SmartSOPC 实验箱的LEDKLED8通过跳线JP6的LEDO?LED7分别与FPGA的第50、53?55、 176和第47?49引脚相连)。木实验的内容是建立可用于控制LED亮/灭的简单硬件电路,要求点亮 SmartSOPC试验箱上的4个发光二极管(LED1、LED3、LED5、LED7)。具体包 括:① 使用Quartus II建立工程;② Quartus II工程设计;③ 设置编译选项并编译硬件系统;④ 下载硬件设计到目标FPGA;⑤ 观察LED的状态。三、 实验原理FPGA器件同单片机一样,为用户提供了许多灵活独立的输入/输出I/O 口(单 元)。FPGA每个I/O 口可以配置为输入、输出、双向I/O、集电极开路和三态门 等各种组态。做为输出口时,FPGA的I/O 口可以吸收最大为24mA的电流,可 以直接驱动发光二极管LED等器件。所以只要正确分配并锁定引脚后,在相应 的引脚上输出低电平“0”,就可实现点亮该发光二极管的功能。四、 实验步骤使用Quartus II建立工程 打开QuartusII软件并建立工程① 在 Windows 桌面上选择“开始”亠"程序” —Altera>Quartus II 64-Bit, 打开Quartus II 64-Bit软件,软件界面如图1所示。Type |Message|For Help, press FlIdleNUM\ System 人 P『oce»ing 入 Extra Info 入 Info 入 Waming 入 Critical Waming 入 Eg 入 Suppressed 入 Flag /金 | 季| |Location图1 Quartus II软件界面New课以为New Project Wizard□新建工程向导说明如对话框图2所示。② 在图1中选择File—New Project Wizard来新建一项工程。注意不要把 图2新建工程向导说明対话框在图2中可以了解在新建工程的过程中要完成哪些工作,这些工作包括:指 定项目目录、名称和顶层实体;指定项目设计文件;指定该设计的Altera器件系 列;指定用于该项目的其他EDA工具;项目信息报告。③ 在图2中单击Next进入如图3所示对话框。任何一项设计都是一项工程Project,必须首先为此工程建立一个放置与此工 程相关的所有文件的文件夹,此文件夹将被Quartus II默认为工作库(Work Library)o 一般来说不同的设计项目最好放在不同的文件夹中,而同一工程的所 有文件都必须放在同一文件夹中。图3中的第一栏用于指定工程所在的工作库文件夹;第二栏用于指定工程 名,工程名可以去任何名字,也可以直接用顶层文件的实体名作为工程名(建议 使用);第三栏用于指定顶层文件的实体名。本例工程的路径为E:\EDA\Example\led_test,工程名与顶层文件的实体名同为led testoNew Project Wizard: Directory, Name, Top-Level Entity "page 1 of 5]D Q 1 1*夕®啓$3 Quartus II - [blue.* 越 File Edit VicWhaJ i$ the wotkrjg directory for this project?| E: /altera/90/quartu$7biue/Project NavigatorEntity4 Compilation HiWhat i$ the name of this project? (blueWhat is the name of the top-level design entity for this project? This name is case sensitive and must exactly maJch the entity name in the design file.Use Existing Project Settings...For Help, press Fl^Hierarchy | g) Files |< Back Next > Finish 取消? all;:in std^log:?e iseccor(1 downc<2,k3,k4) I▼■(numF /图3新建工程路径、名称、顶层实体指定对话框④ 单击Next进如图4所示对话框。由于是新建工程,暂无输入文件。 Flow |CoapilationSpecify the path names of any non-default litxaries.取消〈BackFinishNew Project Wizard: Add Files [page 2 of 5]Select the design files you want to include in the project. Click Add All to add al design files in the project directory to the project. No»e: you can always add design files to the project later.File name:
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