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1、国防科技大学2008学年秋季学期------------《数字电子技术基础》考试试卷（A）卷参考答案--------------考试形式：闭卷考试时间：120分钟满分：100分。专业：题号一二三四五六七总分--------------得分评阅人注意：1、所有答题都须写在此试卷纸密封线右边，写在其它纸上一律无效。--------------2、密封线左边请勿答题，密封线外不得有姓名及相关标记。年级：线得分一、填空题（共5小题，每题2分，共10分）－封1、逻辑等式F=A(B+C)+A+D的对偶式是F*=(A+B•C)•A•D；学院：－反演式是F=(A+B•C)(A+D)。2、（108）10=
2、(154)8=(000100001000)8421-BCD密3、按照逻辑功能的不同，触发器可以分成RS、D、JK、T、T’等类型；而从电路结构和动作特点上又可以把触发器分为基本RS触发器、同步触发器、姓名：----------------主从触发器以及各种形式的边沿触发器。4、半导体存储器按存取功能分为RAM存储器和ROM存储器。----------------5、时序逻辑电路通常包含组合电路和存储电路两个组成部分；描述时序逻辑电路有三组方程，指的是驱动方程、状态方程和输出方程。学号：-----------------第1页共8页得分二、选择题（共10小题，每小题2分，共20分）1、下列
3、说法正确的是C。（A）若X+Y=X+Z，则Y=Z（B）若XY=XZ，则Y=Z（C）若X+Y=X+Z，且XY=XZ，则Y=Z（D）以上说法都不对2、下列各门电路中D的输出端不可以并联使用；（A）CMOSOD门（B）CMOS三态门（C）TTLOC门（D）具有推拉式输出的TTL门电路3、下列A不属于组合逻辑电路。（A）序列信号发生器（B）译码器（C）数据选择器（D）优先编码器4、下列A触发器具有一次变化问题。（A）主从JK触发器（B）利用CMOS传输门的上边沿D触发器（C）同步D触发器（D）维持阻塞D触发器5、用触发器设计一个同步十七进制的计数器所需要的触发器的数目是D。（A）2（B）3（C）
4、4（D）56、可以用来实现并/串转换和串/并转换的器件是：A。（A）移位寄存器（B）全加器（C）译码器（D）计数器7、由8级触发器构成的十进制计数器的模值是C。（A）8（B）10（C）100（D）2568、石英晶体多谐振荡器的输出脉冲频率取决于C：（A）电路RC参数大小（B）组成振荡器的门电路的平均传输时间（C）晶体的固有频率f（D）晶体的固有频率f和RC参数值009、为构成4096×8位的RAM，需要片1024×1的RAM，并且需要位地址译码以完成寻址操作。B（A）32，15（B）32，12（C）8，15（D）8，1210、下列几种A/D转换器中，B的转换速度最快？（A）双积分型ADC
5、（B）并联比较型ADC（C）计数型ADC（D）逐次渐近型ADC第2页共8页得分三、分析简答题（共4小题，每小题5分，共20分）------------1.试将下列逻辑函数化为最简“与或”式：--------------F=AC+ABC+ACD+CD解：=A(C+BC)+C(AD+D)(1分)专业：=A(C+B)+C(A+D)(1分)--------------=A(C+B+C)+CD(1分)=A+CD(2分)--------------年级：线2．已知用3线-8线译码器74LS138构成的逻辑电路如下图所示，试写出Y1、Y2的逻辑表达式，列出真值表，并分析该电路的逻辑功能。其中74LS1
6、38输出－低电平有效，使能端EN=S⋅S+S。123(2)对应的真值表为：(3分)封ABCY1Y2学院：00000－001100101001101密10010101011100111111姓名：----------------(1)Y1=m1•m2•m4•m7=∑m()1,2,4,7Y=m•m•m•m=∑(3,5,6,7)(1分)23567m(3)由真值表易知，----------------这是一个1位全加器电路，Y1是本位和，Y2是本位的进位端。(1分)学号：-----------------第3页共8页3．由4位二进制加法计数器CT4161（功能表见题六）和PROM组成的电路如图所
7、示，试写出函数W，X，Y，Z的最小项之和的表达式，并分析在CP作用下，W、X、Y、Z端顺序输出的8421BCD码的状态，说明电路的功能。解：W=∑m()5,11,12,14在CP作用下，由WXYZ组成的8421BCDX=∑()2,4,7,8,10,13码依次输出3.141592653589793…..mY=∑()0,6,7,9,13,15即：是一个π常数存储器。mZ=∑()0,1,3,4,5,8,9,10,12,13,14,15(2
