电子技术基础.ppt

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1、电子技术基础第8章触发器与时序逻辑电路学习要点触发器的工作原理及逻辑功能时序逻辑电路的分析方法寄存器、计数器的工作原理及构成555定时器的工作原理及其应用第8章触发器与时序逻辑电路8.1双稳态触发器8.2寄存器8.3计数器8.4555定时器触发器是构成时序逻辑电路的基本逻辑部件。它有两个稳定的状态：0状态和1状态；在不同的输入情况下，它可以被置成0状态或1状态；当输入信号消失后，所置成的状态能够保持不变。所以，触发器可以记忆1位二值信号。根据逻辑功能的不同，触发器可以分为RS触发器、D触发器、JK触发器、T和

2、T´触发器；按照结构形式的不同，又可分为基本RS触发器、同步触发器、主从触发器和边沿触发器。8.1双稳态触发器8.1.1RS触发器电路组成和逻辑符号信号输入端，低电平有效。信号输出端，Q=0、Q=1的状态称0状态，Q=1、Q=0的状态称1状态，1、基本RS触发器工作原理10010100110010101010101111011不变10001100不定？01010111不变功能表基本RS触发器的特点（1）触发器的次态不仅与输入信号状态有关，而且与触发器原来的状态有关。（2）电路具有两个稳定状态，在无外来触发信号作用时

3、，电路将保持原状态不变。（3）在外加触发信号有效时，电路可以触发翻转，实现置0或置1。（4）在稳定状态下两个输出端的状态和必须是互补关系，即有约束条件。C＝0时，触发器保持原来状态不变。C＝1时，工作情况与基本RS触发器相同。2、同步RS触发器功能表在数字电路中，凡根据输入信号R、S情况的不同，具有置0、置1和保持功能的电路，都称为RS触发器。主要特点波形图（1）时钟电平控制。在CP＝1期间接收输入信号，CP＝0时状态保持不变，与基本RS触发器相比，对触发器状态的转变增加了时间控制。（2）R、S之间有约束。不能允许

4、出现R和S同时为1的情况，否则会使触发器处于不确定的状态。不变不变不变不定置1置0置13、计数式RS触发器设触发器的初始状态为0。根据同步RS触发器的逻辑功能可知，第1个时钟脉冲C到来时，因R=Q=0、S=Q=1，所以触发器状态翻转为1，即R=Q=1、S=Q=0；第2个时钟脉冲C到来时，触发器状态翻转为0，即R=Q=0、S=Q=1。由此可见，每输入一个时钟脉冲C，触发器状态翻转一次，故称为计数式RS触发器，计数式触发器常用来累计时钟脉冲C的个数。8.1.2D触发器1、同步D触发器C=0时触发器状态保持不变。C=1时

5、，根据同步RS触发器的逻辑功能可知，如果D=0，则R=1，S=0，触发器置0；如果D=1，则R=0，S=1，触发器置1。波形图在数字电路中，凡在CP时钟脉冲控制下，根据输入信号D情况的不同，具有置0、置1功能的电路，都称为D触发器。CP=1期间有效2、维持阻塞D触发器（1）D=0。当C=0时，G3、G4和G6的输出均为1，G5输出为0，触发器的状态不变。当C从0上跳为1，即C=1时，G3、G5和G6的输出不变，G4输出由1变为0，使触发器置0。（2）D=1。当C=0时，G3和G4的输出为1，G6的输出为0，G5的输

6、出为1，触发器的状态不变。当C=1时，G3的输出由1变为0，使触发器置1。维持阻塞D触发器具有在时钟脉冲上升沿触发的持点，其逻辑功能为：输出端Q的状态随着输入端D的状态而变化，但总比输入端状态的变化晚一步，即某个时钟脉冲来到之后Q的状态和该脉冲来到之前D的状态一样。即有：逻辑符号波形图Qn+1=DC上升沿时刻有效8.1.3主从JK触发器工作原理01（1）接收输入信号的过程。C=1时，主触发器被打开，可以接收输入信号J、K，其输出状态由输入信号的状态决定。但由于C=0，从触发器被封锁，无论主触发器的输出状态如何变化，

7、对从触发器均无影响，即触发器的输出状态保持不变。01（2）输出信号过程当C下降沿到来时，即C由1变为0时，主触发器被封锁，无论输入信号如何变化，对主触发器均无影响，即在C=1期间接收的内容被存储起来。同时，由于C由0变为1，从触发器被打开，可以接收由主触发器送来的信号，其输出状态由主触发器的输出状态决定。在C=0期间，由于主触发器保持状态不变，因此受其控制的从触发器的状态也即Q、Q的值当然不可能改变。逻辑功能分析（1）J=0、K=0。设触发器的初始状态为0，此时主触发器的R1=0、S1=0，在C=1时主触发器保持0

8、状态不变；当C从1变0时，由于从触发器的R2=1、S2=0，也保持为0状态不变。如果触发器的初始状态为1，当C从1变0时，触发器则保持1状态不变。可见不论触发器原来的状态如何，当J=K=0时，触发器的状态均保持不变。（2）J=0、K=1。设触发器的初始状态为0，此时主触发器的R1=0、S1=0，在C=1时主触发器保持0状态不变；当C从1变0时，由于从触发器的