移位乘法器教学文稿.doc

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1、移位乘法器精品文档移位乘法器设计报告一、乘法电路工作流程图STEP0:复位。电路初始化,C=0,G[7:4]=0000;STEP1:装载数据。A=1011,B=1101;STEP2:求部分积。加法器运算结果为:G[7:4]+A=0000+1011=1011,故G[7:4]=0101,B=1110;STEP3:求部分积。加法器运算结果为:G[7:4]+0=0101+0000=0101,故G[7:4]=0010,B=1111;STEP4:求部分积。加法器运算结果为:G[7:4]+A=0010+1011=1101,故G[7:4]=1101,B=1111;ST

2、EP5:求部分积。加法器运算结果为:G[7:4]+A=0110+1011=10001,故G[7:4]=1000,B=1111;收集于网络,如有侵权请联系管理员删除精品文档STEP6:输出乘积值M=10001111。二、框图及接口定义CLKA[3:0]B[3:0]LOADOUT[7:0]READYRESET移位乘法器1.框图如图所示2.接口定义接口名称作用备注CLK时钟信号提供时钟RESET#复位信号复位低有效LOAD装载信号装载高有效A[3:0]输入信号输入数据4位输入B[3:0]输入信号输入数据4位输入OUT[0:7]输出信号输出数据8位输出READ

3、Y输出有效提供输出高有效三、实现框图B[3:0]G[7:0]0CIA[3:0]COADD4收集于网络,如有侵权请联系管理员删除精品文档四、实现算法moduleFour_bit_Mutiplicate(A,B,RESET,LOAD,CLK,G,READY);input[3:0]A;input[3:0]B;inputCLK;output[7:0]G;reg[7:0]G=0;reg[3:0]F;wireE;wire[3:0]P;inputRESET;inputLOAD;outputREADY;regREADY=0;收集于网络,如有侵权请联系管理员删除精品文档

4、Four_bite_AdderC1(.S(G[7:4]),.D(F),.SUM(P),.CI(E));always@(CLK)beginif(RESET)beginG<=0;F<=0;READY=0;endif(LOAD)beginF[3:0]<=A;G[3:0]<=B;endif(F)beginF[0]<=F[0]&G[0];收集于网络,如有侵权请联系管理员删除精品文档F[1]<=F[1]&G[0];F[2]<=F[2]&G[0];F[3]<=F[3]&G[0];G[7:4]<=P[3:0];G<=G>>1;G[7]<=E;endelseG[7]<=

5、0;READY<=1;endendmodulemoduleFour_bite_Adder(S,D,SUM,CI);input[3:0]S,D;output[3:0]SUM;outputCI;wirea,b,c;Full_AdderB1(S[0],D[0],0,SUM[0],a);收集于网络,如有侵权请联系管理员删除精品文档Full_AdderB2(S[1],D[1],a,SUM[1],b);Full_AdderB3(S[2],D[2],b,SUM[2],c);Full_AdderB4(S[3],D[3],c,SUM[3],CO);endmodulemo

6、duleFull_Adder(X,Y,CIN,S,COUT);inputX,Y;inputCIN;outputS;outputCOUT;assignS=X^Y^CIN;assignCOUT=(X&Y)+(X&CIN)+(Y&CIN);endmodule收集于网络,如有侵权请联系管理员删除

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