第5章组合逻辑电路设计ppt课件.ppt

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1、第5章组合逻辑电路设计5.1基本门电路的设计5.2数据选择器的设计5.31对2数据分配器的设计5.44位BCD译码器的设计5.5三态门的设计5.6半加器的设计5.7全加器的设计5.86位加法器的设计5.94位加减法器的设计5.103位乘法器的设计习题5.1基本门电路的设计基本门电路主要用来实现基本的输入/输出之间的逻辑关系，包括与门、非门、或门、与非门、或非门、异或门、同或门等，下面以2输入端与非门为例讲解基本门电路的设计。1．实验原理表5-12输入端与非门的真值表2输入端与非门是组合逻辑电路中的基本逻辑器件，有2个输入端A、B和1个输出端C。其真值表如表5-1所示。2输入端与非门应具备

2、的脚位：输入端：A、B；输出端：C。表5-12输入端与非门的真值表输入端输出端ABC0010111011102．原理图输入与非门原理图输入法的操作步骤介绍如下。(1)建立新文件：选取窗口菜单File→New，出现对话框，选择GraphicEditorfile选项，单击OK按钮，进入图形编辑画面。(2)保存：选取窗口菜单File→Save，出现对话框，键入文件名nand2.gdf，单击OK按钮。(3)指定项目名称，要求与文件名相同：选取窗口菜单File→Project→Name，键入文件名nand2，单击OK按钮。(4)确定对象的输入位置：在图形窗口内单击鼠标左键。(5)引入逻辑门：选取窗

3、口菜单Symbol→EnterSymbol，在Maxplus2max2libprim处双击，在SymbolFile菜单中选取NAND2逻辑门，单击OK按钮。(6)引入输入和输出脚：按步骤(5)选出2个输入脚和1个输出脚。(7)更改输入和输出脚的脚位名称：在PIN_NAME处双击鼠标左键，进行更名，输入脚为A、B，输出脚为C。(8)连接：将A、B脚连接到与非门的输入端，C脚连接到与非门的输出端，如图5-1所示。(9)选择实际编程器件型号：选取窗口菜单Assign→Device,出现对话框，选择ACEX1K系列的EP1K30TC144-1。(10)保存并查错：选取窗口菜单File→Pr

4、oject→Save&Check，即可针对电路文件进行检查。图5-12输入端与非门的原理图(11)修改错误：针对Massage-Compiler窗口所提供的信息修改电路设计，直到没有错误为止。(12)保存并编译：选取窗口菜单File→Project→Save&Compile，即可进行编译，产生nand2.sof烧写文件。(13)创建电路符号：选取窗口菜单File→CreateDefaultSymbol，可以产生nand2.sym文件，代表现在所设计的电路符号。选取File→EditSymbol，进入SymbolEdit画面，2输入端与非门的电路符号如图5-2所示。(14)创建电路包含文件

5、：选取窗口菜单File→CreateDefaultIncludeFile，产生用来代表目前所设计电路的nand2.inc文件，供其他VHDL编译时使用，如图5-3所示。(15)时间分析：选取窗口菜单Utilities→AnalyzeTiming，再选取窗口菜单Analysis→DelayMatrix，可以产生如图5-4所示的时间分析结果。图5-22输入端与非门的电路符号图5-32输入端与非门的电路包含文件图5-42输入端与非门的时间分析3．文本输入(1)建立新文件：选取窗口菜单File→New，出现对话框，选择TextEditorfile选项，单击OK按钮，进入文本编辑画面。(2)保存：

6、选取窗口菜单File→Save，出现对话框，键入文件名nand2.text，单击OK按钮。(3)指定项目名称，要求与文件名相同：选取窗口菜单File→Project→Name,键入文件名nand2，单击OK按钮。(4)选择实际编程器件型号：选取窗口菜单Assign→Device，出现对话框，选择ACEX1K系列的EP1K30TC144-1。(5)输入VHDL源程序：ENTITYnand2ISPORT(A,B:INBit;C:OUTBit);ENDnand2;ARCHITECTUREaOFnand2ISBEGINC<=not(AANDB);ENDa;(6)保存并查错：选取窗口菜单File→

7、Project→Save&Check，即可针对电路文件进行检查。(7)修改错误：针对Massage-Compiler窗口所提供的信息修改电路文件，直到没有错误为止。(8)保存并编译：选取窗口菜单File→Project→Save&Compile，即可进行编译，产生nand2.sof烧写文件。(9)创建电路符号：选取窗口菜单File→CreateDefaultSymbol，可以产生nand2.sym文件，代表现在所设计的电路符号。选取