第2讲 QUARTUSⅡ开发软件 EDA课件.ppt

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1、第2讲　QUARTUSⅡ开发软件2.1图形输入法设计实例2.2文本输入法设计实例2.3宏功能模块及其使用1输入图形设计文件2编译分析综合：分析（检查原理图信号线有无虚接）综合（完成逻辑设计到器件资源的映射）适配：完成设计逻辑在器件中的布局布线、选择适当的内部互连路径、引脚分配、逻辑元件分配等操作汇编：产生多种形式的器件编程映像文件，可下载到目标芯片的编程文件中时序分析3仿真（建立波形文件、输入信号节点、设置波形参量、编辑输入信号、保存波形文件、运行仿真器）4编程下载（分配引

2、脚、重新编译、连接电缆、下载、硬件测试）§2.1QuartusⅡ图形输入设计步骤4位加法器设计实例本节将通过一个4位加法器的设计实例来介绍采用图形输入方式进行简单逻辑设计的步骤。图2.14位加法器端口§2.1.14位加法器逻辑设计4位加法器是一种可实现两个4位二进制数的加法操作的器件，其输入/输出端口如图2.1所示。输入为两个4位二进制的被加数A和B，以及输入进位位Ci，输出为一个4位二进制和数D和输出进位位Co。图2.24位加法器的顶层结构4位加法器的顶层结构如图2.2所示，由一个半加器和三个

3、全加器串接而成。工作时，首先是低位A1与B1两位数相加，得出最低位的和数D1和进位位C1，然后第二位加数A2、B2以及第一位全加运算后的进位输出C1进行全加操作，得到和数的第二位D2和进位位C2，依次类推，最终获得4位和数D4和进位位Co。A=(A4A3A2A1)B=(B4B3B2B1)表2.1半加器逻辑状态表ABCS0000010110011110半加操作就是求两个加数A、B的和，输出本位和数S及进位数C，其逻辑状态如表2.1所示。由逻辑状态表可写出逻辑式：由逻辑式可获得如图2.3所示的逻辑图

4、。图2.3半加器逻辑结构每个全加器有3位输入，分别是加数A、B和一个进位位Ci。将这三个数相加，得出本位和数(全加和数)D和进位数Co。这个过程称为“全加”，全加器的逻辑状态如表2.2所示。表2.2全加器的逻辑状态表ABCiCoD0000000101010010111010001101101101011111全加器如图2.4所示，由两个半加器和一个“或”门组成。图2.4全加器逻辑结构工作时A和B在第一个半加器中相加，得出的结果再和Ci在第二个半加器中相加，即得出全加和D。两个半加器的进位数通过“

5、或”门输出作为本位的进位数Co。§2.1.2半加器模块设计过程本节将介绍使用Quartus Ⅱ 6.0“GraphicEditor”进行设计输入的步骤。(1)双击桌面上的Quartus Ⅱ 6.0快捷图标，打开如图2.5所示的“Quartus Ⅱ”窗口。图2.5“Quartus Ⅱ”窗口(2)选择如图2.6所示的“File”→“NewProjectWizard…”命令，打开如图2.7所示的“NewProjectWizard：Introduction”对话框。图2.6选择“File”→“NewPr

6、ojectWizard…”命令图2.7“NewProjectWizard：Introduction”对话框图2.8“NewProjectWizard：Directory，Name，Top-LevelEntity[page1of5]”对话框(4)在如图2.8所示的对话框中输入新建项目的地址路径，本例中设置路径为“d:example”。输入项目的名称，本例中设置项目名称为“hsa”。输入设计实体的名称，本例中设置设计实体的名称为“hsa”，单击“Next”按钮，打开如图2.9所示的“NewProj

7、ectWizard：AddFiles[page2of5]”对话框。图2.9“NewProjectWizard：AddFiles[page2of5]”对话框“NewProjectWizard：AddFiles[page2of5]”对话框用于向项目中添加已存在的文件，由于本例中新建的是空白项目，因此暂时没有文件需要添加。(5)在如图2.9所示的对话框中单击“Next”按钮，打开如图2.10所示的“NewProjectWizard：Family&DeviceSettings[page3of5]”对话框

8、。图2.10“NewProjectWizard：Family&DeviceSettings[page3of5]”对话框(6)在如图2.10所示的对话框中的“Family”下拉列表中选择“FLEX10K”，在“Targetdevice”区域中选择“Specificdeviceselectedin‘Availabledevices’list”单选项。然后在对话框下方的“Availabledevices”列表中选择“EPF10K10LC84-4”，单击“Next”按钮，打开如图2.11所示的“NewP