8255a并行接口应用

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1、课程设计说明书NO.18255并行接口应用1.课程设计的目的为了巩固《微型计算机技术》课程学到的相关知识，通过对本课程所学知识的综合运用，使学生融会贯通课程中所学的理论知识，加深对计算机系统各个部分的工作原理及相互联系的认识，加深对接口的理解，清晰地建立计算机系统的概念，培养学生进行微机应用系统硬件和软件开发的实践工作能力。2.设计方案论证2.1并行接口芯片具有的功能：（1）具有两个以上的输入/输出数据端口（锁存/缓冲）；（2）每个数据端口有与CPU用应答方式交换信息所必须的控制和状态信息；也有与外设交换信息所必

2、须的控制和状态信息；（3）通常每个数据端口还具有能用中断方式与CPU交换信息所必须的电路；（4）具有进行片选和读写控制的电路；（5）可编程（由程序来选择数据端口，数据传送方向，交换信息的方式等）。本课程设计为键盘接口，键盘的扫描过程所以采用8255A芯片。设计所需设备：8255A芯片、键盘2.28255芯片介绍2.2.18255内部结构(一)数据端口8255A内部包含3个8位I/O端口A口、B口和C口，通过外部24根I/O线与外设交换数据或进行通信联络。其中C口可分为两个4位口使用。端口A和端口B可用作8位数据I

3、/O口，端口C既可作为8位I/O口，又可作为两个4位I/O口，还常用来配合A口和B口工作，作为控制信号输出、或作为状态信号输入。(二)控制逻辑这是两组根据CPU的编程命令控制8255A工作的电路，它们内部有控制寄存器，用来沈阳大学课程设计说明书NO.2接收CPU送来的命令字，以决定A组、B组的工作方式，或对C口的每一个位执行置位/复位操作。端口A和端口C的上半部分（PC7～PC4）由A组控制逻辑管理，端口B和端口C的下半部分（PC3~PC0）由B组控制逻辑管理。(三)数据总线缓冲器数据总线缓冲器是双向三态的8位缓

4、冲器,用作8255A和系统数据总线的接口。(1)接收CPU送来的数据或控制字；(2)外设传送给CPU的数据或状态信息；(四)读/写控制逻辑控制总线的开放与关闭；控制信息传送的路径和方向。A1A0=00，选中端口A,A1A0=01，选中端口B,A1A0=10，选中端口C,A1A0=11，选中控制字寄存器端口。(五)端口寻址8255A端口选择和控制信号如表1所示：表18255A端口选择和控制信号A1、A0端口功能00001A口读A口00010A口写A口00101B口读B口00110B口写B口01001C口读C口/读状

5、态01010C口写C口01110控制口写控制字1XXXXX总线高阻（六）端口选择信号沈阳大学课程设计说明书NO.3系统数据总线的低8位，这样CPU要求芯片内部的各个端口都使用偶地址。（七）8255A的控制字⑴方式选择控制字8255A有3种基本的工作方式，在对8255A进行初始化编程时，应向控制寄存器写入方式选择控制字，以规定各端口的工作方式。方式选择控制字格式如图1所示：图18255A的控制方式字⑵置位/复位控制字端口C常用作控制或应答信号，通过对8255A的控制口写入置位/复位控制字，可使C口的任一个引脚的输出

6、单独置1或置0。复位控制字格式如图2所示：沈阳大学课程设计说明书NO.4图28255A的复位控制字2.2.28255A的工作方式(一)方式0－基本输入输出方式适用于不需要应答信号的简单I/O场合。A口和B口可作为8位端口，C口的高4位和低4位可作为两个4位的端口，且每个端口均可作为输入口或输出口用。数据输出有锁存，输入不能锁存。(二)方式1－选通输入/输出方式端口A或B用作数据口，均可以工作于输入或输出方式。这两个8位数据口的输入、输出数据都能锁存，但必须在联络信号的控制下完成I/O操作，端口C的部分引脚用来产生

7、或接收这些联络信号。①选通输入方式此时PC3~5和PC0~2分别用作A口和B口的状态和控制线,PC6和PC7用作I/O线。方式1选通输入方式如图3所示：图3方式1选通输入方式沈阳大学课程设计说明书NO.5各控制联络信号的意义：:选通输入信号，低电平有效。A组控制方式字应PC4;B组方式对应PC2;IBF:输入缓冲器满信号，高电平有效。A组控制方式字对应PC5;B组方式控制字中对应PC1;INTR:中断请求信号，高电平有效。A组方式控制字中对应PC3;B组方式控制字中对应PC0;INTE:中断允许信号，高电平有效。

8、该信号为高时，允许中断请求，为低时则屏蔽中断请求。②选通输出方式PC3、PC6和PC7作A口的应答信号，PC0、PC1和PC2作B口的应答信号。余下的PC4和PC5可作输入或输出线。方式1输出方式如图4所示：图4方式1选通输出方式各应答信号的意义：OBF－输出缓冲器满信号，输出，低电平有效。表示CPU已输出数据到指定端口。ACK－外设的回答信号，低电平有效，由外设送给82