基于vhdl的语音数字钟的设计

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1、毕业设计（论文）题目:基于VHDL的语音数字钟的设计学院物理科学与工程技术专业电子信息班级08电信学号200812108120001姓名陈世羽指导老师刘瑶老师二O一一年九月二十日89摘要本设计主要研究基于VHDL的语音数字钟的设计，该数字钟具有年、月、日、时、分、秒计数显示功能，以24小时循环计数；具有校对功能、整点报时以及清零、使能功能。本设计主要是在介绍了EDA及VHDL一些相关基本知识的基础上，进一步采用EDA技术，以硬件描述语言VHDL为系统逻辑描述手段设计文件，在Max+plusII工具软件环境下，采

2、用自顶向下的设计方法，由各个基本模块共同构建了一个多功能语音数字钟，最后通过仿真出时序图实现预定功能。其中，重点叙述了数字钟的设计原理和分模块实现的方法，详细介绍了各模块的设计程序并给出了各模块的波形仿真图及分析，最后通过在Max+plusII上进行时序仿真，调试运行，在硬件测试后，验证了所设计的系统达到了预先设计目标。通过这次的设计更进一步地增强了实验的动手能力，对数字钟的工作原理及EDA技术也有了更加透彻的理解。关键词：VHDLEDA数字钟仿真图89TheDesign of aVoiceDigitalClo

3、ck Based on VHDLAbstractThedesignforamulti-functionaldigitalclock,withayear,month,day,hours,minutesandsecondscountdisplaytoa24-hourcyclecount;haveprooffunctionsandthewholepointtimekeepingfunction.ThedesignismainlytheintroductionoftheEDAandsomerelatedbasickno

4、wledgeofVHDL,basedonthefurtheruseofEDAtechnology,hardware-descriptionlanguageVHDLdescriptionlogicmeansforthesystemdesigndocuments,inMaxplusIItoolsenvironment,atop-downdesign,bythevariousmodulestogetherbuildavoicedigitalclock.Finally,atimingdiagramofthesimula

5、tiontoachievetheintendedfunction.Describesthekeydesignprinciplesanddigitalclocksub-moduleapproach.Finally,byMax+plusIIontimingsimulation,debuggingandrunning,bythehardwaretesting,thetwosystemsdesignedareverifiedtorealizetheadvanceddesigngoal.Throughthisexperi

6、mentaldesignfurtherenhancestheabilityofthedigitalclockworksandEDAtechnologyhasamorethoroughunderstanding.Keywords:VHDLEDAdigitalclockSimulationdiagram89目录第一章绪论11.1选题背景11.1.1课题相关技术的发展11.1.2课题研究的必要性21.2课题研究的内容2第二章EDA概述32.1EDA简介32.2可编程逻辑器件FPGA32.3硬件描述语言VHDL42.3

7、.1VHDL的特点52.3.2VHDL的设计结构62.3.3VHDL的设计步骤62.4MAX+plusⅡ概述7第三章数字钟的设计要求及总体设计83.1设计要求83.2总体设计83.2.1设计框图83.2.2设计原理图93.3设计原理103.4各模块及其功能103.5端口引脚名称11第四章VHDL程序设计124.1分频模块124.2软件设计134.2.1SECOND模块134.2.2MINUTE模块154.2.3HOUR模块174.2.4扫描模块184.2.5显示模块204.2.6定时闹钟模块214.2.7日计数

8、模块234.2.8月计数模块254.2.9年计数模块274.3硬件测试及说明304.3.1顶层模块原理图30894.3.2电子钟基本功能仿真结果314.3.3硬件测试说明324.3.4结论32第五章总结33参考文献35致谢3689第一章绪论现代社会的标志之一就是信息产品的广泛使用，而且是产品的性能越来越强，复杂程度越来越高，更新步伐越来越快。支撑信息电子产品高速发展的基础就是微电子制造