tdd-lte系统下行多用户控制信道实现关键技术研究

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1、．、７．：；；［朵击种化Ａ著Ｉ，．？巧．．山、ＵＮＩＶＥＲＳＩＴＹＯＦＥＬＥＣＴＲＯＮＩＣＳＣＩＥＮＣＥＡＮＤＴＥＣＨＮＯＬＯＧＹＯＦＣＨＩＮＡＭ＇？专业学位硕±学位论文■ＭＡＳＴＥＲＴＨＥＳＩＳＦＯＲＰＲＯＦＥＳＳＩＯＮＡＬＤＥＧＲＥＥ＇ＳＩ－．碱卢气．１…？炒ｉＡ；挪４＾＾＾！气；是心＇／ｓｓｅＩ．Ｉ３论支题目ＴＤＤ－ＬＴＥ系统下行多用户检制信道￣实现关雜技术妍究专业学位类别工程硕－上—学号２０１３２２２６０１４６爭化者姓名

2、陈帅、爭指导教师雷霞教授？＇独剑性声明本人声明所呈交的学位论文是本人在导师指导下进行的研究工作及取得的研究成果。据我所知，除了文中特别加标注和致谢的地方夕ｈ，论文中不包含其他人已经发表或撰写过的研究成果，也不包含为获得电子科技大学或其它教育机构的学位或证书而使用过的材料。与我一同工作的同志对本研究所做的任何贡献均已在论文中作了明确的说明并表示谢意。作者签名！Ｉ月巧日：傑帥日期：（）年论文使用授权本学位论文作者完全了解电子科技大学有关保留、使用学位论文的规定，有权保留并向国家有关部口或机构送交论文的复印件和磁盘，

3、允许论文被查阅和借阅。本人授权电子科技大学可Ｗ将学位论文的全部或部分内容编入有关数据库进行检索，可Ｗ采用影印、缩印或扫描等复制手段保存、汇编学位论文。（保密的学位论文在解密后应遵守此规定）队作者签名；炼导师签名：畫－呼日期：年＾月巧日分类号密级注1UDC学位论文TDD-LTE系统下行多用户控制信道实现关键技术研究（题名和副题名）陈帅（作者姓名）指导教师雷霞教授电子科技大学成都（姓名、职称、单位名称）申请学位级别硕士专业学位类别工程硕士工程领域名称电子与通信工程提交论文日期2016.04.20论文答辩日期2016.05.20学位授予单位和日期电子

4、科技大学2016年06月答辩委员会主席评阅人注1：注明《国际十进分类法UDC》的类号。RESEARCHONTHEKEYTECHNOLOGIESANDTHEIMPLEMENTATIONOFTHEMULTI-USERPDCCHCHANNELOFTDD-LTESYSTEMAMasterThesisSubmittedtoUniversityofElectronicScienceandTechnologyofChinaMajor:MasterofEngineeringAuthor:ChenShuaiAdvisor:Prof.LeiXiaSchool:NationalKeyLaborat

5、oryofScienceandTechnologyonCommunications摘要摘要长期演进（Long-TermEvolution，LTE）在近年来得到了极大发展和广泛应用。分时长期演进（TimeDivisionLongTermEvolution，TDD-LTE）是它的一个重要的发展方向。本文研究了TDD-LTE系统中物理下行控制信道（PhysicalDownlinkControlChannel，PDCCH）的关键技术和实现方法，及其在TMS320C6670多核DSP平台上的实现。论文分析了TDD-LTE物理层协议，梳理了PDCCH信道的输入格式与功能；研究了发射机和接

6、收机的关键算法，进行算法选型；设计了收发数据处理的流程，在Matlab上搭建链路级浮点仿真平台；分析了全部四种格式的PDCCH在加性高斯白噪声（AdditiveWhiteGaussianNoise，AWGN）信道下的性能，研究了单天线和发射分集对信道性能的影响。论文研究了TDD-LTE实验系统所使用的串行快速输入输出接口（SerialRapidI/O，SRIO）。论文分析了SRIO接口的体系规范和编程机制；基于实验样机的整体结构和协议规定，完善设计了基于SRIO的物理层与调度层及射频单元的数据传输模式；测试了物理层与调度层，物理层与射频单元间SRIO的连通性；论文同时测试了D

7、SP与调度层和射频单元两个通道的数据传输速率，验证了SRIO的性能满足实验样机的通信要求。论文研究了TMS320C6670多核DSP芯片的特点，在多核DSP平台上完成了PDCCH收发信机的实现；论文利用了比特加速协处理器（BitRateCoprocessor，BCP）对PDCCH发端的CRC添加、速率匹配、咬尾卷积编码和调制进行加速。论文重点研究了PDCCH信道盲检测过程的实现。PDCCH由于先验信息不足，在收端必须通过盲检测进行解析，根据协议规定，盲检测次数最多可达44次，从而成为实验系统的性能瓶颈；