MOS集成电路的基本制造工艺ppt课件.ppt

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1、1.2MOS集成电路的基本制造工艺12CMOS工艺技术是当代VLSI工艺的主流工艺技术，它是在PMOS与NMOS工艺基础上发展起来的。其特点是将NMOS器件与PMOS器件同时制作在同一硅衬底上。CMOS工艺技术一般可分为三类，即P阱CMOS工艺N阱CMOS工艺双阱CMOS工艺3P阱CMOS工艺P阱杂质浓度的典型值要比N型衬底中的高5~10倍才能保证器件性能。然而P阱的过度掺杂会对N沟道晶体管产生有害的影响，如提高了背栅偏置的灵敏度，增加了源极和漏极对P阱的电容等。4P阱CMOS工艺电连接时，P阱接最负电位，N衬底接最正电位，通过反向

2、偏置的PN结实现PMOS器件和NMOS器件之间的相互隔离。P阱CMOS芯片剖面示意图见下图。5N阱CMOS工艺N阱CMOS正好和P阱CMOS工艺相反，它是在P型衬底上形成N阱。因为N沟道器件是在P型衬底上制成的，这种方法与标准的N沟道MOS(NMOS)的工艺是兼容的。在这种情况下，N阱中和了P型衬底，P沟道晶体管会受到过渡掺杂的影响。6N阱CMOS工艺早期的CMOS工艺的N阱工艺和P阱工艺两者并存发展。但由于N阱CMOS中NMOS管直接在P型硅衬底上制作，有利于发挥NMOS器件高速的特点，因此成为常用工艺。7N阱CMOS芯片剖面示意

3、图N阱CMOS芯片剖面示意图见下图。8双阱CMOS工艺随着工艺的不断进步，集成电路的线条尺寸不断缩小，传统的单阱工艺有时已不满足要求，双阱工艺应运而生。9双阱CMOS工艺通常双阱CMOS工艺采用的原始材料是在N+或P+衬底上外延一层轻掺杂的外延层，然后用离子注入的方法同时制作N阱和P阱。10双阱CMOS工艺使用双阱工艺不但可以提高器件密度，还可以有效的控制寄生晶体管的影响，抑制闩锁现象。11双阱CMOS工艺主要步骤双阱CMOS工艺主要步骤如下：（1）衬底准备：衬底氧化，生长Si3N4。（2）光刻P阱，形成阱版，在P阱区腐蚀Si3N4

4、，P阱注入。（3）去光刻胶，P阱扩散并生长SiO2。（4）腐蚀Si3N4，N阱注入并扩散。（5）有源区衬底氧化，生长Si3N4，有源区光刻和腐蚀，形成有源区版。（6）N管场注入光刻，N管场注入。12双阱CMOS工艺主要步骤（7）场区氧化，有源区Si3N4和SiO2腐蚀，栅氧化，沟道掺杂（阈值电压调节注入）。（8）多晶硅淀积、掺杂、光刻和腐蚀，形成多晶硅版。（9）NMOS管光刻和注入硼，形成N+版。（10）PMOS管光刻和注入磷，形成P+版。（11）硅片表面生长SiO2薄膜。（12）接触孔光刻，接触孔腐蚀。（13）淀积铝，反刻铝，形成

5、铝连线。13MOS工艺的自对准结构自对准是一种在圆晶片上用单个掩模形成不同区域的多层结构的技术，它消除了用多片掩模所引起的对准误差。在电路尺寸缩小时，这种有力的方法用得越来越多。有许多应用这种技术的例子，例子之一是在多晶硅栅MOS工艺中，利用多晶硅栅极对栅氧化层的掩蔽作用，可以实现自对准的源极和漏极的离子注入，如图所示。14自对准工艺示意图15自对准工艺上图中可见形成了图形的多晶硅条用作离子注入工序中的掩模，用自己的“身体”挡住离子向栅极下结构（氧化层和半导体）的注入，同时使离子对半导体的注入正好发生在它的两侧，从而实现了自对准。而

6、且原来呈半绝缘的多晶硅本身在大量注入后变成低电阻率的导电体。可见多晶硅的应用实现“一箭三雕”之功效。1617181920212223242526272829303132333435363738394041424344454647484950515253545556575859606162636465无定形硅66676869707172737475767778锑离子798081828384858687888990919293949596979899100101氩1021031041051061071081091101111121131

7、14115116117118炭化硅119120121122123124125126127128129130131132133134135136137138139140141142143144145146147148149150151152153154155156157158159160161162163164165166167168169170171172173174175176177178179180181182183184185186187188189190191192193194195196197198199200201202

8、203204205206207208209210211212213214215216217此课件下载可自行编辑修改，供参考！感谢您的支持，我们努力做得更好！