行间转移面阵CCD驱动电路.ppt

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1、基于CPLD的行间转移面阵CCD驱动电路的研究姓名：导师：学号：课题意义？主要工作？结论？课题意义？主要工作？结论？主要工作IT型面阵CCD？驱动脉冲特点？的研究与实现？IT型面阵CCD电源的特点？与实现？面阵CCD驱动程序设计？与仿真？驱动硬件电路？的设计？驱动印刷电路板？的设计返回主要工作课题的意义当前面阵CCD应用广泛，但驱动方面研究集中于时序方面，整体驱动系统的研究（软件+硬件）不完整也不全面。CPLD的高速以及并行性VHDL语言的通用性和可靠性电路的可扩展性有效的控制了产品开发的成本，而且极大的提高了同类型产品开发的

2、效率。返回行间转移面阵CCD（ICX098AK）水平驱动：两路时序H1/H2；垂直驱动：四路脉冲V1/V3/V2A/V2BCPLD输出的V2a与V2b分别与XSG1及XSG2（均为二值时序）合成成为V2A和V2B（三电平脉冲）还需要CCD输出“采样/保持”以及“模数转换”芯片的控制时序。总时序数为22路。返回前期时序的实现（VHDL编程）使用唯一的系统时钟，在其基础上进行同步的设计采用多进程（Process）并行工作在程序运行时需要的所有中间变量以及传值参数均使用信号参数（Signal）通过单一系统时钟的分频、计数与组合输出所有

3、需要的驱动时序重要经验---------Counter780:780*6-1process(MCK6)beginif(MCK6'eventandMCK6='1')thenif(Co1="1001001000111")thenCo1<="0000000000000";LineFlag<='1';elseCo1<=Co1+'1';LineFlag<='0';endif;endif;endprocess;水平转移时序进程：------H1andH2:44~116(*3)process(MCK6)beginif(MCK6'eventan

4、dMCK6='1')thenif(Co1<"0000100001000")thenH1_temp<='1';elsif(Co1<"0001010111000")thenH1_temp<='0';elseH1_temp<='1';endif;endif;endprocess;H1<=H1_tempandCP_temp;H2<=not(H1_tempandCP_temp);返回延时方面仿真中，计数器的延时相当于一个门。与（and）、或（or）、异或（xor）对应的延时是相同的，而not（非）不会产生延迟。对信号无论几次做逻辑运算（求

5、与、求或、求非…），除了not，都只相当于一个门的延迟。程序方面编程中应尽量减少变量的使用。使用变量，无法对设计的运行情况有效验证。算法方面奇数分频与半整数分频在程序编写中积累的部分经验返回返回PrevNext芯片说明要求的时序编程实现的22路时序（1）图3.4.1仿真帧视图返回NextPrev编程实现的22路时序（2）图3.4.3仿真行视图返回NextPrev编程实现的22路时序（3）图3.4.4单行仿真时序图返回NextPrev编程实现的22路时序（4）图3.4.5单行仿真时序图返回NextPrev驱动电路系统面阵CCD驱动

6、脉冲的特点：1.垂直脉冲为三值脉冲(+15V,0V,-8.5V)，需将CPLD输出二值时序进行合成。2.其他驱动脉冲部分0-5V；部分0-3.3V故而需要电平转换（低压差线性转换）3.+15V上电需早于-8.5V。4.需要CPLD开漏设置。返回驱动脉冲产生电路？上电顺序管理电路？电平转换电路？外围支持电路？输出信号预处理电路？输出端口？系统模块构成返回三值电平生成方案1.2.使用集成驱动脉冲合成器返回脉冲合成电路返回上电控制方案1.2.使用MAX685返回上电控制电路返回MAX685电路参数由R4和R3构成的分压器确定着反向输出

7、电压的压值。，应尽量使R4和R2的值接近100KΩ。（1）由R1和R2构成的分压器确定着正向输出电压的压值（2）返回电平转换电路左图--可调电源电路使用集成运放实现内外电路的阻抗隔离。通过滑动变阻器调节输出电压压值。CPLD的电源选择电路（右图）由于EPM7128具有多电压接口，为实现CPLD的双电压输出选择，设计了为VCCIO输入两种电压的跳线供用户选择。返回CPLD下载电路，系统时钟返回输出信号预处理电路返回试验接口返回JTAG下载电路PCB返回JTAG下载器PCB返回系统模块分布及构成？返回PCB制成型的驱动电路PCB返回

8、结论（1）针对面阵CCD驱动时序的要求，设计完成了ICX098AK芯片的基于VHDL的驱动程序。并使用软件进行了仿真，仿真结果和要求完全吻合。（2）针对面阵CCD工作时序特征，设计了以EPM7128SLC84-5和CXD1267AN共同构成的驱动脉冲产生电路。使