数电-模电-单片机等面试题目.doc

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1、模电数电题&{2t8d)A1I;]"}0n1、基尔霍夫定理的内容是什么？基尔霍夫定律包括电流定律和电压定律2r)u8w&w!r*l:T4i5F电流定律：在集总电路中，任何时刻，对任一节点，所有流出节点的支路电流的代数和恒等于零。电压定律：在集总电路中，任何时刻，沿任一回路，所有支路电压的代数和恒等于零。2、描述反馈电路的概念，列举他们的应用。*z-J#y2n5N;s,b3T!v反馈：把输出回路的电量输入到输入回路中去。-v  

2、%~;H1U1z反馈的类型有：电压串联负反馈、电流串联负反馈、电压并联负反馈、电流并联负反馈。!N#:d%

3、b,o负反馈的优点：降低放大器的增益灵敏度，改变输入电阻和输出电阻，改善放大器的线性和非线性失真，有效地扩展放大器的通频带，自动调节作用。电压负反馈的特点：电路的输出电压趋向于维持恒定。.i6o7T/T+@(

4、4h'Q-w7i电流负反馈的特点：电路的输出电流趋向于维持恒定。0S'Y)o*H&T9d:W3、有源滤波器和无源滤波器的区别无源滤波器：这种电路主要有无源元件R、L和C组成"q$r'i/M+_*{,e:[有源滤波器：集成运放和R、C组成，具有不用电感、体积小、重量轻等优点。数字电路1、同步电路和异步电路的区别是什么？同步电路：存

5、储电路中所有触发器的时钟输入端都接同一个时钟脉冲源，因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。/D+D1t+Y2K#E"h异步电路：电路没有统一的时钟，有些触发器的时钟输入端与时钟脉冲源相连，这有这些触发器的状态变化与时钟脉冲同步，而其他的触发器的状态变化不与时钟脉冲同步。:2、什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？4d7y6a7y3m;{将两个门电路的输出端并联以实现与逻辑的功能成为线与。在硬件上，要用OC门来实现，同时在输出端口加一个上拉电阻。8p/M3C2P  e4j'N0~&Z)O3、解释set

6、up和holdtimeviolation建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。3a%z%U&E*@0n9Q4、什么是竞争与冒险现象？怎样判断？如何消除？在组合逻辑中，由于各个输入信号通路经过了不同的延时，导致到达该门的时间不一致叫竞争。产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。)R0g:n$S-w  M:w解决方法：一是添加布尔式的消去项，二是在芯片外部加电容。5、名词：SRAM、SSRAM、SDRAMSRAM：静态RAM

7、3h3V9?&a+Z'SDRAM：动态RAM(J9n&?-?1G#M+_%Q!sSSRAM：同步静态随机访问存储器。它的一种类型的SRAM。SSRAM的所有访问都在时钟的上升/下降沿启动。地址、数据输入和其它控制信号均于时钟信号相关。这一点与异步SRAM不同，异步SRAM的访问独立于时钟，数据输入和输出都由地址的变化控制。/]+d#W-}#U(E(f4}SDRAM：同步动态随机存储器:m%U&}"N!f0G6K6、FPGA和ASIC的概:}2v%x8j  I'M7v0

8、+C答案：FPGA是可编程逻辑电路。  4G)x%d*_6t(?"

9、y*EASIC:专用集成电路'

10、4y$w,a8C6H-g6u%G6{&_8、单片机上电后没有运转，首先要检查什么？1.-L;U:u*G2Z5`9R首先应该确认电源电压是否正常。用电压表测量接地引脚跟电源引脚之间的电压，看是否是电源电压。2.接下来就是检查复位引脚电压是否正常。分别测量按下复位按钮和放开复位按钮的电压值。3.检查晶振是否起振了，用示波器来看晶振引脚的波形，注意应该使用示波器探头的“X10”档。2、平板电容公式(C=εS/4πkd)。9M3O  ].t"m+z7g2m,{10、你知道那些常用逻辑电平？TTL与COMS电平可

11、以直接互连吗？+v2x2`!A.{1?#H常用逻辑电平：12V，5V，3.3V；TTL和CMOS不可以直接互连，由于TTL是在0.3-3.6V之间，而CMOS则是有在12V的有在5V的。CMOS输出接到TTL是可以直接互连。TTL接到CMOS需要在输出端口加一上拉电阻接到5V或者12V。,g2W0Z(t"o,P4B4k"Z5t"n11、如何解决亚稳态。亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚7r6o6N4I;`.u稳态时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平 上。

12、在这个稳定期间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无用的输出电平可以沿信号通道上的各个触发器级联式传播下去。3F*d6#N*Z"h:C1、简单描述一个单片机系统的主要组成模块，并说明各模块之间的数