数字电路译码与译码器讲课教案.ppt

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1、数字电路译码与译码器e)二进制译码器译码输入：n位二进制代码译码输出m位控制信息：m=2n译码规则：对应输入的一组二进制代码有且仅有一个输出端为有效电平，其余输出端为相反电平2译码器——二进制译码器译码输入译码输出2位二进制译码器译码输入译码输出a1a0y0y1y2y30001110110111011011111102位二进制译码器010100100010110001y0y1y2y3a1a0001000有效电平为“1”有效电平为“0”34.5.2集成译码器当使能输入端EI有效时，对应每一组输入代码，只有

2、其译码对应的一个输出端为有效输出，其余输出端均为无效输出。n个输入端若干个使能输入端EI2n个输出端以二进制集成译码器为代表1.集成译码器框图42.集成译码器典型产品双2－4线译码器74××139两个完全独立2－4线二进制译码器；译码输出低电平有效；1个低电平有效译码使能端；封装：DIP16；52.集成译码器典型产品3－8线译码器74××138单3－8线二进制译码器；译码输出低电平有效；2个低电平有效译码使能端和1个高电平有效译码使能端；封装：DIP16；62.集成译码器典型产品4－10线译码器74145、

3、7442、7443、7444单个4－10线译码器；分别为8421BCD（74145）、8421BCD（7442）、余3码（7443）、余3格雷码输入（7444）；译码输出低电平有效（74145同时为OC输出）；无译码使能端；封装：DIP16；72.集成译码器典型产品4－16线译码器74××154单个4－16线译码器；译码输出低电平有效；2个低电平有效译码使能端封装：DIP24；83.集成译码器74××138功能表及其应用74××138框图与内部电路3个输入端3个控制端8个输出端974××138集成译码器功能

4、表输入输出G1G2AG2BABCY0Y1Y2Y3Y4Y5Y6Y7×H××××HHHHHHHH×XH×××HHHHHHHHL×××××HHHHHHHHHLLLLLLHHHHHHHHLLLLHHLHHHHHHHLLLHLHHLHHHHHHLLLHHHHHLHHHHHLLHLLHHHHLHHHHLLHLHHHHHHLHHHLLHHLHHHHHHLHHLLHHHHHHHHHHL1074××138基本应用用74××138实现4－16线译码（留作习题）11例：用3—8译码器构成4—16译码器X0-X3：译码输入E：译码

5、控制E=0，译码E=1，禁止译码X3-X0：0000-0111，第一片工作X3-X0：1000-1111第二片工作000-111译码输入001000000-111译码输入10100112d)译码器应用数据分配器：相当于有多个输出的单刀多掷开关，将从一个数据源来的数据分时送到多个不同的通道上去的逻辑电路。数据分配器示意图13译码器作为数据分配器以74LS138为例说明用译码器实现数据分配器0１0１14输入输出G1G2BG2AA2A1A0Y0Y1Y2Y3Y4Y5Y6Y7LLXXXXHHHHHHHHHLDLLLD

6、HHHHHHHHLDLLHHDHHHHHHHLDLHLHHDHHHHHHLDLHHHHHDHHHHHLDHLLHHHHDHHHHLDHLHHHHHHDHHHLDHHLHHHHHHDHHLDHHHHHHHHHHD74138译码器作为数据分配器时的功能表1574138工作条件：G1=1，G2A=G2B=0例用74××138译码器实现函数用74××138实现任意组合逻辑函数1674××138集成译码器功能表输入输出G1G2AG2BCBAY0Y1Y2Y3Y4Y5Y6Y7×H××××HHHHHHHH×XH×××HHH

7、HHHHHL×××××HHHHHHHHHLLLLLLHHHHHHHHLLLLHHLHHHHHHHLLLHLHHLHHHHHHLLLHHHHHLHHHHHLLHLLHHHHLHHHHLLHLHHHHHHLHHHLLHHLHHHHHHLHHLLHHHHHHHHHHL3–8线全译码器能产生三变量函数的全部最小项。基于这一点能够方便地实现任意三变量逻辑函数。如何实现多于三变量的任意逻辑函数？17例：试用CT74LS138和与非门构成一位全加器。解:全加器的最小项表达式应为Si=Ci+1=全加器真值表输入输出AiBi

8、CiSiCi+110010101011100111111000000110100110010101819abcdfge1.数字显示框图2.半导体发光二极管七段显示器件共阳极显示器共阴极显示器显示器分段布局图4.5.3七段显示译码器要点亮共阳极显示的某一段，如何驱动？20abcdfgabcdefg111111001100001101101e3.七段数码显示原理共阴极显示器214.集成显示译码／驱动器74