综合计时系统的设计

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1、科学技术学院毕业设计任务书（工科及部分理科专业使用）题目：利用CPLD/FPGA设计综合计时系统学科部：信息学科部专业：电子信息工程班级：07级（2）班学号：7020907059学生姓名：李爽起讫日期：2010年12月8日—2011年5月31日指导教师：丁杰职称：高工学科部主任：审核日期：1说明1.毕业设计任务书由指导教师填写，并经系或专业学科组审定，下达到学生。2.进度表由学生填写，每两周交指导教师签署审查意见，并作为毕业设计工作检查的主要依据。3.学生根据指导教师下达的任务书独立完成开题报告，1个月内提交给指导教师批阅。4.本

2、任务书在毕业设计完成后，与论文一起交指导教师，作为论文评阅和毕业设计答辩的主要档案资料，是学士学位论文成册的主要内容之一。1一、毕业设计的要求和内容（包括原始数据、技术要求、工作要求）可编程逻辑器件（CPLD/FPGA）的出现是超大规模集成电路和现代微电子技术发展的成果，结合计算机辅助工程技术成就了现代电子系统设计的核心技术EDA技术。近年来EDA技术和市场发展十分迅速，广泛应用于计算机、通信、自动控制、信息处理等诸多领域，熟练掌握EDA技术已经是对电子设计工程师的基本要求。本课题的任务是利用CPLD/FPGA实现一个综合计时系统

3、。要求同学在熟悉QuartusII开发软件的使用、了解CPLD/FPGA器件硬件结构、原理、分类及一般设计流程、了解各芯片生产厂家产品系列（Altera、Xilinx、Lattice、Actel等）的特点比较、了解一般综合计时系统的结构和要求、熟悉Protel软件的使用的基础上，用一片CPLD/FPGA和其它辅助器件构成一个综合计时系统，要求能实现时、分、秒的计数等综合计时功能，同时将计时结果通过6个七段数码管显示，并且可通过两个设置键，对计时系统的有关参数进行调整。要求给出硬件原理图和PCB板图、画出状态转移图、编写VHDL或V

4、erilogHDL代码、做出仿真波形图并在教学实验系统上模拟实现（如经费许可应制板做出成品）。1二、毕业设计图纸内容、张数及要求电路原理图一张规格：A3电路制板板图三张（包括顶层，底层，丝印层）规格：A4状态转移图、硬件描述语言代码和仿真图三、毕业设计计算书、实物内容及要求实物内容：在万能板上做出综合计时系统（如经费允许也可以制板）。要求：1.实现时、分、秒的计时功能；2.通过6个七段数码管显示；3.通过两个设置键，对计时系统的有关参数进行调整；4.扩展考虑音乐闹钟等功能；1四、毕业设计进度计划序号各阶段工作内容起讫日期备注理解课

5、题内容，做相关资料，软件准备，熟悉ProtelDXP和QuartusII的使用，查阅相关资料。初步形成方案，写出开题报告。进行硬件部分，计时部分，显示部分、设置部分设计。绘出原理图和PCB布线图。优化硬件描述语言代码。软硬件仿真。补充资料，完成毕业设计论文，准备论文答辩。五、主要参考资料1．潘松，《EDA技术实用教程》，科学出版社。2．高有堂，《EDA技术及应用实践》，清华大学出版社。3．陈赜，《可编程逻辑器件技术实践教程》，科学技术出版社。4．褚振勇，《FPGA设计及应用》，西安电子科技大学出版社。5．林明权，《VHDL数字控制

6、系统设计范例》，电子工业出版社。6.黄志伟，《FPGA系统设计与实践》，电子工业出版社。7．www.fpga.com.cn8．中国电子技术信息网，www.cetinet.com1六、毕业设计进度表（本表每两周由学生填写一次，交指导教师签署审查意见）第一、二周（11月15日至11月28日）学生主要工作：理解课题内容，做相关资料，软件准备，熟悉Quartus的使用，查阅相关资料。指导教师审查意见：年月日第三、四周（2月13日至2月27日）学生主要工作：构建数字钟的基本模型，初步确定设计方案并写出开题报告。指导教师审查意见：年月日1第五

7、、六周（2月28日至3月11日）学生主要工作：画出系统状态转移图并编写硬件描述语言代码初稿指导教师审查意见：年月日第七、八周（3月12日至3月26日）学生主要工作：对硬件描述语言代码初稿进行修正,并在开发软件上进行逻辑仿真，功能仿真,初步确定代码.指导教师审查意见：年月日1第九、十周（3月27日至4月10日）学生主要工作：完成外文资料翻译，基本完成毕业设计论文初稿指导教师审查意见：年月日第十一、十二周（4月11日至4月25日）学生主要工作：物理硬件部分设计，绘出原理图和PCB布线图指导教师审查意见：年月日第十三、十四周（4月26日

8、至5月10日）学生主要工作：2、毕业设计中期检查：检查毕业设计进程及程序和初稿完成情况指导教师审查意见：年月日1第十五、十六周（5月11日至5月25日）学生主要工作：设计优化，完成毕业设计论文。指导教师审查意见：年月日第十七、十八周（5月26日至6