jtag引脚定义与各种jtag引脚序号与引脚名对应关系

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1、JTAG的引脚定义与各种JTAG的引脚序号与引脚名的对应关系 JTAG有10pin的、14pin的和20pin的，尽管引脚数和引脚的排列顺序不同，但是其中有一些引脚是一样的，各个引脚的定义如下。一、引脚定义??TestClockInput(TCK)-----强制要求1TCK在IEEE1149.1标准里是强制要求的。TCK为TAP的操作提供了一个独立的、基本的时钟信号，TAP的所有操作都是通过这个时钟信号来驱动的。??TestModeSelectionInput(TMS)-----强制要求2TMS信号在

2、TCK的上升沿有效。TMS在IEEE1149.1标准里是强制要求的。TMS信号用来控制TAP状态机的转换。通过TMS信号，可以控制TAP在不同的状态间相互转换。??TestDataInput(TDI)-----强制要求3TDI在IEEE1149.1标准里是强制要求的。TDI是数据输入的接口。所有要输入到特定寄存器的数据都是通过TDI接口一位一位串行输入的（由TCK驱动）。??TestDataOutput(TDO)-----强制要求4TDO在IEEE1149.1标准里是强制要求的。TDO是数据输出的接口

3、。所有要从特定的寄存器中输出的数据都是通过TDO接口一位一位串行输出的（由TCK驱动）。??TestResetInput(TRST)----可选项1这个信号接口在IEEE1149.1标准里是可选的，并不是强制要求的。TRST可以用来对TAPController进行复位（初始化）。因为通过TMS也可以对TAPControll进行复位（初始化）。所以有四线JTAG与五线JTAG之分。??(VTREF)-----强制要求5     接口信号电平参考电压一般直接连接Vsupply。这个可以用来确定ARM的JT

4、AG接口使用的逻辑电平（比如3.3V还是5.0V?）??ReturnTestClock(RTCK)----可选项2可选项，由目标端反馈给仿真器的时钟信号,用来同步TCK信号的产生,不使用时直接接地。??SystemReset(nSRST)----可选项3可选项,与目标板上的系统复位信号相连,可以直接对目标系统复位。同时可以检测目标系统的复位情况，为了防止误触发应在目标端加上适当的上拉电阻。??USERIN用户自定义输入。可以接到一个IO上，用来接受上位机的控制。??USEROUT用户自定义输出。可以接

5、到一个IO上，用来向上位机的反馈一个状态由于JTAG经常使用排线连接，为了增强抗干扰能力，在每条信号线间加上地线就出现了这种20针的接口。但事实上，RTCK、USERIN、USEROUT一般都不使用，于是还有一种14针的接口。对于实际开发应用来说，由于实验室电源稳定，电磁环境较好，干扰不大。 二、20pin、14pin及10pinJTAG的引脚名称与序号对应关系最初制定的20脚的Jtag头，管脚序号与信号的对应关系如下：值得注意的是，不同的IC公司会自己定义自家产品专属的Jtag头，来下载或调试程序。

6、下面是两大FPGA供应商Altera和Xilinx各自下载线的Jtag头的管脚图：     Xilinx的CableIV下载线14脚的Jtag头管脚图：   Altera的ByteBlast-II下载线的Jtag头管脚图：     注意：上述贴图中的JTAG的信号排列仅代表厂商的做法，不代表所有的厂商都是如此规定的。嵌入式系统中常用的20pin和10pinJTAG的信号排列如下：需要说明的是，上述Jtag头的管脚名称是对IC而言的。例如TDI脚，表示该脚应该与IC上的TDI脚相连，而不是表示数据从该脚

7、进入downloadcable。