计算机组成原理》实验

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1、计算机组成原理实验指导书第25页2021-7-2实验一、运算实验算术逻辑一、实验目的1、掌握简单运算器的数据传送通路2、验证运算功能发生器（74LS181）的组合功能二、实验设备CCT-IV计算机组成原理教学实验系统一台，排线若干。三、实验原理实验中的运算器由两片74LS181构成。运算器的输出经过一个三态门74LS245和数据总线相连，运算器的两个数据输入端，分别由二个锁存器74LS273锁存，锁存器的输入端和数据总线相连，数据输入输出都通过总线完成；数据显示灯（“BUS　UNIT”）与数据总线相连，用来显示数据总线内容。实验中的数据输入由数据开关（“INPUT　DEVICE”

2、）给出，并经过三态门74LS245和数据总线相连，数据输出可以经总线输出至七段数码管（“OUTPUTDEVICE”）显示W/RUNITT4STATEUNITKK2ALUUNITARAUJ3ALU-BS3-CNLDDR1LDDR2…………BUSUNIT……………………SW-BALU-BS3-CNLDDR1LDDR2ARSWITCHUNITSWJ3SW-BINPUTDEVICE计算机组成原理实验指导书第25页2021-7-2实验一、运算实验算术逻辑一、实验目的1、掌握简单运算器的数据传送通路2、验证运算功能发生器（74LS181）的组合功能二、实验设备CCT-IV计算机组成原理教学实

3、验系统一台，排线若干。三、实验原理实验中的运算器由两片74LS181构成。运算器的输出经过一个三态门74LS245和数据总线相连，运算器的两个数据输入端，分别由二个锁存器74LS273锁存，锁存器的输入端和数据总线相连，数据输入输出都通过总线完成；数据显示灯（“BUS　UNIT”）与数据总线相连，用来显示数据总线内容。实验中的数据输入由数据开关（“INPUT　DEVICE”）给出，并经过三态门74LS245和数据总线相连，数据输出可以经总线输出至七段数码管（“OUTPUTDEVICE”）显示W/RUNITT4STATEUNITKK2ALUUNITARAUJ3ALU-BS3-CNL

4、DDR1LDDR2…………BUSUNIT……………………SW-BALU-BS3-CNLDDR1LDDR2ARSWITCHUNITSWJ3SW-BINPUTDEVICE计算机组成原理实验指导书第25页2021-7-2实验一、运算实验算术逻辑一、实验目的1、掌握简单运算器的数据传送通路2、验证运算功能发生器（74LS181）的组合功能二、实验设备CCT-IV计算机组成原理教学实验系统一台，排线若干。三、实验原理实验中的运算器由两片74LS181构成。运算器的输出经过一个三态门74LS245和数据总线相连，运算器的两个数据输入端，分别由二个锁存器74LS273锁存，锁存器的输入端和数据

5、总线相连，数据输入输出都通过总线完成；数据显示灯（“BUS　UNIT”）与数据总线相连，用来显示数据总线内容。实验中的数据输入由数据开关（“INPUT　DEVICE”）给出，并经过三态门74LS245和数据总线相连，数据输出可以经总线输出至七段数码管（“OUTPUTDEVICE”）显示W/RUNITT4STATEUNITKK2ALUUNITARAUJ3ALU-BS3-CNLDDR1LDDR2…………BUSUNIT……………………SW-BALU-BS3-CNLDDR1LDDR2ARSWITCHUNITSWJ3SW-BINPUTDEVICE计算机组成原理实验指导书第25页2021-7

6、-2实验一、运算实验算术逻辑一、实验目的1、掌握简单运算器的数据传送通路2、验证运算功能发生器（74LS181）的组合功能二、实验设备CCT-IV计算机组成原理教学实验系统一台，排线若干。三、实验原理实验中的运算器由两片74LS181构成。运算器的输出经过一个三态门74LS245和数据总线相连，运算器的两个数据输入端，分别由二个锁存器74LS273锁存，锁存器的输入端和数据总线相连，数据输入输出都通过总线完成；数据显示灯（“BUS　UNIT”）与数据总线相连，用来显示数据总线内容。实验中的数据输入由数据开关（“INPUT　DEVICE”）给出，并经过三态门74LS245和数据总线

7、相连，数据输出可以经总线输出至七段数码管（“OUTPUTDEVICE”）显示W/RUNITT4STATEUNITKK2ALUUNITARAUJ3ALU-BS3-CNLDDR1LDDR2…………BUSUNIT……………………SW-BALU-BS3-CNLDDR1LDDR2ARSWITCHUNITSWJ3SW-BINPUTDEVICE计算机组成原理实验指导书第25页2021-7-2实验一、运算实验算术逻辑一、实验目的1、掌握简单运算器的数据传送通路2、验证运算功能发生器（74LS18