基于FPGA的UART设计毕业论文

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1、本科生毕业论文(设计)题目:基于FPGA的UART设计姓名:亓毓阈系别:工程系专业:机械设计制造及其自动化班级:本科0班学号:2014701247指导教师:诸葛孔明完成时间:2013-6-152014年4月15日3毕业设计(论文)原创性声明和使用授权说明原创性声明本人郑重承诺:所呈交的毕业设计(论文),是我个人在指导教师的指导下进行的研究工作及取得的成果。尽我所知,除文中特别加以标注和致谢的地方外,不包含其他人或组织已经发表或公布过的研究成果,也不包含我为获得及其它教育机构的学位或学历而使用过的材料。对本研究提供过帮助和做出过贡献的个人或集体,均已在文中

2、作了明确的说明并表示了谢意。作者签名:     日 期:     指导教师签名:     日  期:     使用授权说明本人完全了解安阳工学院关于收集、保存、使用毕业设计(论文)的规定,即:按照学校要求提交毕业设计(论文)的印刷本和电子版本;学校有权保存毕业设计(论文)的印刷本和电子版,并提供目录检索与阅览服务;学校可以采用影印、缩印、数字化或其它复制手段保存论文;在不以赢利为目的前提下,学校可以公布论文的部分或全部内容。作者签名:     日 期:     3摘要通用串口是远程通信接口,在数字系统使用很

3、普遍,是一个很重要的部件。本论文使用VerilogHDL语言描述硬件功能,利用QuartusII5.0在FPGA芯片上的综合描述,采用模块化设计方法设计UART(通用异步收发器)的各个模块。其中包括波特发生器,程序控制器,UART数据接收器和UART数据发送器,本文采用的外部时钟为48MHZ,波特率为9600。在QuartusII5.0和Modelsim6.0环境下进行设计、编译和仿真。最后的程序编译仿真表明系统数据完全正确。关键词:VerilogHDL;UART;帧格式;FPGA;3AbstractInthispaper,theuseofhardwar

4、edescriptionlanguagesVerilogVHDLfunction,theuseofAltera'sFPGAchips,thedesignofmodulardesignmethodofUART(UniversalAsynchronousReceiverTransmitter)ofeachmodule,includingPorter,generators,processcontrollers,UARTreceiverdataandtheUARTtransmitterdata.QuartusII5.0andModelsim6.0inenviro

5、nmentdesign,compilation,simulationanddownloading.Finally,simulationresultsshowthattheproceduresforcompilingdataentirelycorrect.Keywords:VerilogHDL;UART;frameformat;FPGA3目录第一章绪论11.1引言11.2什么是VerilogHDL?11.3历史21.4主要能力21.5模块41.6数据流描述方式5第二章片上系统SOC与FPGA的现状62.1片上系统SOC介绍62.2FPGA技术介绍62.3F

6、PGA核心设计流程72.3.1设计流程图72.3.2关键步骤的实现82.3.2.1功能仿真82.3.2.2逻辑综合92.3.2.3前仿真92.3.2.4布局布线102.3.2.5后仿真(时序仿真)11第三章UART设计123.1UART的帧格式123.2UART模块133.2.1主要引脚功能介绍133.2.2UART主体程序143.3UART发送模块153.3.1UART的数据发送服务153.3.2UART的数据发送操作163.3.3UART的数据发送模块程序173.3.4UART的数据发送模块程序仿真图203.4UART接收模块213.4.1UART数

7、据接收服务213.4.2UART数据接收操作223.4.3UART的数据接收模块程序223.4.4UART的数据接收模块程序功能仿真图253.5UART控制器263.5.1UART控制器服务263.5.2UART控制器模块程序2633.5.3UART控制器模块程序仿真图283.6UART波特发生器293.6.1UART波特发生器服务293.6.2UART波特发生器模块程序293.6.13UART波特发生器程序仿真图30结论31参考文献32致谢33附录34外文资料原文35译文433电子科技大学成都学院毕业设计论文绪论1.1引言21世纪,电子技术迅猛发展,高

8、新技术日新月异。传统的设计方法正逐步退出历史舞台,取而代之的是基于EDA技术的芯

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