赛灵思 ise 12设计套件

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1、ISE12设计套件常见问题解答蚂羆芅芃薈羅羅蒈蒄羄肇芁螃羄腿蒇虿肃节艿薅肂羁蒅蒁肁肄芈蝿肀芆蒃螅聿莈莆蚁肈肈薁薇蚅膀莄蒃蚄节薀螂蚃羂莂蚈螂肄薈薄螁膇莁蒀螁荿膄衿螀聿葿螅蝿膁节蚁螈芃蒇薇螇羃芀蒃螆肅蒆螁袅膈芈蚇袅芀蒄薃袄羀芇蕿袃膂薂蒅袂芄莅螄袁羄薁蚀袀肆莃薆衿膈蕿蒂罿芁莂螀羈羀膄蚆羇膃莀蚂羆芅芃薈羅羅蒈蒄羄肇芁螃羄腿蒇虿肃节艿薅肂羁蒅蒁肁肄芈蝿肀芆蒃螅聿莈莆蚁肈肈薁薇蚅膀莄蒃蚄节薀螂蚃羂莂蚈螂肄薈薄螁膇莁蒀螁荿膄衿螀聿葿螅蝿膁节蚁螈芃蒇薇螇羃芀蒃螆肅蒆螁袅膈芈蚇袅芀蒄薃袄羀芇蕿袃膂薂蒅袂芄莅螄袁羄薁蚀袀肆莃薆衿膈蕿蒂罿芁莂螀羈羀膄

2、蚆羇膃莀蚂羆芅芃薈羅羅蒈蒄羄肇芁螃羄腿蒇虿肃节艿薅肂羁蒅蒁肁肄芈蝿肀芆蒃螅聿莈莆蚁肈肈薁薇蚅膀莄蒃蚄节薀螂蚃羂莂蚈螂肄薈薄螁膇莁蒀螁荿膄衿螀聿葿螅蝿膁节蚁螈芃蒇薇螇羃芀蒃螆肅蒆螁袅膈芈蚇袅芀蒄薃袄羀芇蕿袃膂薂蒅袂芄莅螄袁羄薁蚀袀肆莃薆衿膈蕿蒂罿芁莂螀羈羀膄蚆羇膃莀蚂羆芅芃薈羅羅蒈蒄羄肇芁螃羄腿蒇虿肃节艿薅肂羁蒅蒁肁肄芈蝿肀芆蒃螅聿莈莆蚁肈肈薁薇蚅膀莄蒃蚄节薀螂蚃羂莂蚈螂肄薈薄螁膇莁蒀螁荿膄衿赛灵思ISE12设计套件常见问题(2010年5月4日前请勿发布)赛灵思ISE12设计套件利用智能时钟门控技术将动态功耗降低30%1)赛灵思今

3、天要宣布什么消息？ISE®12设计套件不仅实现了功耗与成本的突破性优化，而且为逻辑、嵌入式、DSP和系统设计人员带来了更高的设计生产力。2)新版ISE设计套件与前版有什么区别？ISE设计套件首次提供了“智能”时钟门控技术，可将动态功耗降低多达30%。针对加密、数据路径和计算密集型设计，甚至还能进一步降低功耗。新套件还提供了基于时序的高级设计保存功能、符合AMBA4AXI4规范的即插即用设计IP支持，以及具备第四代部分重配置功能的直观设计流程，可将系统成本降低30%以上，满足有线电信应用的需求。3)ISE12设计套件推出的主要推动

4、因素有哪些？降低新一代电子产品系统成本，降低功耗，同时提升性能，这是各种应用及市场领域提出的普遍需求，正是这些需求推动ISE12设计套件应运而生。ISE12设计套件使设计人员能够通过功耗和成本方面的软件创新平衡上述需求，并最大限度地发挥Virtex®-6和Spartan®-6器件的功能，同时大大提高整体设计生产力。4)“智能”时钟门控技术的功耗优化优势有哪些？其工作原理是什么？智能时钟门控是降低数字设计动态功耗的有效优化技术，可自动检测并通过精细粒度（逻辑切片）优化功能中止不必要的转换。利用我们正在独特的算法对设计进行分析，以检

5、测转换时不改变下游逻辑和互联的顺序元件。系统会在各个逻辑切片中生成“本地时钟启用”，自动关闭不必要的活动，而避免关闭整个时钟网络。这些优化措施不会改变现有的逻辑，仅添加最少的逻辑和网络元件连接到时钟启用（平均增加约2%的LUT）。5)赛灵思的智能时钟门控技术能否支持第三方综合工具的映射?综合工具能自动转换ASIC中常用的门控时钟结构，从而映射至赛灵思器件中的时钟启用，同时还能使用全局布线资源。赛灵思的智能时钟门控技术简化了带门控时钟的ASIC代码移植到FPGA的工作，但它不会分析转换后的代码，以检测转换时不改变下游逻辑和互联的顺

6、序元件。4ISE12设计套件常见问题解答1)新版ISE对部分重配置流程做出了哪些变动？部分重配置技术现采用直观的界面，以及与标准ISE设计流程紧密结合的简化设计方法，其易用性得到进一步提升。ISE12套件还为第四代动态重配置（也称作“按需”或“即时”重配置）功能提供了设计支持，通过让多种高级应用集成于尽可能小型化的Virtex-6器件上，可大幅降低系统成本与功耗。2)赛灵思为什么选择AMBA4AXI4协议来进行IP互联标准化？它是如何支持赛灵思FPGA的即插即用设计的？AMBA4AXI4规范定义了一系列的性能增强型互联接口，这些

7、接口采用针对应用类型优化的多种不同总线。通过在统一开放式互联协议上进行标准化，使设计人员能够更轻松地在设计方案中集成赛灵思及第三方供应商提供的IP，实现最新一代系列器件上的即插即用互操作性。这种经过优化的互联基础架构不仅为赛灵思FPGA提供了符合AXI4规范的更广阔的IP生态系统，而且还为2010年秋季开始启用赛灵思目标设计平台开发支持AXI4的系统奠定了基础。3)AMBA4AXI4规范是否为了与FPGA协同使用经过了优化？是的。为高效映射于FPGA架构，赛灵思与ARM共同定义了AXI4、AXI4-Lite和AXI4-Strea

8、m规范。这进一步提升了我们最新系列器件的系统性能。4)ISE12采用了哪些新特性支持设计保存？ISE12设计套件的高级设计保存功能，使设计人员能通过可重复使用的时序结果快速实现设计时序收敛。设计人员不仅能将设计方案分区，集中精力满足关键模块所需的时序功能，而且还