中规模组合逻辑电路之一

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1、试验六中规模组合电路设计之一实验目的1.了解中规模组合电路的使用方法2.掌握用中规模集成电路设计组合电路的方法3.通过实验验证设计的正确性4.训练正确接线与排除故障的能力实验仪器与器材DLMU数字电路实验箱1台万用表及工具3线—8线集成译码器74LS138双2线4线译码器74LS139八选一数据选择器74LS151双四选一数据选择器74LS153其他必要的门电路实验内容1.测试3线—8线集成译码器74LS138的逻辑功能实验图6-1为CT74LS138的逻辑符号，用逻辑开关作为74LS138的输入信号，改变端输入A2A1A0的逻辑开关状态（000—111），

2、用0,1显示并记录输出端Y0’—Y7’的逻辑状态，并把结果记入实验表6-1输入输出S1S2’+S3’A2A1A0Y0’Y1’Y2’Y3’Y4’Y5’Y6’Y7’0100000111111111000110111111210010110111113100111110111141010011110111510101111110116101101111110171011111111110禁止0ΦΦΦΦ11111111Φ1ΦΦΦ11111111实验表6-12.译码器作脉冲分配的应用３线－８线集成译码器CT74LS138“使能”控制端S1加高电平，逻辑开关S2'S3'

3、其中一断接地，另一端接脉冲信号.依次改变A2/A1/A0的逻辑开关状态（000~111)观察Y0'---Y1'的变化，并进行具体分析.Y0'~Y1'输出的情况如表所示，加上脉冲信号，对应的所选通道发生低—高电平的变化，谁脉冲信号连续变化３.实验图６－２是由译码器和门电路构成的组合逻辑电路，改变输入端的A2/A1/A0逻辑开关状态（000~111)，观察并记录输出端F1和F2的逻辑状态.列真值表，并指出此电路能完成的逻辑状态.序列输入输出S1S2’S3’A2A1A0F1F201000000011000011021000101031000110141001001

4、05100101016100110017100111014用八选一数据选择器74LS151实现逻辑函数（W.X为输者的输入变量，YE为受血者输入变量）F=YE'+WX+XY'E+W'X'E'令W=A2,X=A1.Y=A0'则输出真值表为W/XY000111100E'E'Z'Z10E'11即令D0=D1=D5=D3=D'.D6=D7=1',D4=0,W=A2,X=A1,Y=A.即可用八选一数据选择其74S151实现逻辑函数，实验图如下图实验8七段显示译码器实验目的１.熟悉七段字译码器CT54174LS48的逻辑功能２.掌握七段字译码器CT54174LS48的一

5、般应用实验器材与仪器１.DLMU数字电路实验箱1台２.YB43201A双踪四迹示波器1台３.万用表及工具４.CT54174LS481片５.夹阴极七段数码管1块实验内容1.4线-7线显示译码驱动器CT74LS38逻辑功能的测试译码器CT54174LS48的输出a~g为高平有效，用于驱动夹阴极式的七段数码管，OC输出，内部接有2K欧的上拉电阻而无需外接.当UCC=5V时，输出端只能提供2mA左右的电流，如果数码管需要的电流大于这个数值时，则应在2K欧的上拉电阻上再并联适当电阻.使其输出a~g分别对应接七段显示器a~g输入端.CT5417448外引线功能：L’T’

6、——灯测试输入R’B’I’——动态灭灯输入B’I’/R’B’O’——灭灯输入/动态灭灯输出实验图8-1为CT74L48的逻辑符号，按实验表8-1测试CT74LS48输出端a~g的逻辑状态，并把测试结果记入表中.输入输出字形A3A2A1A0RBILTBI/RBOabcdefg00000111111110010001Φ110110000110010Φ111101101230011Φ111111001340100Φ110110011450101Φ111011011560110Φ110011111670111Φ111110000781000Φ111111111891

7、001Φ1111100119101010Φ110001101111011Φ110011001121100Φ110100011131101Φ111001011141110Φ110001111151111Φ110000000灭灯ΦΦΦΦΦ0灭零0000010试灯ΦΦΦΦΦ012.把CT74LS48的输出端a~g接到t段数码显示器（实验图8—2）上，按实验表8—1改变状态，观察显示器显示的波形.