allegro如何导入网表

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1、一.首先要保证Designrulecheck没有问题。二.从原理图中导出Netlist.原理图中Tools------CreateNetlist或者直接点击如下图快捷键。出来如下选择框，，选择网表到处的文件夹。点击确定。点击确定.正在导出网表。导出完成后会在选择的文件夹下生成一个 netlist.log的文件。注意：导出网表时有时候会提示有error，如果有error则无法生成网表，需要按提示将error解决，然后重新导出。三.从PCB中导入Netlist打开allegro.新建一个brd文件。导入网表前必须要有一个边框（边框是一个后缀名为dra的封

2、装文件，如何画边框请参照附一）。1.设置library路径：在Setup----UserPerference----Library。需要设置其中三个参数。点击箭头上的按键出来对话框，选择对应library的路径。此路径必须是原件封装的所在文件夹，我们所需的边框的封装也必须要在这些路径下。路径可同时设置多个，其他两个参数的设置操作相同。海信标准库的路径：devpath:    Z:HISENSE_Allegro_Libsymbols  和 Z:HISENSE_Allegro_LibsymbolsNO_USEpadpath:    Z:H

3、ISENSE_Allegro_Libpadstackpsmpath:   Z:HISENSE_Allegro_Libsymbols  和 Z:HISENSE_Allegro_LibsymbolsNO_USE自己画的封装可以放到本机目录下：我的边框文件outline.dra就放在F:mydisc下２.放置边框。点击Place-----Manually出来如下对话框，先选择AdvancedSettings,勾选中Library，再点击PlacementList，选择Mechanicalsymbols，在下拉菜单中选择自己画的边框文件o

4、utline，前面的勾选中，然后移动鼠标到版图上，单击左键，放置完成。３.导入Netlist。点击File----Import----Logic，出来如下对话框，Importdirctionary选择边框文件所在的目录。点击ImportCandence，开始导入，导入完成后会提示......succussfully。如果没有成功，会出现一个txt文件提示错误信息，根据错误和警告信息进行更改，如果原理图导出没有问题，而PCB导入有问题，很多时候是因为library设置不多造成的。4.放置所有元件。点击Place-----Quickplace 点击pla

5、ce。开始自动快速部件。完成后如下图：至此，网表导入结束。附一:如何制作边框文件1.File----New,输入文件名，Browse选择目录,Drawingtype选择Mechanicalsymbol.2.设置工作区大小和坐标。Setup-----DesignParameter，按如下设置，extents的数值根据实际需要调整。2.画边框。add--- Line   点击右侧option标签页，按如下设置。在命令行中输入（以宽200，高300为例）：x00ix200iy300ix-200iy-300右键，选择done。完成最简单的边框。File---

6、 saveas保存到某一目录下，生成一个dra文件一个bsm文件，这个目录就是前面导入边框时需要添加的library路径。