[试题]数电模电课程设计

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1、目录1数字电子设计部分错误！未定义书签。1.1六进制同步加法计数器1.1.1课程设计的目的1.1.2设计的总体框图1.1.3设计过程1.1.4设计的逻辑电路图1.1.5设计的电路原理图1.1.6实验仪器1.1.7实验结论（分析实验中出现的故障及产生的原因1.1.6实验仪器1.1.7实验结论（分析实验中出现的故障及产生的原因1.2串型数据检测器1.2.1课程设计的目的1-2.2设计的总体框图1.2.3设计过程1.2.4设计的逻辑电路图1.2.5设计的电路原理图1.2.6实验仪器127实验结论（分析实验中出现的故障及产生的原因）1.3参考文献2模拟电了

2、设计部分错误!2.1课程设计的戸的与作用错误!2.1.1课程设计错误!2.2设计任务、及所用multisim软件环境介绍错误!2.3电路模粮的建立错误!2.4理论分析及计算错误!2.5仿真结果分析错误!2.6设计总结和体会错误!未定义书签。未定义书签。未定义书签。未定义书签。未定义书签。未定义书签。未定义书签。未定义书签。未定义书签。2.7参考文献错误!1数字电子设计部分1.1六进制同步加法计数器1.1.1课程设计的目的1、掌握同步加法计数器工作原理及逻辑功能2、掌握电路的分析，设计及运用3、学会正常使用JK触发器1.1.2设计的总体框图CP三位二

3、进制同步加法i1输入计数脉冲计数器Y设计过程(1)状态图/////001——►010—►100——►101——►110——111f/丨(2)时序图“_rm_rm_rm_rmQiQ2(1)触发器名称选用三个CP下降沿触发的JK触发器74LS112(2)求时钟方程CP。二CPlCB二CPCP是整个要设计的时序电路的输入时钟脉冲(1)求状态方程00011110XXX010XXX100101110001111次态QFQLQ拧的卡诺图0X0Xo1-t厂J一一'01匚00011110Q；+，的卡诺图000111100X.4/1X010u0oQ严的卡诺图Qo

4、n+1=Q2nQon+Qt'Qon驱动方程：由状态卡诺图图得到坐迹方鱼Qln+1=QonQln+Q2WQ.n(1.1.1)厂文二QJ-<(2)检查能否自启动将无效态000,011代入式(1.1.1)进行计算，结果如下:000——O011「_>101(有效态)rti此可见不能自启动1.1.4设计的逻辑电路图X1X2X3noO2.5V1.1.5设计的电路原理图X1X2X3CBAY3AV-■C444333ABYABYND111222GcABYABYc444333ABYABV-111222G1.1.6实验仪器两个74LS112芯片，一个74LS00芯片，一

5、个74LS08芯片1.1.1实验结论(分析实验中出现的故障及产生的原因)经过试验可知，满足吋序图的变化，切不能自启动实验过程中没有错误，顺利完成实验1.2串型数据检测器1.2.1课程设计的目的(1)进一步了解和掌握同步时序电路的基本设计方法。(2)了解序列检测器的工作原理及设计方法。1.2.2设计的总体框图CP串行数列检测器1.2.3设计过程(1)原始状态图(2)进彳①确定等价状态现态输入输出次态So00SiSo10SoSi00S2Si10Sos200s2S210S3S300SiS311S4s400Sis410So仔细检查可以发现，S4和S3是等价

6、的。因为无论是在状态S2还是状态S3,当输入为1时输出均为1,且都转换到次态So;当输入为0时输出均为0,且都转换到次态S

7、O②合并等价状态把S3和S4合并起來，且用S3表示。下图是经化简后得到的最简状态图。1/0(1)进行状态分配，画出用二进制数编码后得状态图(2)选择触发器，求吋钟方程，输出方程和状态方程。①选用两个CP卜•降沿触发的边沿JK触发器。②时钟方程CP()=CP］二CP②求输出方程000111100000000Y的卡诺图由此知:Y=XQ1nQonQtnQon③求状态方程:011111010000100000011110Q严Q「+1的

8、次态卡诺图驱动方程为:U2A-有卡诺图得状态应程少「Q)n+,=XQonQ?+Q!nQonLQon+1^XQ?+XQonY_KfQ；1.2.4设计的逻辑电路图1.2.5设计的电路原理图2.5VY2.5VVCC74LS04D74LS08D・・・VCC・・・VCCvieiR口二:•:・・：«・-2J•卸>1CLK-1K*・1J-•址・-Ifi・U3•74LW2N1211・・X31.2.6实验仪器一个74LS112芯片，一个74LS04芯片，一个74LS08芯片，一个74LS11芯片1.2.7实验结论(分析实验中出现的故障及产生的原因)实验过程屮没有出现

9、什么问题，能实现对0011序列的检测。1.3参考文献余孟尝•数字电子技术基础简明教程•三版•北京：高等教育出版社，2006