Cortex-M3处理器简介

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1、第一章Cortex-M3处理器简介引言2006年ARM公司推出了基于ARMv7架构的Cortex系列的标准体系结构，以满足各种技术的不同性能要求，包含A、R、M三个分工明确的系列：A系列：面向复杂的尖端应用程序，用于运行开放式的复杂操作系统；R系列：适合实时系统；M系列：专门针对低成本的微控制领域。1.1Cortex-M3处理器特点1.2Cortex-M3处理器基本结构1.3STM32系列处理器1.1Cortex-M3处理器特点基于哈佛架构的3级流水线内核Thumb-2指令集嵌套矢量中断控制器（NVIC）存储器保护单元（MPU）ARMCoreSight调试跟踪体系

2、结构1.2Cortex-M3处理器基本结构处理器核Cortex-M3NVICBusMatrixFPB（FlashPatchandBreakpoint）DWTITMMPUETMTPIUSW/SWJ-DPCortex-M3核的主要特点使用Thumb-2指令集，集Thumb指令集和ARM指令集优点于一体；采用Harvard结构，同时存取指令和数据；三段流水线；可在单周期内完成32位乘法；硬件除法；有Thumb和Debug两种操作状态；有Handler和Thread两种操作模式；快速进入和退出中断服务程序；可中断连续LDM/STM、PUSH/POP指令；支持ARMv6类型

3、的BE8/LE；支持ARMv6非对齐访问。嵌套矢量中断控制器（NestedVectoredInterruptController，NVIC）特点外部中断数量可配置为从1到240个；用来表示优先权等级的位数可配置为从3到8；支持电平触发和脉冲触发中断；中断优先级可动态重置；支持优先权分组；支持尾链技术；进入和退出中断无需指令，中断进入时可自动保存处理器状态，退出时可自动恢复处理器状态；BusMatrixBusmatrix有如下外部总线接口：Icode总线：从代码空间预取指令及向量；DCode总线：从代码空间存取数据或进行调试访问；System总线：从系统空间预取指令

4、及向量、存取数据或进行调试访问；PPB总线：用于从系统空间存取数据或进行调试访问，Busmatrix负责实现以下控制：非对齐访问；位操作：控制由位段别名到位段区域的转换访问；写缓冲。FPB（FlashPatchandBreakpoint）FPB有8个比较器，用来实现从代码空间到系统空间的转换访问和硬件断点：6个可独立配置的指令比较器，用于转换从代码空间到系统空间的指令预取，或执行硬件断点；2个常量比较器用于转换从代码空间到系统空间的常量访问。数据观测与跟踪单元（DataWatchpointandTrace、DWT）DWT有4个比较器可配置为硬件断点、ETM触发器、

5、PC采样事件触发器或数据地址采样触发器；DWT有几个计数器或数据匹配事件触发器用于性能剖析；DWT可配置用于在定义的时间间隔发出PC采样信息，而且可发出中断事件信息。测量跟踪宏单元（InstrumentationTraceMacrocell，ITM）软件跟踪：软件可直接写ITM单元内部的激励寄存器，使之向外发送相关信息包；硬件跟踪：DWT产生信息包，由ITM向外发送；时间戳：ITM可产生与所发送信息包相关的时间戳包，并向外发送。存储器保护单元（MemoryProtectionUnit，MPU）MPU提供以下支持：存储保护；保护区域重叠；访问允许控制；向系统传递存储

6、器属性。通过以上支持，MPU可：实现存储管理优先规则；分离存储过程；实现存储访问规则。嵌入式跟踪宏单元（EmbeddedTraceMacrocell，ETM）TPIU单元是ITM单元、ETM单元与片外跟踪分析器之间传递跟踪数据的桥梁。TPIU单元兼容CoreSight调试体系结构。SW/SWJ-DP对于此调试接口，外部调试口有两种可能的实现方法：串行JTAG调试接口SWJ-DP：SWJ-DP是一个结合JTAG-DP和SW-DP的标准CoreSight调试口；SW-DP调试口：该调试口通过两个引脚（clock+data）实现与处理器内部AHB-AP的接口。1.3ST

7、M32系列处理器1.3.1STM32处理器的分类1.3.2STM32F10x处理器的内部结构1.3.3STM32系列MCU的优点1.3.4STM32处理器开发工具1.3.1STM32处理器的分类STM32F1系列处理器目前分为5个子系列STM32F100 -24MHzCPU withmotorcontrolSTM32F101是标准型系列，工作在36MHz；upto1MbyteFlashSTM32F102-48MHzCPUwithUSBFSSTM32F103是增强型系列，工作在72MHz，带有更多片内RAM和更丰富的外设。upto1MbyteFlashwithmot

8、orcon