简单梯形波的设计实验报告

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1、电工电子实验报告简单梯形波的设计实验任务：基于AD558可将输入的数字量转化成0~2.56v的压模电压量；用CPLD器件产生循环变化的数据量，如：0~255（8BT）的循环加法计数和减法计数，在时钟信号的控制下先上升到一定的值，在保持该数值一个设定的时间，然后在进行减法计数，在该值的基础上减到零，在示波器上则显示为个梯形的波.硬件要求:示波器、模拟功能块、DA转换芯片。实验思路：从整个实验来看，要能显示梯形的波形则可看成是三个状态的组成，而且三个状态的之间的出现时间和先后也需要控制，通过对模拟函数信号的实验我们知道了上升和下降是如何实现的了，最关键是如何让上升到一定值后进入

2、保持阶段，于是就想到了利用D触发器有记忆的功能，我们在设计一个模块把它的输出状态来控制显示模块的状态。分频模块状态控制模块CLK状态实现模块实验原理及改进和分析:征对上述的思路，设计了三个模块如下：（1）、首先是分频模块的设计，因为所需要的两个脉冲至少要有200倍的关系，所以在分频时对D触发器的个数控制上要选择好，硬件语言如下：SUBDESIGNCN(CLK:INPUT;CLKCLK,CKDSP:OUTPUT;)VARIABLEcount[7..0]:DFF;BEGINcount[].clk=clk;count[].clrn=VCC;count[].d=count[].q+

3、1;CLKCLK=count7;…………………分配时钟脉冲时要保证SS模块的扫描快于显示模块.CKDSP=count0;END;（2）、是对S的控制模块，在这个模块的设计上由于只有三个状态的改变则只需给它分配两个BT，要注意为了使波形能实现循环，则要使S的第四个状态是多的用来回到零状态，而且它的扫描要快。硬件语言描述如下：初步的设计：成熟的设计：SUBDESIGNSESUBDESIGNSE(（CKCLK,RESET:INPUT;CKCLK,RESET:INPUT;SSOUT[1..0]:OUTPUT;SSOUT[1..0]:OUTPUT;）)VARIABLEVARIABLE

4、SS[1..0]:DFF;SS[1..0]:DFF;count2[1..0]:DFF;BEGINBEGINcount2[].clk=CKCLK;SS[].CLK=CKCLK;count2[].clrn=RESET;SS[].CLRN=RESET;count2[].d=count2[].q+1;SS[].CLK=count2[1];IFSS[]==2THENSS[].d=SS[].q+1;SS[].d=B"00";ELSEIF(SS[].q==3)THENSS[].d=SS[].q+1;SS[].d=B"00ELSESSOUT[]=SS[];ENDIF;ENDIF;END;E

5、ND;初步的设计会出现的问题是,我们多定义了一个计数器,而SS本身也是定义的计数器,则在工作时内部会出现分频,而使SS状态的改变和下个模块合不上,则会出现如图的波形,只有一个梯形波.(3)、则是显示模块，根据S状态的改变来控制计数。硬件语言描述如下：SUBDESIGNBO(CKDSP,RESET,SSOUT[1..0]:INPUT;DAOUT[7..0]:OUTPUT;)初步设计:成熟设计:VARIABLEVARIABLECOUNT3[7..0]:DFF;COUNT3[7..0]:DFF;BEGINBEGINcount3[].clk=CKDSP;count3[].clk=C

6、KDSP;count3[].clrn=RESET;count3[].clrn=RESET;IF(SSOUT[]==0)THENIF(SSOUT[]==0)THENcount3[].d=count3[].q+1;ifcount3[].q<250thencount3[].d=count[].q+1;ELSIF(SSOUT[]==2)THENelsecount3[].d=count3[].q-1;count3[].d=count3[].q;endif;ELSEELSIF(SSOUT[]==2)THENcount3[].d=count3[].q;ifcount3[].q>0then

7、count3[].d=count3[].q-1;ENDIF;elseDAOUT[]=count3[];count3[].d=count3[].q;Endif;END;ELSECount3[].d=count3[].q;Endif;DAOUT[]=count3[];END;初步设计出现的问题是会导致梯形波出现后在下降段下降为零后会自动跳到计数的最大值然后再下降再上升就是所说的溢出.改进的方法是在每个SS的判断阶段增加判断条件,限制上升和下降使对称.实验结果:在示波器上的显示为：（1）、初步实验梯形波绉行：（2）、成熟