福州大学集成电路应用课程设计报告

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1、《集成电路应用》课程设计基于锁相环CD4046的数字频率合成器学院：物理与信息工程学院 专业:电子信息工程  年级：2015级    姓名：张桢     学号： 指导老师：许志猛    基于锁相环CD4046的数字频率合成器一、内容摘要：随着通讯，宇航和遥控遥测技术的不断发展，对信号频率的调控，稳定度和准确度的要求不断提高。频率合成器就是以一个或少量的高准确度和高稳定度的标准频率作为参考频率，导出多个或大量的输出频率，这些输出频率的准确度和稳定度与参考频率是一致的。本设计是基于锁相环CD4046制作的是频率合成器，锁相环是一种很有效的信号处理技术，它能严格跟

2、踪想干信号频率。利用锁相环构成的频率合成器电路结构简单，输出频率成分频谱纯度高，是一个较好的频率转换系统。锁相频率合成器是一个闭环系统，结构简单，成本低，有较高的频率准确度。二、设计目的：1.掌握锁相环的基本工作原理，锁相环外部元件的选择方法。2.掌握频率合成器的设计思路。3.结合所学的内容和知识，学会设计一个完整的电路。三、设计步骤：1.设计方案，确定电路形式，画出电路图。2.选取各部分电路所需元件并计算出元件参数。3.绘制PCB电路图。4.转印并腐蚀电路板，进行焊接和组装电路。5.调试并测量电路性能。四、主要技术指标：1.频率合成范围：2.步进频率：3.

3、频率稳定度：4.振荡器部分指定采用4053芯片5.时钟源分频>2总体方案的确定：总体方案的设计原理框图如图1所示，锁相环路对稳定度的参考振动器锁定，环内串接可编程的分频器，通过改变分频器的分配比N，从而就得到N倍参考频率的稳定输出。振荡源输出的信号频率f1，经固定分频后（M分频）得到基准频率f2，输入锁相环的相位比较器（PC）。锁相环的VCO输出信号经可编程分频器（N分频）后输入到PC的另一端，这两个信号进行相位比较，当锁相环路锁定后得到：f1/M=f2=f3/N=f4故f3=Nf2(f2为基准频率)当N变化时，或者N/M变化时，就可以得到一系列的输出频率f

4、3。低通滤波器N分频f2振荡源f1压控振荡器f3相位比较器M分频f4图1：原理框图六、具体设计步骤：1.振荡源的设计：用CD4053三2通道数字控制模拟开关构成的反相器和2M晶体组成2MHz振荡器，接成的电路如图2所示。图中R1使F1工作于线性放大区。晶体的等效电感，C1、C2构成谐振回路。C1、C2可利用器件的分布电容不另接。图2：振荡源的设计2.M分频设计：设计要求以1KHz为步进，所以可以选择比1Khz小的200Hz作为标准信号源。我们需要200HZ的标准参考频率，因此需要要进行10000分频，所以选择使用两片CD4518。CD4518内含两片计数器，

5、一个计数器可以十分频，所以两片共四个组成了10000分频。设计出的10000分频电路图如图3所示图3：10000分频设计3.N分频设计：由于我们设计的标准信号元频率是200Hz，要满足根据本次课程设计的要求的锁存频率范围，需设计一个N=0-999的分频计。通过方案的比较采用三块CD4522构成。CD4522是可预置数的二一十进制1/N减计数器。其引脚见附录。其中D1-D4是预置端，Q1—Q4是计数器输出端，其余控制端的功能如下：PE（3）=1时，D1—D4值置进计数器EN（4）=0，且CP（6）时，计数器（Q1—Q4）减计数；CF（13）=1且计数器（Q1—

6、Q4）减到0时，QC(12)=1Cr(10)=1时，计数器清零。信号输出图4：单片4522分频器信号输入信号输出单片4522分频器，拨盘开关为BCD码开关，如当数据窗口显示3时则A和1，2相连；当显示5时，则A和14相连，其余类推。4个100K电阻用来保证当拨盘开关为某脚不和A相连，也就是悬空时，为低电平。工作过程是这样的：设拨盘开关拨到N，当某时刻PE（3）=1，则N置到IC内的计数器中，下一个CP来时，计数器减计数变为N-1，……，一直到第N个CP来时，计数器为0。这时由于CF（13）=1，所以QC（12）=1，也即PE（3）=1又恢复到开始状态，开始一

7、个新的循环。很显然，每来个N个CP，QC（12）就会出现一个高电平，也就是QC（12）应是CP的N分频信号。这样一块CD4522和四位拨码开关就可以构成1－9的分频效果。采用四块CD4522，分别对应千百十个位就可以通过拨盘开关的数值是多少，得到对应数值的分频器。由于千位保持7不变，便将CD4522的14,11,5号角置高。图51——999分频器锁相环参数设计本设计中，M固定，N可变。基准频率f2定为200Hz，改变N值，使N=50~500，则可产生f3=10.00KHz—100.00KHz的频率范围。锁相环锁存范围：fmax=100.00KHzfmin=1

8、0.00KHz则fmax/fmin=10.00使用相