基于CPLD的频率计设计论文

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1、长春理工大学本科毕业设计本科生毕业设计基于CPLD的频率计设计DesignoftheFrequencyMeterbasedonCPLD学生姓名专业学号指导教师学院长春理工大学本科毕业设计毕业设计（论文）原创承诺书1．本人承诺：所呈交的毕业设计（论文）《基于CPLD的频率计设计》，是认真学习理解学校的《长春理工大学本科毕业设计（论文）工作条例》后，在教师的指导下，保质保量独立地完成了任务书中规定的内容，不弄虚作假，不抄袭别人的工作内容。矚慫润厲钐瘗睞枥庑赖。2．本人在毕业设计（论文）中引用他人的观点和研究成果，均在文中加以注释或以参考文

2、献形式列出，对本文的研究工作做出重要贡献的个人和集体均已在文中注明。聞創沟燴鐺險爱氇谴净。3．在毕业设计（论文）中对侵犯任何方面知识产权的行为，由本人承担相应的法律责任。4．本人完全了解学校关于保存、使用毕业设计（论文）的规定，即：按照学校要求提交论文和相关材料的印刷本和电子版本；同意学校保留毕业设计（论文）的复印件和电子版本，允许被查阅和借阅；学校可以采用影印、缩印或其他复制手段保存毕业设计（论文），可以公布其中的全部或部分内容。残骛楼諍锩瀨濟溆塹籟。以上承诺的法律结果将完全由本人承担！作者签名：年月日长春理工大学本科毕业设计摘要频

3、率测量是电子测量领域最基本也是最重要的测量之一。但基于传统测频原理的频率计在测频时测量精度将随被测信号频率的下降而降低，在实用中有较大的局限性。因此，本文提出了一种基于CPLD的数字频率计的设计方法。该设计电路简洁，软件潜力得到充分挖掘，低频段测量精度高，有效防止了干扰的侵入，把CPLD具有的编程灵活，适用范围宽，价格大众化等优点用于实现频率计的设计。该频率计采用先进的EDA技术及自上而下的设计，使用流行的VHDL语言编程，并在Max+plusII软件平台上进行编译仿真。经过硬件调试和软件仿真后结果证明此设计方案符合毕设要求和技术参数

4、。酽锕极額閉镇桧猪訣锥。关键词：频率计EDA技术CPLD长春理工大学本科毕业设计ABSTRACTFrequencymeasurementisthemostbasicelectronicandalsooneofthemostimportantmeasureinthemeasurementfield.Buttheaccuracyoffrequencymeterwhichisbasedonthetraditionalprinciplewillvarydependingonthemeasuredsignalfrequencyandthelow

5、er,hasgreatlimitationsinthepracticalinfrequencymeasurement.Therefore,thisarticleputsforwardadesignmethodofdigitalfrequencymeterbasedonCPLD.TheadvantagesuchastheCPLDprogrammingflexibility,wideapplicablescope,andthepopularpriceetc,areusedtoimplementthefrequencymeterdesign

6、bythesimplecircuitdesign,thefullyexcavateofsoftwarepotential,theprecisioninlowfrequencymeasurement,andtheeffectivelypreventoftheinvasionoftheinterference.ThefrequencymeterdesignwhichisfromtoptobottomadoptstheadvancedEDAtechnologyandpopularVHDLlanguageprogramming,andcomp

7、ilingonMax+plusIIsoftwareplatformsimulation.彈贸摄尔霁毙攬砖卤庑。Keywords:frequencymeter;EDA;CPLDII长春理工大学本科毕业设计目录摘要I謀荞抟箧飆鐸怼类蒋薔。ABSTRACTII厦礴恳蹒骈時盡继價骚。第1章绪论1茕桢广鳓鯡选块网羈泪。1.1背景1鹅娅尽損鹌惨歷茏鴛賴。1.2频率计设计的目的和意义1籟丛妈羥为贍偾蛏练淨。1.3论文所做的工作及研究内容2預頌圣鉉儐歲龈讶骅籴。第2章设计环境介绍3渗釤呛俨匀谔鱉调硯錦。2.1EDA技术的发展及VHDL简介3铙誅卧泻噦

8、圣骋贶頂廡。2.1.1EDA技术的发展3擁締凤袜备訊顎轮烂蔷。2.1.2VHDL简介3贓熱俣阃歲匱阊邺镓騷。2.1.3CPLD器件及其特点4坛摶乡囂忏蒌鍥铃氈淚。2.2基于EDA的CPLD/FPGA设计流程4蜡變黲癟報伥