EDA实验教案.ppt

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1、1EDA实验指导2实验要求实验之前必须预习，写出所需的程序，否则不能进入实验室做实验，所缺实验和报告必须补上，同时扣除该实验所占平时成绩。实验中主要调试程序，练习软件的应用。实验报告：内容充实，程序清单可以打印后附于实验报告中；小结内容必须填写，并以经验总结的形式回答思考题。3.GW48-CKEDA实验箱(硬件环境)EDA实验设施.MAX+PLUSII(软件环境)4电源开关和电源插口25芯下载接口模拟信号输入输出口RS232串行接口GW48-CKEDA实验箱525芯编程线与PC机的并行口相接插上

2、电源实验箱与计算机联机方法16将编程下载线与PC机的打印机口相接实验箱与计算机联机方法2DSP与EDA实验室7适配板目标芯片注意时钟频率选择电路结构模式NO.1编程下载ASIC外部时钟信号选择区接向目标器件的时钟信号CLOCK1通过短路帽，CLOCK0上可选的时钟频率有14种：1Hz---50MHz注意，PCB板面抗高频干扰的细密栅孔铺层！实验箱的主要部件8MAX+PLUSII的操作环境“Help”菜单为你提供联机帮助工具栏提供常用功能的快速启动状态提示条简要描述被选中的菜单命令和工具栏按钮“M

3、AX+PLUSII”菜单使你访问到MAX+PLUSII的所有功能工程路径和工程名称9MAX+plusII使用指南HierarchyDisplay:显示当前项目层次图。GraphicEditor:原理图编辑器。SymbolEditor:图形符号编辑器。TextEditor:文本编辑器。WaveformEditor:波形编辑器。FloorplanEditor:引脚平面编辑器。Simulator:仿真窗口。TimingAnalyzer:定时分析窗口。Programmer:器件编程（下载）窗口。Mess

4、ageProcessor:信息窗口。10MAX+plusII的原理图编辑器DSP与EDA实验室11MAX+plusII的HDL文本编辑器12MAX+plusII的波形编辑器13MAX+PLUSII设计框图设计输入编译修改设计仿真与定时分析管脚编辑硬件测试再编译编程下载14MAX+PLUSII设计流程15实验一MAX+PLUSII软件的使用一、实验目的：1、通过一个3－8译码器的设计，掌握VerilogHDL设计方法。2、掌握组合逻辑电路的静态测试方法。3、初步了解可编程器件设计的全过程。二、实验

5、步骤：MaxplusII软件的基本操作与应用16（0）建立一个新工程每个设计都是一个工程，都必须有一个工程名（符合命名规则）工程名必须与设计实体名（文本）一致（相符）工程路径不能包括汉字工程名工程路径17（1）建立源程序1）启动FileNew菜单命令2）选择TextEditorfile，点击OK；3）键入VerilogHDL代码：用Verilog编写模块实现3-8译码器模块名test1输入：a,b,c输出d0,d1,d2,d3,d4,d5,d6,d7case({c,b,a})3’b000:d[

6、7..0]=1;3’b001:d[7..0]=2;3’b010:d[7..0]=4;3’b011:d[7..0]=8;3’b100:d[7..0]=16;3’b101:d[7..0]=32;3’b110:d[7..0]=64;default:d[7..0]=128;endcase4）保存为test1.v文件18（2）电路的编译与适配1）选择芯片型号选择当前项目文件欲设计实现的实际芯片进行编译适配，点击AssignDevice菜单选择芯片。192）编译适配启动MAX+plusIICompile

7、r菜单，按Start开始编译，并显示编译结果，生成下载文件。如果编译时选择的芯片是CPLD，则生成*·pof文件；如果是FPGA芯片的话，则生成*·sof文件，以备硬件下载编程时调用。同时生成*·rpt报告文件，可详细查看编译结果。如有错误待修改后再进行编译适配，如下图所示。注意，此时在主菜单栏里的Processing菜单下有许多编译时的选项，视实际情况选择设置。20（3）电路仿真与时序分析MaxplusII教学版软件支持电路的功能仿真（或称前仿真）和时序分析（或称后仿真）。1）添加仿真激励信号

8、波形１、启动ＭaxplusIIＷavefromeditor菜单，进入波形编辑窗口，如下图所示。从SNF文件中输入设计文件的信号节点点击“LIST”21２、将鼠标移至空白处并单击右键，出现窗口。３、选择Ｅnternodesfromsnf选项并按左键确认，出现下图对话筐，单击list和=>按钮，选择欲仿真的Ｉ／Ｏ管脚。用此键选择左窗中需要的信号进入右窗最后点击“OK”SNF文件中的信号节点22４、单击ＯＫ按钮，列出仿真电路的输入、输出管脚图，如下图所示。在本电路中，３－８译码器的输出为灰色，表示未