Quartus使用.ppt

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1、原理图/VHDL文本编辑综合FPGA/CPLD适配FPGA/CPLD编程下载FPGA/CPLD器件和电路系统时序与功能门级仿真功能仿真EDA工具使用流程逻辑综合结构综合1.功能仿真2.时序仿真QuartusII:1.支持最新的FPGA器件,如cyclone、cycloneⅡ、stratix、stratixⅡ、stratixGX等系列。2.平均设计性能提高15%,器件资源减少5%。3.支持所有第三方工具,支持硬件描述语言的RTL综合,可以查看其图形化描述。4.高级特性:功率分析、系统级设计、高级综合优化、高级验证特性等。QuartusII简介启动并运行Quartu

2、sII,打开管理器窗口。项目导航窗口状态窗口消息窗口项目导航窗口快捷按钮消息窗口快捷按钮状态窗口快捷按钮2.启动QuartusII为了保证QuartusII能正常运行,必须设置license.dat文件。否则仿真和下载等功能将被禁用。查找license文件(1)在QuartusII管理器界面中选择ToolLicenseSetup…,点击“...”按钮,在出现的对话框中选择License.dat文件或直接输入带全路径名的文件名。(2)设置License.dat文件后,关闭对话框,回到QuartusII管理器界面进行设计。3.首次运行QuartusII设计输入Qu

3、artusII支持多种设计输入方法,包括原理图输入,文本输入(如AHDL,VHDL,VerilogHDL文本文件),第三方EDA工具输入文件(如EDIF,HDL,VQM文件)。QuartusII编辑器的工作对象是项目,用来管理该项目涉及的所有文件,所以在进行一个逻辑设计前必须确定设计的项目名称。以一个带有异步置0、异步置1端的D触发器为例,介绍QuartusII中采用文本方式的设计过程。1.新建文本文件在QuartusII管理器界面中选择菜单FileNew...,出现New对话框。在对话框中选择VerilogHDLFile,点击ok按钮,打开文本编辑器,输入D

4、触发器的VerilogHDL程序,保存文件exam_dff.v。需要注意的是,文件名与模块名必须一致。D触发器程序2.建立项目项目路径项目名称顶层实体名(1)在管理器窗口中选择菜单File/NewProjectWizard...,出现新建项目向导NewProjectWizard对话框,输入项目目录(D:quartus)、项目名称(exam_dff)和顶层实体(exam_dff.v)。(2)点击Next按钮,出现NewProjectWizard第二页,添加文件对话框。添加与该项目有关的所有文件到当前项目。查找文件添加文件到列表当前项目(3)点击Next按钮,接着

5、选择目标器件系列、目标器件封装形式、引脚数目和速度级别。(4)点击Finish按钮,项目exam_dff出现在项目导航窗口中。双击文件名,即可打开文件进行编辑。在设计过程中,如果要添加文件到当前项目或删除当前项目中的文件,选择菜单ProjectAdd/RemoveFilesinProject…,或直接用鼠标右键单击项目名,打开Settings对话框,选中对话框中的Add/Remove项,添加或删除文件。打开Settings对话框的另外一种方法是选择菜单AssignmentsSettings…。设计处理编辑文件后,开始进行设计项目的处理,设计处理主要使用Qua

6、rtusII编译器完成。QuartusII编译器的功能包括设计错误检查、逻辑综合、Altera适配器件、仿真/定时分析以及产生下载编程的输出文件。编译器生成的编程文件可以用QuartusII编程器或其它工业标准编程器对器件进行编程或配置。设计处理包括编译设置、引脚锁定、编译、观察及编辑适配结果、生成编程文件等几个部分。1.编译设置选择器件系列编译设置选项在管理器窗口选择菜单AssignmentCompilerSettingsWizard...,或用鼠标右键单击项目名,选择CompilerSettingsWizard,出现编译设置向导CompilerSettin

7、gsWizared,根据对话框提示,完成编译设置。最后的对话框是对前面设置的总览。也可以在Settings对话框的CompilerSettings项中直接进行编译设置。锁定引脚的方式有前锁定和后锁定两种。2.引脚锁定(2)前锁定:对设计项目编译前进行引脚锁定。打开Settings对话框,选择CompilerSettings下的Device,点击右边AssignPins按钮,出现AssignPins对话框。(1)后锁定:对设计项目编译后通过修改适配结果锁定引脚。前锁定:选中引脚号,再添加节点名。如选中引脚183,然后在Pinname中填写clk,或点击Pinnam

8、e右边的按钮“…”,打开

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