Stm32应用手册笔记.pdf

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1、Stm32应用手册笔记History：2010/1/22：新建byscutrobocon2010_sophia由上得知的是：现在所使用的48脚103系列的stm32没有DAC，FSMC，OTG，ETH，SDIO接口，TIM6，TIM7。对于系统结构这一部分，要结合Cortex-M3结构来理解。处理器包含4个总线接口：ICode存储器接口。从Code存储器空间（0x0000000–0x1FFFFFFF）的取指都在这条32位AHBLite总线上执行。DCode存储器接口。对Code存储器空间（0x0000000–0x1FFFFFFF）进行数据和调试访问都在这条32位AHBLite总线上执行。

2、系统接口。对系统空间（0x20000000–0xDFFFFFFF）进行取指、数据和调试访问都在这条32位AHBLite总线上执行。外部专用外设总线（PPB）。对外部PPB空间（oxE0040000–0xE00FFFFF）进行数据和调试访问都在这条32位APB总线（AMBAv2.0）上执行。跟踪端口接口单元（TPIU）和厂商特定的外围器件都在这条总线上。总线矩阵用来将处理器和调试接口与外部总线相连，协调内核系统总线和DMA主控总线之间的访问仲裁，仲裁利用轮换算法。在互联型产品中，总线矩阵包含5个驱动部件(CPU的DCode、系统总线、以太网DMA、DMA1总线和DMA2总线)和3个从部件(

3、闪存存储器接口(FLITF)、SRAM和AHB2APB桥)。在其它产品中总线矩阵包含4个驱动部件(CPU的DCode、系统总线、DMA1总线和DMA2总线)和4个被动部件(闪存存储器接口(FLITF)、SRAM、FSMC和AHB2APB桥)。AHB外设通过总线矩阵与系统总线相连，允许DMA访问。AHB/APB桥(APB)两个AHB/APB桥在AHB和2个APB总线间提供同步连接。APB1操作速度限于36MHz，APB2操作于全速(最高72MHz)。（在写时钟配置程序时，要注意到这一点）程序存储器、数据存储器、寄存器和输入输出端口被组织在同一个4GB的线性地址空间内。Cortex™-M3存储器

4、映像包括两个位段(bit-band)区。这两个位段区将别名存储器区中的每个字映射到位段存储器区的一个位，在别名存储区写入一个字具有对位段区的目标位执行读-改-写操作的相同效果。在STM32F10xxx里，外设寄存器和SRAM都被映射到一个位段区里，这允许执行单一的位段的写和读操作。下面的映射公式给出了别名区中的每个字是如何对应位带区的相应位的：bit_word_addr=bit_band_base+(byte_offset×32)+(bit_number×4)其中：bit_word_addr是别名存储器区中字的地址，它映射到某个目标位。bit_band_base是别名区的起始地址。byte_

5、offset是包含目标位的字节在位段里的序号bit_number是目标位所在位置(0-31)闪存读取（时钟配置里有些注意事项）闪存的指令和数据访问是通过AHB总线完成的。预取模块是用于通过ICode总线读取指令的。仲裁是作用在闪存接口，并且DCode总线上的数据访问优先。读访问可以有以下配置选项：●等待时间：可以随时更改的用于读取操作的等待状态的数量。●预取缓冲区(2个64位)：在每一次复位以后被自动打开，由于每个缓冲区的大小(64位)与闪存的带宽相同，因此只通过需一次读闪存的操作即可更新整个缓冲区的内容。由于预取缓冲区的存在，CPU可以工作在更高的主频。CPU每次取指最多为32位的字，取一

6、条指令时，下一条指令已经在缓冲区中等待。●半周期：用于功耗优化。注：1.这些选项应与闪存存储器的访问时间一起使用。等待周期体现了系统时钟(SYSCLK)频率与闪存访问时间的关系：0等待周期，当0

7、.只有在系统时钟(SYSCLK)小于24MHz并且没有打开AHB的预分频器(即HCLK必须等于SYSHCLK)时，才能执行预取缓冲器的打开和关闭操作。一般而言，在初始化过程中执行预取缓冲器的打开和关闭操作，这时微控制器的时钟由8MHz的内部RC振荡器(HSI)提供。5.使用DMA：DMA在DCode总线上访问闪存存储器，它的优先级比ICode上的取指高。DMA在每次传送完成后具有一个空余的周期。有些指令可以和