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1、中山大尊SUNYAT-SENUNIVERSITY实验报告第1页，共10页中山大尊SUNYAT-SENUNIVERSITYSUNYAT-SENUNIVERSITY院(系)信息科学与技术学院专业〜讦算机关T学号实验人审批第1页，共10页中山大尊SUNYAT-SENUNIVERSITY第1页，共10页中山大尊SUNYAT-SENUNIVERSITY2015年523日实验题目：组合逻辑电路实现一、实验目的：1掌握verilog语法，实现组合逻辑电路2进一步理解逻辑电路的实现。:、实验仪器及器件:计算机，ISE软件。三、实验要求：
2、1熟悉verilog基本语法，理解硬件描述语言和其他编程语言的区别2实现与非门(74LS00和74LS20),与异或门(74LS86)。3实现选择器(74LS151)和译码器(74LS138)四、实验原理：1实现与非门(74LS00和74LS20),与异或门(74LS86)。74LS00为四组2输入端与非门，逻辑图如下:第1页，共10页中山大尊SUNYAT-SENUNIVERSITY第1页，共10页中山大尊SUNYAT-SENUNIVERSITY第1页，共10页院（系）专业NUNYATTENUNIVERSITYSUNYA
3、T-SENUNIVERSITY信息科学与技术学院计算机类实验报告学号实验人审批实验题目：组合逻辑电路实现2015年5月23日第2页，共10页第2页，共10页□E>p[>34¥1iAS74LS151为互补输出的输入数据D0〜D7中，下：DATAINPUTSDATASELECT74LS86为四组2输入端异或门，逻辑图如下:m■工IM■/MM
4、F2实现选择器（74LS151）和译码器（74LS138）按二进制译码，从8个8选1数据选择器，选择控制端（地址端）为C〜A,选择一个需要的数据送到输出端Y,G为使能端，低电平有效。引脚
5、排列图如第2页，共10页第2页，共10页DATAI忖PUTSOUTPUTS当一个选通端（G1）为高电平，另74LS138为3线—8线译码器，其主要电特性的典型值如下:两个选通端（/（G2A）和/（G2B））为低电平时，可将地址端（A、B、C）的二进制编码在一个对应的输出端以低电平译出。利用G1、/（G2A）和/（G2B）可级联扩展成24线译码器；若外接一个反相器若将选通端中的一个作为数据输入端时，138还可作数据分配器。还可级联扩展成32线译码器引脚图如下：ri第2页，共10页中山大尊SUNYAT-SENUNIVERSI
6、TY实验报告SUNYAT-SENUNIVERSITY院（系）信息科学与技术学院专业〜讦算机关T学号实验人审批第4页，共10页中山大尊SUNYAT-SENUNIVERSITY第4页，共10页中山大尊SUNYAT-SENUNIVERSITY实验题目：组合逻辑电路实现2015年5月23日五、预习报告：74LS00为四组2输入端与非门，设两个输入分别为A1,B1,输出为C1。列出真值表如下：A1B1C1001011101110所以，可得程序代码为：assignC1=~（A1&B1）;A1,B1,C1,D1。输出为OUT1。只有当
7、同理74LS20为两组4输入端与非门，设四个输入为A1,B1,C1,D1都为高电平是，OUT1才会输出低电平。74LS86为四组2输入端异或门，设两个输入为A1,B1,输出为OUT。列出真值表如下:A1B1C100001110111074LS151为互补输出的8选1数据选择器，选择控制端（地址端）为C〜A,按二进制译码，从8个输入数据D0〜D7中，选择一个需要的数据送到输出端Y,G为使能端，低电平有效。设输入为D0〜D7,控制端S0,S1,S2G为使能端。输出Y与_Y。列出真值表如下：GS2S1S0I0I1I2I3I4I
8、5I6I7YY1XXXXXX1XIXIXIXIX1000000XXXXXXX100001X0XXXXXX100010XX0XXXXX100011XXX0XXXX100100XXXX0XXX100101XXXXX0XX100110XXXXXX0X100111XXXXXXX010第4页，共10页中山大尊SUNYAT-SENUNIVERSITY实验报告SUNYAT-SENUNIVERSITY院（系）信息科学与技术学院专业〜讦算机关T学号实验人审批第4页，共10页中山大尊SUNYAT-SENUNIVERSITY第4页，共10页中
9、山大尊SUNYAT-SENUNIVERSITY实验题目：组合逻辑电路实现2015年5月23日74LS138为3线—8线译码器。设输入为A,B,C,G1,_G2A,_G2B;输出为_Y0~_Y7。真值表如下：G1_G2A_G2BABCY0Y1Y2Y3Y4Y5Y6Y70XXXx:X:11111111X1XXx:X:111
