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1、成绩批阅教师日期桂林电子科技大学实训报告2016-2017学年第二学期学院海洋信息工程学院课程EDA技术综合设计实训姓名学号指导老师**日期2017年6月9日实训题目：数字日历电路的设计1.1概述1.1设计要求1.1.1设计任务设计并制作一台数字日历。1.1.2性能指标要求①用EDA实训仪的I/O设备和PLD芯片实现数字日历的设计。②数字日历能够显示年、月、日、时、分和秒。③用EDA实训仪上的8只八段数码管分两屏分别显示年、月、日和时、分、秒，即在一定时间段内显示年、月、日（如），然后在另一时间段内显示时、分、秒（如），两个时间段能自动倒换
2、。④数字日历具有复位和校准年、月、日、时、分、秒的按钮，但校年和校时同用一个按钮，即在显示年、月、日时用此按钮校年，在显示时、分、秒时则用此按钮校时，依此类推。1.2总体设计基本原理及框图1.2.1基本原理日历主要由五个模块组成，包括年月日模块(nyr217)、时分秒计时器模块(jsq)、时分秒与年月日8秒切换控制模块(contr)、年月日与时分秒显示模块(xianshi)、校时选择模块（mux_4）。校时选择模块（mux_4）采用3个公用按钮j1、j2、和j3完成时分秒或年月日的校时，年月日与时分秒显示模块(xianshi)用8只七段数码
3、管分时完成时分秒或年月日的显示。设计电路的时分秒计时器模块(jsq)用于完成一天的24小时计时；年月日模块(nyr217)接收计时器模块送来的“天”脉冲进行计数，得到日月年的显示结果，控制模块(contr)产生控制信号k，控制数码显示器显示年月日，还是时分秒，或者自动轮流显示；校时选择模块（mux_4）在k信号的控制下，选择将j1、j2和j3这3个校时按钮产生的信号是送到计时器模块的校秒、校分和校时输入端，还是送到年月日模块的校天、校月、校年输入端；年月日与时分秒显示模块(mux_16)在k信号的控制下，选择是将计时器模块的时、分、秒状态信
4、号，还是将年月日模块的年、月、日状态信号送到数码管显示器显示。1.2.2总体框图2系统软件设计分析2.1时分秒计时器模块(jsq)时分秒计时器模块(jsq)程序如下：modulejsq(clk,clrn,js,jf,jm,qs,qf,qm,cout);inputclk,clrn,js,jf,jm;outputreg[7:0]qs,qf,qm;outputregcout;regclkf,clks;always@(posedgeclk^jmornegedgeclrn)beginif(~clrn)qm=0;elsebeginif(qm=='h60
5、)qm=0;elseqm=qm+1;if(qm[3:0]=='ha)beginqm[3:0]=0;qm[7:4]=qm[7:4]+1;endif(qm=='h60)beginqm=0;clkf=1;endelseclkf=0;endendalways@(posedgeclkf^jfornegedgeclrn)beginif(~clrn)qf=0;elsebeginif(qf=='h59)qf=0;elseqf=qf+1;if(qf[3:0]=='ha)beginqf[3:0]=0;qf[7:4]=qf[7:4]+1;endif(qf=='h
6、59)beginqf=0;clks=1;endelseclks=0;endendalways@(posedgeclks^jsornegedgeclrn)beginif(~clrn)qs=0;elsebeginif(qs=='h23)qs=0;elseqs=qs+1;if(qs[3:0]=='ha)beginqs[3:0]=0;qs[7:4]=qs[7:4]+1;endif(qs=='h23)beginqs=0;cout=1;endelsecout=0;endendendmodule该模块完成基于VerilogHDL的六十进制计数和二十四进制
7、计数合成的设计，将它生成一个元件符号，作为万年历设计的基本元件。2.2年月日模块(nyr217)年月日模块(nyr217)程序如下modulenyr2017(clrn,clk,jn,jy,jr,qn,qy,qr);inputclrn,clk,jn,jy,jr;output[15:0]qn;output[7:0]qy,qr;reg[15:0]qn;reg[7:0]qy,qr;regclkn,clky;reg[7:0]date;regclkn1,clkn2,clkn3;//*******脉冲初始化******//initialbeginclkn
8、1=1;clkn2=1;clkn3=1;end//***初始化年月日***//initialbeginqn='h2015;qy=1;qr=1;end//年月日赋初值2010年1月
