stm32固件库(v3.4.0)中的例程说明

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1、ST固件库(V3.4.0)中的例程说明1.例程目录序号类别名称说明1ADC3ADCs_DMA2ADCADC1_DMA3ADCAnalogWatchdog4ADCExtLinesTrigger5ADCRegSimul_DualMode6ADCTIMTrigger_AutoInjection7BKPBackup_Data8BKPTamper9CANDualCAN（仅适用于互联型MCU10CANLoopBack11CANNetworking12CECCEC仅适用于超值型MCU13CortexM3BitBand14CortexM3Mode

2、_Privilege15CRCCRC16DACDualModeDMA_SineWave17DACOneChannelDMA_Escalator18DACOneChannel_NoiseWave19DACTwoChannels_TriangleWave20DMAADC_TIM121DMAFLASH_RAM22DMAFSMC23DMAI2C_RAM24DMASPI_RAM25EXTIEXTI26FLASHDual_Boot仅适用于超大容量型MCU27FLASHProgram28FLASHWrite_Protection29FSMCNA

3、ND30FSMCNOR31FSMCNOR_CodeExecute32FSMCOneNAND安富莱开发板不支持33FSMCSRAM34FSMCSRAM_DataMemory35GPIOIOToggle36GPIOJTAG_Remap37I2CEEPROM38I2C_TSENSORLM75芯片，安富莱开发板不支持39IOExpanderSTMPE811扩展IO芯片，不支持40I2SInterrupt41SPI_I2S_Switch42IWDGIWDG43Lib_DEBUGLib_DEBUG44NVICDMA_WFIMode45IRQ_

4、Channels46Priority47VectorTable_Relocation48PWRPVD49STANDBY50STOP51RCCRCC52RTCCalendar53LSI_Calib54SDIOSDIO55SPICRC56DMA57FullDuplex_SoftNSS58Simplex_Interrupt59SPI_FLASH60SysTickSysTick61TIM6Steps627PWM_Output63Cascade_Synchro64ComplementarySignals65DMA66ExtTrigger_S

5、ynchro67InputCapture68OCActive69OCInactive70OCToggle71OnePulse72Parallel_Synchro73PWM_Input74PWM_Outpu75TIM10_PWMOutput76TIM15_ComplementarySignals77TIM1_Synchro78TIM9_OCToggle79TimeBase80USARTDMA_Interrupt81DMA_Polling82HalfDuplex83HyperTerminal_HwFlowControl84HyperT

6、erminal_Interrupt85Interrupt86IrDA87MultiProcessor88Polling89Printf90Smartcard91Synchronous92WWDGWWDG1.ADC1.1.3ADCs_DMA这个例子描述如何使用3个ADC工作于独立转换模式。其中2个ADC(ADC1和ADC3)通过DMA连续传输转换数据，当ADC2（使用ADC转换中断）转换结束时触发DMA传输。ADC1配置为连续转换ADC通道14。每次转换结束时触发DMA1传输，DMA1工作于循环模式。转换数据由ADC1数据寄存器（D

7、R)传输到ADC1_ConvertedValue变量。ADC2配置为连续转换ADC通道13。每次转换结束时产生一个ADC转换结束中断，在中断服务程序中将ADC2数据寄存器中的转换结果存储到ADC2_ConvertedValue变量。ADC3配置为连续转换ADC通道12。每次转换结束触发DMA2传输，DMA2工作在循环模式。转换数据由ADC3数据结存器(DR)传输到ADC3_ConvertedValue变量。所有的ADC时钟设置为14MHz。ADC1、ADC2、ADC3转换结果可以通过3个变量（ADC1ConvertedValue、

8、ADC2ConvertedValue、ADC3ConvertedValue）进行监视。1.1.ADC1_DMA1.2.AnalogWatchdog1.3.ExtLinesTrigger1.4.RegSimul_DualMode1.5.TIMTrig