电子线路实验论文_数字钟

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1、电子线路实验论文实验课题：简易数字钟姓名：夏继学号：679年级：2013级系别：电子信息类完成日期：2015年4月16日实验题目：简易数字钟摘要数字钟是一种用数字电路设计实现时、分、秒计时的装备，与机械化时钟相比更具有高的准确性和直观性，且无机械装备，具有更长的使用寿命，因此得到了广泛的使用。本文介绍、记录了基于Multisim软件设计所需功能数字钟电路的方案及过程。从设计思路到芯片选择，通过软件仿真，一步步调试、完善。本数字钟具有基础功能，调试运行成功。时钟显示：采用四个数码管，有时分显示和分秒显示两种状态，且十位上

2、零不显示。一、主要功能列举：调整时间：采用逐位调整向上加数的方式。星期显示：通过七盏灯代表一周七天，并可调整。整点报时：在整点前五秒钟蜂鸣器开始启动，到零点时响最后一声高频信号。且在23:00~5:00之间不进行报时（包括23:00和5:00）。闹钟：可以设定闹钟时间并进行确认和取消，在设定时间到时开始响铃，可通过按钮中断响铃。二、方案设计：1.整体设计：利用六个74160芯片进行正常的时间计时并通过con端控制数据选择器74157进行四个数码管的切换显示。通过选位开关adj（由一片74160和三-八译码器组成）和向上

3、加数端pl（直接控制计时的74160时钟端）分别对每一位进行时间调整。用小时的进位端对星期显示的计数器进行控制达到星期显示功能，并同样由选位开关和加数端进行调整。在整点之前5秒启动蜂鸣器并在最后一声单独用一个高频蜂鸣器作为整点信号。利用数值比较器74ls85通过adj显示闹钟时间，并由闹钟选位端alr进行闹钟调整位的选择，并用pl端加数设定闹钟，用alr调整了闹钟每一位之后，闹钟被确认开启，如用alr再过一遍闹钟各个位则闹钟取消。在设定时间到达时，通过数值比较器74ls85输出，闹钟会开始响铃一分钟，此时可以通过pl端

4、将闹钟关闭。2.总体框图：3.部分框图时间显示与调整：星期调整：整点报时：闹钟设定：三、电路说明（1）时间显示与调整部分：小时：分钟：秒钟：选位及时间调整。显示切换：数码管显示及消除无效零：如图所示。秒钟分钟的计时分别由两片74160组成同步60进制计数器，电路采用异步置零。小时的计时由两片74160组成同步24进制计数器，同样采用异步置零。秒的clk信号由信号发生器输入1Hz的TTL信号。分的个位Clk连接秒的Co进位输出和pl的“或”，分的十位接个位的进位输出和pl的“或”；小时的clk接分钟的Co进位输出和pl端

5、的“或”。adj端控制一个74160构成的6进制计数器。之后由三-八译码器译出状态。状态为‘1’‘2’‘3’时分别选中分钟个位、十位，小时个位（通过和pl信号“与”）。在选中一个位后，按pl按钮可以向上增加该位数字调整时间。在con端为低电平时，数据选择器输出小时和分钟信号，在con为高电平时变为显示分钟秒钟。数据选择器的输出进入译码器电路，利用7448N译出时间信号并输出到共阴七段数码管中，并在十位信号为零时译出关闭信号将数码管灭掉。（2）星期显示与调整：星期的显示通过七盏灯实现。由一片74160构成7进制计数器，其

6、clk接pl端和小时的进位输出Co的“或”。并同样通过adj=4时和pl信号“与”来进行调整。（3）整点报时：小时位数值比较：分钟秒钟信号采集：报时控制电路：小时时间输出到数值比较器中，若小时小于5或大于22（在23:00-5:00不报时）则输出一个低电平到报时控制端的三输入端与门。该与门的另外两端为分钟到59时的高电平信号和秒钟到54的高电平信号。与门输入到报时控制电路的con端控制一个四进制计数器的开关，瞬间信号启动计数后该四进制计数过程中每个非零状态下的输出都给该计数器电源端进行供电直到一个4秒循环结束。同时这段

7、时间内通过一个T触发器将clk信号1/2分频接一个电流控制开关。在计数开始后使得1200Hz蜂鸣器启动。在最后一声输出短暂的‘4’状态异步置零的同时，将该信号输出到4000Hz蜂鸣器，使其发出一声高频整点信号。计数器回到0状态，停止计数。（4）闹钟设定：闹钟时间设定选位：闹钟确认与取消：闹钟小时设定：闹钟分钟设定：闹钟显示及时间比较：在adj=5时，通过第二层数据选择器，数码管将显示闹钟的时间，此时通过alr控制闹钟选位的74160构成的4进制计数器，并在其后用二-四译码器输出信号，分别在alr=1、2、3时，对闹钟分

8、钟个位、十位，小时个位进行选中，并通过将pl信号和相对应的alr信号“与”来控制闹钟分钟、小时计数器的clk端向上加数。在alr再一次回到0时进位信号连接到T触发器的clk端，使其由0转为1，闹钟开启，再一个循环使alr=0则再使T触发器翻转，闹钟取消。闹钟启动之后，输入蜂鸣器的高电平信号和pl相“与”连接到T触发器clk和alr