《DSP片上外围电路》PPT课件

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1、第五章DSP片上外围电路数字信号处理系统设计与实践上海交通大学电子工程系通用输入输出定时器时钟产生逻辑多通道缓冲串行口McBSPDMAHPI外部总线小结主要内容通用输入输出监测外部接口器件的状态可作为中断信号的一种替代不会导致程序被打断跳转控制输入脚BIOXC指令是在流水线的译码阶段检测BIO状态其它的条件指令(如BC、CC和RC等)是在流水线的读阶段检测BIO状态举例：XC2，BIOBIO为低，执行后面一条双字或2条单字指令通用输入输出(续)XF的状态由状态寄存器ST1中的XF位置控制复位时XF管脚输出高电平外部标志输出脚XFS

2、SBX和RSBX指令取指与XF生效的时间关系定时器CPU时钟信号输入定时器0地址定时器1地址寄存器说明0x00240x0030TIM定时器寄存器0x00250x0031PRD定时器周期寄存器0x00260x0032TCR定时器控制寄存器定时器软件可编程16位分频及4位预分频由TIM、PRD、TCR三个寄存器控制5402两个、5416一个定时器（续）定时器周期寄存器PRD对TIM重新加载计数值定时控制寄存器TCR设置定时器控制及状态位保留SoftFreePSCTRBTSSTDDR15-1211109-6543-0定时器寄存器TIM由

3、PRD加载计数值并递减计数定时器(续)定时器的结构框图定时器(续)定时中断速率计算公式tc(C)是CPU时钟CLKOUT的周期定时器初始化将TCR中的TSS置1，停止定时器工作设定PRD的数值设定TDDR的数值，并且启动定时器：将TSS清0和将TRB置1时钟产生逻辑结构内部振荡电路锁相环(PLL)电路参考时钟源两种时钟源选用外接晶振直接使用外部时钟外接晶振与DSP的X1和X2/CLKIN引脚连接通过CLKMD引脚选择使用内部振荡电路从X2/CLKIN直接接入PLL的状态设置硬件设置方法(复位后时钟工作模式)(‘C5402)CLKM

4、D1CLKMD2CLKMD3CLKMD复位值类型20000xE007PLL×150010x9007PLL×100100x4007PLL×51000x1007PLL×21100xF007PLL×11110x00002分频（禁止PLL）1010xF0004分频（禁止PLL）011-停止模式PLL的状态设置(续)软件设置方法PLL模式：输入时钟经过了倍频处理，获得原来的0.25至15倍间的一个频率。分频模式：输入时钟2分频或4分频，此时包括PLL在内的模拟电路全部关闭以降低功耗。CLKMD字段PLLMULPLLDIVPLLCOUNTPL

5、LON/OFFPLLNDIVPLLSTATUS15-121110-3210PLL系数PLLNDIVPLLDIVPLLMUL倍数0×0～140.50×150.25100～14PLLMUL＋110151110或偶数（PLLMUL＋1）211奇数PLLMUL4PLLCOUNT针对PLL模式下，在频率锁定的过程中PLL不能给DSP提供稳定时钟。使用PLLCOUNT将PLL延迟一段时间后再输出时钟。PLLCOUNT计算公式：PLLCOUNT最大锁定时间为255×16个输入时钟周期由DIV(分频)模式切换到PLL模式时，启动PLLCOUN

6、T。在锁定过程中，时钟发生器仍然工作在DIV模式。从PLL模式切换到DIV模式时，不需要PLLCOUNT延时。多通道缓冲串行口McBSP主要特点全双工通信能力（最大速率1/2CPUclock）双缓冲发送和三缓冲接收数据寄存器，以实现连续的数据流收发接收和发送具有独立的帧同步信号和移位时钟支持与工业标准编解码器、串口A/D和D/A转换器以及SPI设备的无缝连接多通道缓冲串行口McBSP（续）主要特点（续）支持多达128个通道的接收和发送支持宽度为8、12、16、24和32位比特数据的收发具有m律与A律数据压扩功能8比特数据传输可选择

7、低位在前或高位在前帧同步信号和数据移位时钟的极性、速率可编程。移位时钟可由外部提供，也可由内部编程产生对CPU产生收发中断或对DMA控制器发送事件EF01E23AD6C5输入/输出缓冲串口设备DataClockFrameSyncMcBSPDMA内部/外部存储器多通道缓冲串行口McBSP（续）通常和DMA一起工作多通道缓冲串行口McBSP（续）DMA和McBSP音频系统（例）多通道缓冲串行口McBSP（续）Ping-PongBuffer(1/4)多通道缓冲串行口McBSP（续）Ping-PongBuffer(2/4)多通道缓冲串行口

8、McBSP（续）Ping-PongBuffer(3/4)多通道缓冲串行口McBSP（续）Ping-PongBuffer(4/4)McBSP结构5402二个McBSP5416三个McBSP5416McBSP可设成通用I/O口DR－接收串行数据DX－发