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时间:2018-10-28
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1、实验一基本门电路设计——电路仿真一、实验内容:完成CMOS反相器的电路设计完成CMOS反相器的电路没计实验H的掌握基本门电路的设计方法掌握基本门电路的设计方法熟悉Cadence的设计数据管理结构,以及定制设计的原理罔输入、电路仿真、版图设计、版图验证工具的使用二、实验目的:基于csmC05工艺,完成一个具奋逻辑反相功能的电路设计要求:设汁要求:1.反相器的逻辑阈值在Vdd/2附近,即噪声容限敁大2.反相器的版阁高度限制为24微米,屯源和地线宽度各为2微米3.反和器宽度限制为mos器件不折栅4.为了给顶层没计留出更多的布线资源,版图屮只
2、能使川金属1和多晶硅作为互连线,输入,输出和电源、地线等pin脚必须使用金属15.版图满足设计规则要求,并通过LVS检查三、设计过程:启动icfb1.建立A己的设计库2.用VirtuosoSchematicComposeritHi电路
3、$
4、3.在AnalogDesignEnvironment屮进行电路仿真4.用Virtuoso(XL)LayoutEditeriUlj版阁5.利用diva工具进行DRC检查,川dracula进行DRC和LVS验证。四、实验步骤1.Cadence软件操作少骤:(1).点击桌面虚拟机快捷万式图标IVHware
5、Workstations(2).打开虚拟机(存放路径:F:cadence);叉繹(DIV分镛a)WDQP■►oC'a©ctia□回■VMworeWorkstotionmm;越挪AIVIBd)LJ0MB打开职文押9B(P••••*(3).启动虚拟机IwtIjKrr>rirrAM■钃91M職■>>HI1»aoBO«»»■m>ooaoroo-10騙9>Maa»O«O
6、助[001I•>lr>7、8、MAleEditV^ewDesignManagerHelpShowCaWgorfesShowFitesNewLibraryLibraryCelUS8thsarialogL9、ibbasicbicmos?vlcdsD-fTechLibesd7wLfunctionallessonllesson23nicl8ro3t02zxyMessagesWarning:Th©directory*/ho»ie/chonLei/gejieyi*doesr.otexJbutvasdefinedinlihrile'/hone/chenlei/cdsLib*r5rILibraryMaineDirectoryles8onlTVLSiGeCSMC05XMPDKDesktopSIML&BcwtcOSfileihnl/hoac/chenLc10、i:DesignManagerJUWHOMFJM«OMOKApplyLib'gejiAyi.~CancelHelp-J-第二步:File-New弹出“NewLibrary”对话框,在“Name”项填写要建的designlib的名字,这里是“lessonl”,选择“Attachtoanexistingtechfile”第三步:弹出”AttachDesignLibrarytoTechnologyFile”对iS框,在“TechnologyLibrary”中选择st02VjjTechnologyFileforNewLibraryHelpOK11、CancelTechnologyFileforlibrary"lessonl"Ifyouwillbecreatingmasklayoutorotherphysicaldatainthislibrary,youwillneedatechnologyfile.IfyouplantouseonlyschematicorHDLdata,atechnologyfileisnotrequired.Youcan:、zCompileanewtechfile♦Attachtoanexistingtechfilex/Don'tneedatechfile312、.新建一个电路图(1)Filc->Ncw->Ccllvicw(2)弹出“CreateNewFile”对话框,“LibraryName”项选择“lessonl”“CellName”项瑣入”inv”,“Tool”项选择”Co
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9、ibbasicbicmos?vlcdsD-fTechLibesd7wLfunctionallessonllesson23nicl8ro3t02zxyMessagesWarning:Th©directory*/ho»ie/chonLei/gejieyi*doesr.otexJbutvasdefinedinlihrile'/hone/chenlei/cdsLib*r5rILibraryMaineDirectoryles8onlTVLSiGeCSMC05XMPDKDesktopSIML&BcwtcOSfileihnl/hoac/chenLc
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12、.新建一个电路图(1)Filc->Ncw->Ccllvicw(2)弹出“CreateNewFile”对话框,“LibraryName”项选择“lessonl”“CellName”项瑣入”inv”,“Tool”项选择”Co
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