k波段频率合成器的设计与实现

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1、声明本学位论文是我在导师的指导下取得的研究成果，尽我所知，在本学位论文中，除了加以标注和致谢的部分外，不包含其他人已经发表或公布过的研究成果，也不包含我为获得任何教育机构的学位或学历而使用过的材料。与我一同工作的同事对本学位论文做出的贡献均已在论文中作了明确的说明。研究生签名：霍重盔咖“年2月／／日学位论文使用授权声明南京理工大学有权保存本学位论文的电子和纸质文档，可以借阅或上网公布本学位论文的部分或全部内容，可以向有关部门或机构送交并授权其保存、借阅或上网公布本学位论文的部分或全部内容。对于保密论文，按保密的有关规定和程序处理。研究生签名：互[篁。磊乃心

2、年芗月／／日硕士论文K波段频率合成器的设计与实现摘要本文首先论述了课题的研究背景以及DDS和PLL的基本工作原理，并分析了DDS的杂散特性及PLL环路的噪声来源；对频率合成器的三种实现方案进行了综合比较：针对PLL内插DDS方案中滤波器难以实现的问题，提出了一种改进的设计方案。其次，采用DDS直接激励PLL的实现方案，设计了一款K波段频率合成器。阐述了DDS和PLL的软硬件设计过程，并利用ADISimPLL软件对PLL电路的各项性能及环路滤波器进行了仿真；给出了DDS电路、PLL电路以及整体电路的测试结果。比较了PLL电路的实测及仿真结果，分析了造成差异的

3、可能原因。研究了PLL参考源相位噪声和芯片基底噪声对带内噪声的影响。研究了频率合成器PCB设计的电磁兼容性问题及调试方法。再次，本文采用基片集成波导技术(SIW)设计了一款K波段的带通滤波器。利用HFSS三维电磁仿真软件完成了电路的建模和仿真，并进行了加工及测试。对比其测试及仿真结果，分析了造成差异的原因。最后，指出了设计中的不足之处，并提出了解决办法。关键词j24GHz，频率合成器，DDS+PLL，SIW，滤波器，HFSSAbstract硕士论文AbstractFirstly，thepaperelaboratestheresearchbackground

4、andthebasicworkingprincipleofDDSandPLL．ThenanalysistheDDSspuriouscharacteristicsandthesourcesofPLLloopnoise．Comparethethreeimplementationsoffrequencysynthesizer．Proposeda11improveddesignforsolvingthatwhenusingtheprogramthatPLLinterpolateDDS，thefilterisdifficulttoachieve．Secondly，t

5、hispaperhasdesignedaK-bandfrequencysynthesizerbyusingtheprogramthattheDDSdirectlyincentivesPLLandpresentedthedesignprocessofDDSandPLLonthehardwareandsoftwareiselaborated．WiththehelpofthesoftwareofADISimPLL，theworkthatdesigningtheloopfilterandsimulatingthePLLperformancehasalsobeenf

6、inished．Allofthetestingresultsareshowedup．Analysisthepossiblereasonsthatresultthedifferencesbetweentestandsimulation．Studytheinfluentsonthein．bandphasenoiseofreferencesourceandphasedetectorchip．Studythefrequencysynthesizer’SelectromagneticcompatibilityproblemsonthePCBdesignandthed

7、ebuggingmethods．Thirdly，itisalsodesignedwithaK—bandpassfilterinthispaperbyusingtheSIWtechnology．WiththehelpoftheHFSSsoftware，thispaperhasmodeledandsimulatedthefilter．Ithasalsofinishedtheworkofmachingandtesting．Analysisthecausesthatresultinthedifferencesbetweensimulationandtest．Fin

8、ally，pointouttheinadequaciesofthe