顺序语句教学ppt课件

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1、3.4VHDL顺序语句（Sequential）硬件执行：并发执行（VHDL本质）仿真执行：顺序执行、并发执行分为两大类：顺序（Sequential）描述语句并发（Concurrent）描述语句ENTITYARCHITECTUREProcessProcessSequentialProcessSequentialProcesscomponentVHDL主要描述语句并行处理语句在结构体（ARCHITECTURE）中执行的语句在进程（PROCESS）函数（FUNCTION）过程（PROCEDURE）中执行的语句硬件描述的特点高级语言的特点(SequentialStatements)顺序处理语句(

2、ConcurrentStatements)顺序描述语句：执行(指仿真执行)顺序与书写顺序基本一致，与传统软件执行语言的特点相似。顺序语句只能用在进程与子程序中。可描述组合逻辑、时序逻辑。常用的顺序描述语句：赋值语句；if语句；case语句；loop语句；next语句；exit语句；子程序；return语句；wait语句；null语句。3.4.1对象与赋值语句1.VHDL中常用的5种对象：1)简单名称，如my_var;2)索引名称，如my_array_var(3);3)片断名称，如my_array_var(3to6);4)记录域名，如my_record.a_field;5)集合，如（my_

3、var1,my_var2）.所有对象均分为：变量和信号对象：=表达式；----变量赋值对象＜=表达式；----信号赋值要求：表达式的值必须与对象的类型、宽度一致。2.变量赋值与信号赋值变量与信号的差异：1）赋值方式的不同：变量：=表达式；信号＜=表达式；2）硬件实现的功能不同：信号代表电路单元、功能模块间的互联，代表实际的硬件连线；变量代表电路单元内部的操作，代表暂存的临时数据。3）有效范围的不用：信号：程序包、实体、结构体；全局量。变量：进程、子程序；局部量。ARCHITETURE{SIGNALDeclarations}Label1:PROCESS{VARIABLEDeclaratio

4、ns}Label2:PROCESS{VARIABLEDeclarations}..4)赋值行为的不同：信号赋值延迟更新数值、时序电路；变量赋值立即更新数值、组合电路。5）信号的多次赋值：a.一个进程:最后一次赋值有效b.多个进程:多源驱动线与、线或、三态例：信号的多次赋值Architecturertlofexissignala:std_logic;Beginprocess(…)begina<=b;…a<=c;endprocess;Endrtl;Architecturertlofexissignala:std_logic;Beginprocess(…)begina<=b;…endproce

5、ss;process(…)begina<=c;…endprocess;Endrtl;例：信号赋值与变量赋值的比较信号赋值：Architecturert1ofsigissignala,b:std_logic;Beginprocess(a,b)begina<=b;b<=a;endprocess;Endrt1;----结果是a和b的值互换变量赋值：Architecturert1ofvarisBeginprocessvariablea,b:std_logic；begina:=b;b:=a;endprocess;Endrt1;----结果是a和b的值都等于b的初值3.4.2转向控制语句转向控制语句

6、通过条件控制开关决定是否执行一条或几条语句，或重得执行一条或几条语句，或跳过一条或几条语句。分为5种：if语句、case语句、loop语句、next语句、exit语句1.if语句if语句执行一序列的语句，其次序依赖于一个或多个条件的值。1）if语句的门闩控制例：if(ena=“1”)thenq<=d;endif;综合后生成锁存器（latch）If条件then顺序处理语句；endif;DENAQdenaqLATCH2).if语句的二选择控制格式：IF条件句THEN顺序语句ELSE顺序语句；ENDIF；用条件来选择两条不同程序执行的路径。此描述的典型电路是二选一电路：Architecture

7、rt1ofmux2isbeginprocess(a,b,sel)beginif(sel=“1”)theny<=a;elsey<=b;endif;endprocess;endrt1;ABS21muxMULTIPLEXERYabsely3)If语句的多选择控制if语句的多选择控制又称为if语句的嵌套。格式：IF条件句THEN顺序语句ELSIF条件句THEN顺序语句}；..ELSIF条件句THEN顺序语句；ELSE顺序语句；ENDIF;典