第五章 触发器.ppt

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1、组合逻辑电路—对二值信号进行算术运算和逻辑运算。时序逻辑电路—保存二值信号和运算结果。能够存储1位二值信号的基本单元电路统称为触发器。第五章触发器触发器是具有记忆功能的基本逻辑单元。5.1概述5.2SR锁存器5.3电平触发的触发器5.4脉冲触发的触发器5.5边沿触发的触发器第五章触发器5.6触发器的逻辑功能及其描述方法不同逻辑功能触发器之间实现逻辑功能转换的简单方法。学习要点：触发器的各种电路结构及动作特点触发器按逻辑功能分类触发器的电路结构与逻辑功能的区别及关系触发器是构成时序逻辑电路的基本逻辑部件。它有两个

2、稳定的状态：0状态和1状态，用来表示逻辑状态的0和1，或二进制数的0和1；在触发信号作用下，根据不同的输入信号，它可以被置成0状态或1状态；当输入信号消失后，所置成的状态能够保持不变。所以，触发器可以记忆1位二值信号。5.1概述触发器可以分为SR触发器、D触发器、JK触发器、T触发器等；触发器的分类：在不同的触发方式下，当触发信号到达时，触发器的状态转换过程的动作特点也不同。电路结构形式不同，触发信号的触发方式不同。触发方式可分为电平触发、脉冲触发和边沿触发。由于控制方式的不同(即信号的输入方式及触发器状态随输

3、入信号变化的规律不同)，触发器的逻辑功能有所不同。按照存储数据的原理的不同，又可分为静态触发器和动态触发器。5.2SR锁存器一、电路结构与工作原理(a)电路结构SRSDRDQQ'(c)图形符号由两个或非门组成的SR锁存器电路Q=1、Q'=0的状态称1状态，Q=0、Q'=1的状态称0状态SD称为置位端或置1输入端，RD称为复位端或置0输入端。1、由或非门组成的SR锁存器电路结构G1vI1vO1G2vI2vO2G1G2RDQSD(b)电路结构Q'SDRDQQ工作原理RDSDQ0111001①不论触发器原来处于什么

4、状态都将变成1状态，这种情况称将触发器置1或置位。SD端称为触发器的置1端或置位端。而且SD=1信号消失后，电路的1状态得以保持。SDRDQQRDSDQ011②不论触发器原来处于什么状态都将变成0状态，这种情况称将触发器置0或复位。RD端称为触发器的置0端或复位端。RD=1信号消失后，电路保持0状态不变。10001101端（原端）0端（非端）SDRDQQ0010③RD=0、SD=0时：根据或非门的逻辑功能不难推知，触发器保持原有状态不变，即原来的状态被触发器存储起来，这体现了触发器具有记忆能力。RDSDQ0

5、1110000不变1010SDRDQQ1100RDSDQ01110000不变11不定？④RD=1、SD=1时：Q=Q=0，不符合触发器的逻辑关系。并且由于或非门延迟时间不可能完全相等，在两输入端的1同时撤除后，将不能确定触发器是处于1状态还是0状态。所以触发器不允许出现这种情况，即在正常工作时输入信号应遵守RDSD=0，这就是基本SR触发器的约束条件。SDRDQQ*功能00000101Q*=Q保持10010111Q*=1置101001100Q*=0置01101110*0*不允许特性表（真值表）现态(初态、原

6、态)：触发器接收输入信号之前的状态，也就是触发器原来的稳定状态。(新态)次态：触发器接收输入信号之后所处的新的稳定状态。将含有状态变量(Q)的真值表称为特性表。(a)电路结构SDQRDQ'(b)图形符号SRSDRDQQ'电路组成和逻辑符号信号输入端，低电平有效。信号输出端，Q=0、Q=1的状态称0状态，Q=1、Q=0的状态称1状态2、由与非门组成的基本SR锁存器SDRDQQ工作原理1001①不论触发器原来处于什么状态都将变成0状态，这种情况称将触发器置0或复位。RD端称为触发器的置0端或复位

7、端。RDSDQ010SDRDQQ②不论触发器原来处于什么状态都将变成1状态，这种情况称将触发器置1或置位。SD端称为触发器的置1端或置位端。RDSDQ0101010110SDRDQQ1110③根据与非门的逻辑功能不难推知，触发器保持原有状态不变，即原来的状态被触发器存储起来，这体现了触发器具有记忆能力。10RDSDQ01010111不变SDRDQQ0011？④R=0、S=0时：Q=Q=1，不符合触发器的逻辑关系。并且由于与非门延迟时间不可能完全相等，在两输入端的0同时撤除后

8、，将不能确定触发器是处于1状态还是0状态。所以触发器不允许出现这种情况，在正常工作时输入信号应遵守SR=0,这就是基本SR触发器的约束条件。RSQ01010111不变00不定特性表（真值表）现态：触发器接收输入信号之前的状态，也就是触发器原来的稳定状态。次态：触发器接收输入信号之后所处的新的稳定状态。二、动作特点在SR锁存器中，输入信号直接加在输出门上，所以输入信号在全部作用时间里