第五章-集成触发器ppt课件.ppt

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1、第5章集成触发器概　述基本RS触发器同步触发器边沿触发器本章小结主从触发器触发器应用举例主要要求：了解触发器的基本特点、作用和类型。5.1概　述Flip-Flop，简写为FF，又称双稳态触发器。一个触发器可存储1位二进制数码一、触发器的基本特点和作用基本特点(1)具有两个在逻辑上互反的输出端Q和Q，且这两个输出端具有两个稳定状态(简称稳态)。当Q=0、Q=1时，称为0状态；Q=1，Q=0时，称为1状态。(2)在输入信号作用下，触发器的两个稳定状态可相互转换(称为状态的翻转)。输入信号消失后，新状态可长期保持下来，因此具有记忆功能，可存储二进制信息。触发器的作用触发器有记忆功能，

2、由它构成的电路在某时刻的输出不仅取决于该时刻的输入，还与电路原来状态有关。而门电路无记忆功能，由它构成的电路在某时刻的输出完全取决于该时刻的输入，与电路原来状态无关。触发器和门电路是构成数字电路的基本单元。根据逻辑功能不同分为RS触发器D触发器JK触发器T触发器T´触发器根据触发方式不同分为电平触发器边沿触发器主从触发器根据电路结构不同分为三、触发器逻辑功能的描述方法主要有特性表、特性方程、激励表(又称驱动表)、状态转换图和波形图(又称时序图)等。基本RS触发器同步触发器主从触发器边沿触发器维持阻塞触发器二、触发器的类型5.2基本RS触发器主要要求：掌握与非门结构基本RS触发器

3、的电路和逻辑功能。理解或非门结构基本RS触发器的电路、逻辑功能。掌握触发器逻辑功能的描述方法。掌握基本RS触发器的工作特点和逻辑功能。5.2.1由与非门组成的基本RS触发器一、电路组成QQSDRDG1G2QQSDRDSRSDRDQQQ=1，Q=0时，称为触发器的1状态，记为Q=1；Q=0，Q=1时，称为触发器的0状态，记为Q=0。RD置0端，也称复位端。R即Reset。SD置1端，也称置位端。S即Set。BasicFlip-Flop互补输出端，正常工作时，它们的输出状态相反。低电平有效QQSDRDG1G211011000SDRD功能说明输入QQ输出二、逻辑功能011110触发

4、器被置0触发器置010QQSDRDG1G211011000SDRD功能说明输入QQ输出二、逻辑功能QQ输出100111触发器被置1触发器置010触发器置101QQSDRDG1G211011000SDRD功能说明输入QQ输出二、逻辑功能QQ输出11触发器置010触发器置101触发器保持原状态不变不变&&G1门输出G2门输出QQSDRDG1G211011000SDRD功能说明输入QQ输出二、逻辑功能输出状态不定(禁用)不定QQ输出触发器置010触发器置101触发器保持原状态不变不变0011输出既非0状态，也非1状态。当RD和SD同时由0变1时，输出状态可能为0，也可能为1，即输出状

5、态不定。因此，这种情况禁用。触发器次态Qn+1与输入信号和电路原有状态（现态Qn）之间关系的真值表。三、特性表000010Qn+1=Qn+1=1，状态错误，因此不允许。011010100触发器置010101100触发器置1111111001触发器保持原状态不变说明QnQnSDRD与非门组成的基本RS触发器特性表111100Qn+10011110011Qn+1说明：SD和RD输入为低电平有效。SD=0时，Q被置0。RD=0时，Q被置1。但SD和RD不能同时为0，否则Q和Q的状态不再互反，出现错误,且当SD和RD由0同时变1时，Q端的状态不定。触发器次态Qn+1与输入信号和电路原有

6、状态（现态Qn）之间关系的真值表。SD端和RD端不能同时为0，即RD+SD=1称约束条件三、特性表000010Qn+1=Qn+1=1，状态错误，因此不允许。011010100触发器置010101100触发器置1111111001触发器保持原状态不变说明QnQnSDRD与非门组成的基本RS触发器特性表111100Qn+10011110011Qn+1触发器次态Qn+1与输入信号和电路原有状态（现态Qn）之间关系的真值表。两个信号输入端信号名上的非号与信号名构成一个不可拆分的的符号，仅表示输入低电平有效，，而不能参与非运算。注意三、特性表000010Qn+1=Qn+1=1，状态错误，

7、因此不允许。011010100触发器置010101100触发器置1111111001触发器保持原状态不变说明QnQnSDRD与非门组成的基本RS触发器特性表111100Qn+10011110011Qn+1四、特性方程触发器次态Qn+1与输入信号RD、SD及现态Qn之间的逻辑关系表达式。特性方程(约束条件)RD+SD=1基本RS触发器Qn+1的卡诺图RDSDQn0100011110××001110基本RS触发器特性表011001010000QnSDRD100110101111010×Qn+1×