CADENCE仿真流程介绍.doc

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1、此文档收集于网络，如有侵权，请联系网站删除此文档仅供学习与交流此文档收集于网络，如有侵权，请联系网站删除第一章进行SI仿真的PCB板图的准备仿真前的准备工作主要包括以下几点：1、仿真板的准备●原理图设计；●PCB封装设计；●PCB板外型边框（Outline）设计，PCB板禁止布线区划分（Keepouts）；●输出网表（如果是用CADENCE的ConceptHDL设计的原理图，可将网表直接Expot到BRD文件中；如果是用PowerPCB设计的板图，转换到allegro中的板图，其操作见附录一的说明）；●器件预布局（Placement）：将其中的关键器

2、件进行合理的预布局，主要涉及相对距离、抗干扰、散热、高频电路与低频电路、数字电路与模拟电路等方面；●PCB板布线分区（Rooms）：主要用来区分高频电路与低频电路、数字电路与模拟电路以及相对独立的电路。元器件的布局以及电源和地线的处理将直接影响到电路性能和电磁兼容性能；2、器件模型的准备●收集器件的IBIS模型（网上下载、向代理申请、修改同类型器件的IBIS模型等）●收集器件的关键参数，如Tco、Tsetup、Tholdup等及系统有关的时间参数Tclock、Tskew、Tjitter●对IBIS模型进行整理、检查、纠错和验证。3、确定需要仿真的电路

3、部分，一般包括频率较高，负载较多，拓扑结构比较复杂（点到多点、多点到多点），时钟电路等关键信号线第二章IBIS模型的转化和加载CADENCE中的信号完整性仿真是建立在IBIS模型的基础上的，但又不是直接应用IBIS模型，CADECE的软件自带一个将IBIS模型转换为自己可用的DML（DeviceModelLibrary）模型的功能模块，本章主要就IBIS模型的转换及加载进行讲解。1、IBIS模型到DML模型的转换在Allegro窗口中选择AnalyseSI/EMISIMLibrary，打开“signalanalyzelibrarybrowser”

4、窗口，在该窗口的右下方点击“Translate→”按钮，在出现的下拉菜单中选择“ibis2signois”项，出现“SelectIBISSourceFile”窗口（图1），选择想要进行转换的源IBIS文件，按下“打开”按钮，出现转换后文件名及路径设置窗口（缺省设置为和源IBIS文件同名并同路径放置，但此处文件名后缀为dml），设置后按下“保存”按钮，出现保存确定窗口（图2）,点击OK按钮即可，随后会出现一个“messages”窗口，该窗口中的报告文件说明在模型转换过程中出现的问题，对其中的“warning”可不用在意，但如果出现“error”此文档仅

5、供学习与交流此文档收集于网络，如有侵权，请联系网站删除则必须进行修改后重新进行模型格式转化直到没有“error”出现为止，此时转换得到的dml文件才是有效的。注：若已有规范的完整DML模型库，我们可以直接将需要的模型库加入到工作库中，即可跳过第一步直接执行第二步。图1：IBIS模型转换源文件设置窗口图2：输出dml文件确认窗口2、将转换后的dml模型加载到模型库在signalanalyzelibrarybrowser窗口中，按下“AddExistingLibrary→”按钮，出现下拉菜单，选择“LocalLibrary”出现“打开”窗口，选择你放置d

6、ml文件的路径并选中要加载的dml文件点击“打开”按钮就将dml文件加载到了模型库中。3、分配DML文件给特定的器件。在Allegro窗口中选择AnalyseSI/EMISIMModel，打开“SignalModelAssignment”窗口(图3所示)，在该窗口中所有使用到的器件是按序排列的。可以点击“AutoSetup”进行器件模型的自动分配，此时的分配原则是如果器件的名称和模型的名称完全一致，则该模型自动分配给这个元器件。也可以选中某一元器件，点击“FindModel…”按钮，出现“ModelBrower”窗口，在“ModelNamePat

7、ter”一栏中填入“*”号，一些模型的名称进入下面的列表框，在列表框里选中你需要的模块后，在“SignalModelAssignment”窗口中的对应器件的“SignalName”列里就会出现它的模型名称。此文档仅供学习与交流此文档收集于网络，如有侵权，请联系网站删除在“SignalModelAssignment”窗口中选中某些器件后，还可点击“CreateModel…”按钮进入创建模型的界面（图4所示）。对于定义了value值的无源器件（包括电阻、电容、电感），系统会自动生成在仿真中使用的Espice模型。对于没有自动生成模型的无源器件，在模型创建

8、窗口选择“CreateEspiceModel”，而对于其他没有模型的有源器件则选择“CreateIBISMo