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1、.第一章逻辑代数基础1.1、用布尔代数的基本公式和规则证明下列等式。1.2、求下列函数的反函数。1.3、写出下列函数的对偶式。1.4、证明函数F为自对偶函数。.1.1、用公式将下列函数化简为最简“与或”式。-(ă9-+a+m+«r+m+zz+im•+awe(»+Y+z*;i?1.2、逻辑函数。若A、B、C、D、的输入波形如图所示，画出逻辑函数F的波形。ADACABD+BJ——ABU-A1.1、逻辑函数F1、F2、F3的逻辑图如图2—35所示，证明F1=F2=F3。1.2、给出“与非”门、“或非”门及“异或”门逻辑符号如图2—36（a）所示
2、，若A、B的波形如图2—36（b），画出F1、F2、F3波形图。Ni-AB1.1、用卡诺图将下列函数化为最简“与或”式。'•*-Z•'(DJ,2,4,5,7):H:P--ABfADBČ@2—36Cb4.Æs=2'(2,3,6,7,8,lQ12,14).ItÆ-BDAD5sN-2s’(4,d,l2,14,20,22,28,20)ãłF=AC.1.1、将下列具有无关最小项的函数化为最简“与或”式；.01ț.l..Ba*fel-%*Zd(14,1d):4F=Zm'(2,3,4,5.6,7.11,14)DCC000ï111000111.1、用
3、卡诺图将下列函数化为最简“与或”式；.(l'PIz‹OId6*(ElT!’art''E'CrJ,•=(gogo7dß)O.’O00TOgl11000*.Q01Tl1000TB&Y=Zin‘(2,2,4,10,11,15)//011.00nłi110a*1.1011F.1..1I-ABID+ABD+BE——ABIDABDBEM——ABID+AND+A——A8IDABDAWH——ABIDABDAD+BID——ABIDABDADBIDDC000111IO00“1.110H第二章门电路2.1由TTL门组成的电路如图2.1所示，已知它们的输入短路电
4、流为Iis=1.6mA，高电平输入漏电流IiH=40。试问：当A=B=1时，G1的灌电流（拉，灌）为3.2mA；A=0时，G1的拉电流（拉，灌）为120。2.2图2.2中示出了某门电路的特性曲线，试据此确定它的下列参数：输出高电平UOH=3V；输出低电平UOL=0.3V；输入短路电流IiS=1.4mA；高电平输入漏电流IiH=0.02mA；阈值电平UT=1.5V；开门电平UON=1.5V；关门电平UOFF=1.5V；低电平噪声容限UNL=1.2V；高电平噪声容限UNH=1.5V；最大灌电流IOLmax=15mA；扇出系数N=10.2.3T
5、TL门电路输入端悬空时，应视为高电平；（高电平，低电平，不定）此时如用万用表测量其电压，读数约为1.4V（3.6V，0V，1.4V）。2.4CT74、CT74H、CT74S、CT74LS四个系列的TTL集成电路，其中功耗最小的为CT74LS；速度最快的为CT74S；综合性能指标最好的为CT74LS。2.5CMOS门电路的特点：静态功耗极低（很大，极低）；而动态功耗随着工作频率的提高而增加（增加，减小，不变）；输入电阻很大（很大，很小）；噪声容限高（高，低，等）于TTL门。2.6集电极开路门（OC门）在使用时须在输出与电源之间接一电阻（输出
6、与地，输出与输入，输出与电源）。2.7若G2的悬空的输入端接至0.3V，结果如下表2.9输入悬空时为高电平，M=“0”，VM=0.2V,三态门输出为高阻，M点电位由后面“与或非”门的输入状态决定，后面与门中有一输入为0，所以VM=0V。2.102.11上图中门1的输出端断了，门2、3、4为高电平输入，此时VM=1.6V左右。2.12不能正常工作，因为不能同时有效，即不能同时为低电平。2.13图为由TTL“与非”门组成的电路，输入A、B的波形如图所示，试画出V0的波形。2.14图中门1、2、3均为TTL门电路，平均延迟时间为20ns，画出V
7、O的波形。2--81、Y1=ABCDEY2=A+B+C+D+E2、该扩展方法不适用于TTL门电路。对与门而言，当扩展端C=0.3V时，其输入电压约为1V，已大于UiLmax(0.8V)；对或门而言，当扩展端C=UOHmin=2.4V时，其输入电压约为1.7V，已小于UiHmin(2V)；2--974TTL74LS7TLCG40ß074HC74HCT74TTL74LSTTL74HCT2--10乙的说法正确，因为该点的电压有可能是变化的，此时万用表测得的是电压的平均值，1.8V的读数完全正常。T=ATC+ABC+C+ABC=zo¢0,3,3,
8、@=ASBł32CAĄYOZ)+YZ=XY+XZ+TZP=YŒzsss.listcff»naãïæl.nxa»aiëa.r,-xmvazs,=2æxzq-xrozs,-xrz14B=B¡=D+
