EDA技术实用教程第4章ppt课件.ppt

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1、FPGA技术第4章VHDL设计初步4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述图4-1mux21a实体4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述图4-2mux21a结构体4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYmux21aISPORT(a,b:INBIT;s:INBIT;y:OUTBIT);ENDENTITYmux21a;ARCHITE

2、CTUREoneOFmux21aISBEGINy<=aWHENs='0'ELSEb;ENDARCHITECTUREone;IEEE库使用说明器件mux21外部接口信号说明，PORT相当于器件引脚，此为实体器件mux21内部工作逻辑描述，即为实体描述的器件功能结构，称为结构体【例4-1】2021/8/26第2章5(1)库(LIBRARY)：包含了描述器件的输入、输出端口数据类型中将要用到的IEEE的标准库中的STD_LOGIC_1164程序包。(2)实体(ENTITY)：电路意义相当于器件，在电路原理图上相当

3、于元件符号。实体是一个完整的、独立的语言模块，它描述了mux21接口信息，定义了mux2l端口引脚的输入输出性质和数据类型。PORT所描述的就相当于电路器件的外部引脚，对端口引脚作了信号流向的方向说明，同时指明了端口的数据类型。(3)结构体(ARCHITECTURE)：描述mux21内部的逻辑功能，在电路上相当于器件的内部电路结构。“Y<=a”表示将a获得的信号赋给(传入)y输出端，这是一个单向过程。选择器逻辑功能的VHDL描述使用了三个层次：2021/8/26第2章6⊿一个可综合的VHDL描述的最小和最基

4、本的逻辑结构中，IEEE标准库说明、实体和结构体是最基本的和不可缺少的三个部分。其它的结构层次可根据需要选用。此例作为一个完整的VHDL描述既可以作为一个独立的功能器件使用和存在，也能被其它的由VHDL描述的逻辑电路所调用，成为其中的一个功能部件。注意：4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述【例4-2】ENTITYmux21aISPORT(a,b:INBIT;s:INBIT;y:OUTBIT);ENDENTITYmux21a;ARCHITECTUREoneOFmux21aIS

5、SIGNALd,e:BIT;BEGINd<=aAND(NOTS);e<=bANDs;y<=dORe;ENDARCHITECTUREone;图4-2mux21a结构体图4-1mux21a实体4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述【例4-3】ENTITYmux21aISPORT(a,b,s:INBIT;y:OUTBIT);ENDENTITYmux21a;ARCHITECTUREoneOFmux21aISBEGINPROCESS(a,b,s)BEGINIFs='0'THENy<=a

6、;ELSEy<=b;ENDIF;ENDPROCESS;ENDARCHITECTUREone;4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述图4-3mux21a功能时序波形4.1多路选择器的VHDL描述4.1.2相关语句结构和语法说明【例4-4】ENTITYe_nameISPORT(p_name:port_mdata_type;...p_namei:port_midata_type);ENDENTITYe_name;1.实体表达2.实体名3.端口语句和端口信号名4.1多路选择器的VHD

7、L描述4.1.2相关语句结构和语法说明4.端口模式IN输入端口，定义的通道为单向只读模式OUT输出端口，定义的通道为单向输出模式INOUT定义的通道确定为输入输出双向端口BUFFER缓冲端口，其功能与INOUT类似4.1多路选择器的VHDL描述4.1.2相关语句结构和语法说明5.数据类型6.结构体表达【例4-5】ARCHITECTUREarch_nameOFe_nameIS[说明语句]BEGIN(功能描述语句)ENDARCHITECTUREarch_name；4.1多路选择器的VHDL描述4.1.2相关语句

8、结构和语法说明7.赋值符号和数据比较符号赋值符“<=”表式中的等号“=”没有赋值的含义，只是一种数据比较符号。IFaTHEN...--注意，a的数据类型必须是booleanIF(s1='0')AND(s2='1')OR(c