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1、电子电路EDA实验指导书（试行稿）胥保文编江苏大学测控实验室2012．10目录实验一设计基本触发器………………………………………1实验二七人表决器……………………………………………2实验三英语字母显示电路……………………………………3实验四BCD码加法器…………………………………………4实验五计数器电路设计……………………..………………..5第1章MAX+PLUSII软件的使用MAX+PLUSII软件是一个功能强大，容易使用的软件包，它可以以图形方式、文字输入方式（AHDL、VHDL和VERILOG）、和波形方式输
2、入设计文件，可以编译并形成各种能够下装到EPROM和各种ALTERA器件的文件，还可以进行仿真以检验设计的准确性，下面举例说明该软件的使用。1MAX+PLUSII软件1.1功能简介(1)原理图输入（GraphicEditor）MAX+PLUSII软件具有图形输入能力,用户可以方便的使用图形编辑器输入电路图,图中的元器件可以调用元件库中元器件,除调用库中的元件以外,还可以调用该软件中的符号功能形成的功能块.图形编辑器窗口见图1.1图1.1图形编辑器窗口(1)硬件描述语言输入(TextEditor)MAX+PLUSII软
3、件中有一个集成的文本编辑器,该编辑器支持VHDL,AHDL和Verilog硬件描述语言的输入,同时还有一个语言模板使输入程序语言更加方便,该软件可以对这些程序语言进行编译并形成可以下载配置数据，文本编辑器窗口见图1.2。图1.2文本编辑窗口(1)波形编辑器(waveformEditor)在进行逻辑电路的行为仿真时，需要在所设计电路的输入端加入一定的波形，波形编辑器可以生成和编辑仿真用的波形（*.SCF文件），使用该编辑器的工具条可以容易方便的生成波形和编辑波形。波形编辑器窗口如图1.3所示。使用时只要将欲输入波形的时
4、间段用鼠标涂黑，然后选择工具条中的按钮，例如，如果要某一时间段为高电平，只需选择按钮”1”。图1.3波形编辑器窗口还可以使用输入的波形(*.WDF文件)经过编译生成逻辑功能块，相当于已知一个芯片的输入输出波形，但不知是何种芯片，使用该软件能力可以解决这个问题，设计出一个输入和输出波形相同CPLD电路。(1)管脚（底层）编辑窗口(FloorplanEditor)该窗口用于将已设计好逻辑电路的输入输出节点赋予实际芯片的引脚,通过鼠标的拖拉，方便的定义管脚的功能。管脚（底层）编辑窗口见图1.4。图1.4管脚（底层）编辑窗口
5、(2)自动错误定位在编译源文件的过程中，若源文件有错误，Max+Plus2软件可以自动指出错误类型和错误所在的位置。(3)逻辑综合与适配该软件在编译过程中，通过逻辑综合(LogicSynthesizer)和适配(Fitter)模块,可以把最简单的逻辑表达式自动的吻合在合适的器件中。(4)设计规则检查选取CompileProcessingDesignDoctor菜单，将调出规则检查医生，该医生可以按照三种规则中的一个规则检查各个设计文件，以保证设计的可靠性。一旦选择该菜单，在编译窗口将显示出医生，用鼠标点击医生，该
6、医生可以告诉你程序文件的健康情况。见图1.5。图1.5规则检查医生(1)多器件划分(Partitioner)如果设计不能完全装入一个器件，编译器中的多器件划分模块，可自动的将一个设计分成几个部分并分别装入几个器件中，并保证器件之间的连线最少。(2)编程文件的产生编译器中的装配程序(Assembler)将编译好的程序创建一个或多个编程目标文件：EPROM配置文件（*.POF）例如,MAX7000系列SRAM文件（*.SCF）例如,FLEX8000系列的配置芯片EPROMJEDEC文件(*.JED)十六进制文件(*.HE
7、X)文本文件(*.TTF)串行BIT流文件(*.SBF)(10)仿真当设计文件被编译好,并在波形编辑器中将输入波形编辑完毕后,就可以进行行为仿真了,通过仿真可以检验设计的逻辑关系是否准确.(11)分析时间(AnalyzeTiming)该功能可以分析各个信号到输出端的时间延迟,可以给出延迟矩阵和最高工作频率.见图1.6和图1.7.图1.6延迟矩阵图1.7最高工作频率(12)器件编程当设计全部完成后,就可以将形成的目标文件下载到芯片中,实际验证设计的准确性.(13)设计过程1)输入项目文件名(File/Project/N
8、ame)2)输入源文件(图形、VHDL、AHDL、Verlog和波形输入方式)(Max+plusⅡ/graphicEditor,Max+plusⅡ/TextEditor,Max+plusⅡ/WaveformEditor)3)指定CPLD型号(Assign/Device)4)设置管脚、下载方式和逻辑综合的方式(Assign/GlobalProje
