基于fpga的误码率测试

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1、题目：基于FPGA的误码率测试24目录一设计内容及任务...................................................31.1设计内容....................................................31.2设计任务....................................................3二设计方案..........................................................42.1方案猜想..

2、..................................................42.2系统整体方案设计............................................4三系统硬件调试......................................................43.1系统硬件的整体设计框图.......................................43.2FLEX10K最小系统...................................

3、..........53.3单片机最小系统...............................................73.4并行接口电路.................................................73.5显示电路.....................................................83.6复位电路.....................................................9四系统软件设计...............

4、.......................................104.1发送模块.....................................................104.1.1M码产生模块................................................104.1.2误码插入模块...............................................124.2接收模块.........................................

5、............124.2.1伪随机码同步模块...........................................124.2.2误码统计模块...............................................134.3单片机模块...................................................14五系统调试...........................................................15六课程设计总结......

6、.................................................16参考文献.............................................................17附录.................................................................1824一、设计内容及任务1.1设计内容误码率=接收出现差错的比特数/总的发送的比特数实现一个误码率测试电路，在数字通信中，必须在数字信号序列中插入标示码元起始位置的同步码元

7、，否则接收端将无法识别连接数字序列中每一个字符或每一帧的起始码元位置。对于接收端来说，信息序列是随机的，不可预知的，但帧同步码元则是已知的，所以可以通过检测帧同步码的错码情况来确定整个系统的误码率。1.2设计任务本系统的核心单元是误码率测试电路，无码测试主要是检测同步头的无码个数，这部分用FPGA来实现，要求数据的速率为19.2MB/S，同步头为7个128位的伪随机码。测试完毕，将误码个数与总的比特数送往CPU进行处理，计算误码率，最后把测试结果送往数码管输出显示。误码率测试电路扩展并行口CPU显示电路晶振及复位电路24二、设计方案2.1

8、设计猜想根据设计要求得出误码测试原理是：通过对经过被测系统的序列和原序列进行逐位比较，从而得到误码数。基本原理如图所示：测试码产生器误码检测接收设备信道发送设备2.2系统整体设计方案本系统是以