fir低通滤波器设计报告

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1、FIR低通滤波器设计报告信息工程信息与通信工程2111203024xxx1.设计内容本设计是基于FPGA的一个FIR低通滤波器设计，要求使用Verilog语言编写滤波器模块，通过编译和综合，并通过Matlab和modelsim联合仿真验证设计结果。2.设计原理FIR滤波器响应（简称FIR）系统的单位脉冲响应为有限长序列，系统函数在有限z平面上不存在极点，其运算结构中不存在反馈支路，即没有环路。如果的长度为N，则它的系统函数和差分方程一般具有如下形式：根据差分方程直接画出FIR滤波器的结构，称为直接型结构。如图所示：

2、图2.1FIR滤波器直接结构FIR滤波器的特点：单位脉冲响应序列为有限个；可快速实现；可得到线性相位；滤波器阶数较高。对线性时不变系统保持线性相位的条件是：单位脉冲响应为偶对称或奇对称。即：为设计线性滤波器，应保证h(n)为对称的。1）若N为偶数，其线性相位FIR滤波器的对称结构流图：图2.2若N为偶数线性相位FIR滤波器的对称结构流图图中：“+1”对应偶对称情况，“-1”对应奇对称情况。当n为奇数时，最后一个支路断开。2）若N为奇数，其线性相位FIR滤波器的对称结构流图：图2.3N为奇数线性相位FIR滤波器的对称

3、结构流图在本设计中，我们采用线性FIR低通滤波器，所采用的阶数N=8，所以是偶对称的，估采取图2.2的结构，其中“±1“取“＋1”。1.设计思路要在FPGA上实现FIR滤波器，首先要确定滤波器的抽头系数。其系数的确定，我们可以通过两种办法来实现：第一种就是通过matlab编写FIR滤波器程序，然后直接导出抽头系数“h（n）”，另外一种办法就是使用matlab自带的FDATOOL简便地设计一个FIR滤波器，然后导出系数。考虑到要更直观地描述FIR滤波器的设计，我采用了第一种方法，用编写matlab代码的方式设计一个F

4、IR低通滤波器。设计好滤波器后，接着要用matlab产生一个高频率和低频率的信号，通过滤波器的滤波，能把高频的信号滤除，只剩下低频的信号，从而验证滤波器的性能。然后再把产生的输入信号进行采样，保存，量化，以供FPGA的FIR滤波器模块使用。做好准备工作后，就可以在QUARTUSII里面编写Verilog代码了。由于是硬件描述语言，所以设计的思路很简单，就是通过把输入序列移位，然后首位对称相加再乘以抽头系数，然后把相乘结果再相加最后给输出。其中涉及的难点是FPGA对有符号小数的乘法处理部分。在QUARTUSII编写好

5、模块之后，就要用到modelsim来对设计进行仿真。对于仿真信号的输入，我们可以添加一个altera的romIP核来存放之前matlab产生的信号采样值，然后通过时钟的驱动一个一个输入到FIR滤波器模块，最后在modelsim中显示滤波器的输出结果。验证的最后一步，就是要把modelsim输出的仿真结果用matlab进行绘图，和之前matlab程序的输出结果进行比较，从而验证滤波器的设计是否成功。1.设计过程1）使用matlab设计FIR滤波器用matlab设计线性FIR滤波器，首先要确定其指标，在本设计里，我们规

6、定滤波器的指标如下：阶数N=8，抽样频率fs=100Hz，截止频率为12.5Hz用窗函数设计FIR滤波器，窗函数选择汉明窗。根据此可以编得matlab代码如下：可以求得滤波器抽头系数h（n）为：h=0.00280.02980.12590.23250.23250.12590.02980.0028由于FPGA不支持浮点数的运算，所以我们采用定点数的格式来量化抽头系数。对于16位的输入数据，我们这里采用Q11的定点小数格式，即11位小数位，4位整数位，1位符号位。将抽头系数乘以2^11可得：b=5602574764762

7、57605这样我们就得到了8阶FIR滤波器的量化系数了。确定好FIR滤波器的系数了，我们还需要用matlab产生仿真用的输入信号，在这里，我们采用了以下两组信号：X1=0.01*sin(2*pi.*t)+0.01*sin(2*pi*40.*t)，f1=0.02π，f2=0.8π（截止频率为0.25π）X2=0.01*sin(2*pi.*t)+0.01*sin(2*pi*4.*t)，f1=0.02π，f2=0.08π（截止频率为0.25π）然后用这两组结果分别与滤波器系数进行卷积运算，可以得到滤波器后的结果，如下图所

8、示：图4.1当输入信号为x1时，滤波器的输入波形以及输出波形示意图图4.2当输入信号为x2时，滤波器的输入波形以及输出波形示意图通过简单分析上述两图的结果，可以看出，当输入信号的频率大于0.25π时，信号得到很好的滤除，而当输入信号少于0.25π时，其信号会无失真地通过滤波器。接下来，我们就先把这两种信号的采样值进行移位量化处理，然后保存到txt文件，供后续