vhdl断言语句与报告语句x

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1、VHDL语句REPORT语句断言语句REPORT语句VHDL仿真中，REPORT语句是报告有关信息的语句，本身不可综合（综合中不能生产电路），主要以提高人机对话的可读性，监视某些电路的状态。REPORT语句的书写格式为：REPORT<字符串>；例:RS触发器的VHDL描述中REPORT语句的使用。LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYrsffISPORT（s：INBIT；r：INBIT；q：OUTBIT；qb：OUTBIT）；ENDrsff；A

2、RCHITECTURErtlOFrsffISBEGINPROCESS（s，r）VARIABLElast_state：BIT；BEGINIF（s=‘1’ANDr=‘1’）THENREPORT“Bothsandrequalto‘1’.”；ELSIF（s=‘0’ANDr=‘0’）THENlast_state：=last_state；ELSIF（s=‘0’ANDr=‘1’）THENlast_state:=0；ELSElast_state:=1；ENDIF；q<=last_state；qb<=not（la

3、st_state）；ENDPROCESS；ENDrtl；断言语句（Assert）断言语句分为顺序断言语句和并行断言语句，顺序断言语句主要用于进程、函数和过程仿真、调试中的人机对话，它可以给出一个文字串作为警告和错误信息。断言语句的书写格式如下：ASSERT<条件表达式>REPORT<出错信息>SEVERITY<出错级别>；在执行过程中，断言语句对条件（布尔表达式）的真假进行判断:(1)如果条件为“TURE”，则向下执行另外一条语句；(2)如果条件为“FALSE”，则输出错误信息和错误严重程度的级

4、别。断言语句的使用规则：ASSERT后判断出错的条件表达式必须由设计人员给出，没有默认格式。REPORT后的出错报告信息必须是用双引号括起来的字符串，如“…”。若REPORT后缺少出错信息报告，则默认输出错误信息报告为“AssertionViolation”。SEVERITY后的错误等级必须是预定的4种错误之一。若缺少错误等级，则默认等级为Error。例:RS触发器的VHDL描述中断言语句的使用LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYrsffIS

5、PORT（s：INBIT；r：INBIT；q：OUTBIT；qb：OUTBIT）；ENDrsff；ARCHITECTURErtlOFrsffISBEGINPROCESS（s，r）VARIABLElast_state：BIT；BEGINASSERT（NOT（s=‘1’ANDr=‘1’））REPORT“Bothsandrequalto‘1’.”SEVERITYERROR；IF（s=‘0’ANDr=‘0’）THENlast_state:=last_state；ELSIF（s=‘0’ANDr=‘1’）T

6、HENlast_state:=0；ELSElast_state:=1；ENDIF；q<=last_state；qb<=not（last_state）；ENDPROCESS；ENDrtl；谢谢观赏