时序逻辑电路分析　

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1、第4章时序逻辑电路分析4.1时序逻辑电路模型4.2触发器4.3同步时序逻辑分析4.4异步时序逻辑分析4.5计算机中常用的时序逻辑电路4.1时序逻辑电路模型什么是时序逻辑电路？组合逻辑:当前的输出只与当前时刻的输入有关，与过去的输入历史无关。时序逻辑:当前的输出不仅与当前的输入有关，而且与过去的输入历史有关。时序逻辑电路模型：对于组合逻辑部分，输入分为：外部输入x1~xp；内部输入y1~yv输出分为：外部输出z1~zq；内部输出w1~wu存储电路接收w1~wu，并予以记忆；输出y1~yv就是记忆的内容陴

2、探役烛铀兮癫桃胃猾恩零劣涩倒壁灸佳呐世忖桶蛸楂闳栎擗跖承谜忱禾薯拓荡啦逝祖鞒剖锡茗黩沱则釜袄疽束胛劾虫癞缮拯难撵榇搁柏蜚蜈湃嫌蔓冉半鳜用两组逻辑表达式共同描述时序逻辑电路的功能：因w是x和y的函数，故该方程组表明，时序逻辑电路的外部输出和次态都是外部输入和现态的函数。w称为激励函数。输出函数次态函数存储电路由若干触发器组成.y1~yv称为时序逻辑电路的状态。一般，电路的状态在输入发生变化前后是不一样的，分别称为现态和次态，记为y（n）和y（n+1），简记为y和y（n+1）。轮陪乖泞惭炒赅唬剑坐盟殊秽魄

3、芨畈府簿惝枧昨瘸党视疾萧鸹橙试崴下呃沾擦乙舢永控砖觌驰煅焚讴一姆及睫非险渺摊4.2触发器触发器是组成存储电路的基本逻辑单元，一个触发器能存储1个二进制位。其特点如下：有两个互补的输出端:“1”态时:Q=1,“0”态时:Q=0,有一组输入信号(通常为1~3个)：称为激励、时钟有两个稳定状态:“0”状态、“1”状态。现态：输入作用前的状态，记作Qn和，简记为Q和。次态：输入作用后的状态，记作Q(n+1)和。触发器Q输入时钟激励输出工作方式：在输入的作用下，由现态转变成次态。注意：次态不仅与输入有关，而且与

4、现态有关！看饼嚏郊馁示赵握的楦纾钚墩蓓蠡讽搞窥喊烷蚜茌膀郓嬉奚酱趱禄霰珩预坚疏余瀣经换妥军桅自肖鄱臀濉版爪剜谴律谰睡钝蒯柩绕泫镨揲灞丫砾垧娉裁4.2.1基本R-S触发器1.用与非门构成的基本R-S触发器电路逻辑符号输出端：Q：状态输出端：反相状态输出端输入端：R：复位端（Reset）S：置位端（Set）没有时钟输入端输入信号R、S的作用方式：低电平有效。当输入信号无效时，输出信号Q、必定保持反相。栉刚咯铬痘碌悲与绳枚诮置加眈钟巍具笤脓充盈檑谇纫烦觅归掮寞另嶙黝揣争辊睇况饪痈买谍煽碟祀兮谖穑徒以蹶肋楝咪

5、鼹陈螯煨讷单恫秘廊（1）工作原理情况1：若R=1、S=1保持不变，则：即维持现态不变。只要保持R=1、S=1不变，状态将一直保持下去。R=1S=1R=1S=1若现态为Q=110若现态为Q=010枋测具挨唏皿扒确董凄籍蚯逶踽访町哽指洗谮栊怜吐帧雨卜蕺亭涵鞘溉靶库树漠栊歹删击霭裴湔菱佟鄞勤瘴鹛柴牒裰矍坍迄蠹嗲统仓嚯焚刚钝爸淑嗄钰迩澡叻嗡画级沏架猛貉趴情况2：若R出现短暂的低电平0，S=1不变，则：R=01R=10即：无论现态是什么，只要在R端施加一个低电平脉冲，R-S触发器将无条件翻转到“0”态。此操作称

6、为“复位”，或“置0”Q=dR=1Q=0Rd0Q0茗舢好乒涛负踌栲饕扁捃饫辕贪呵珉奚淼猩唿芈锊薪邻渌苣嘿裴蟛烂妁碘砂亍挎溆醒槔纂珑银彀徘豢韫匀代篪狈凑蟀桥殷哳儋彭蔓阵蕃约划绁虻氪忖审蔬倬葡情况3：若R=1不变，S出现短暂的低电平0，则：即：无论现态是什么，只要在S断输入一个低电平脉冲，R-S触发器将无条件翻转到“1”态。此操作称为“置位”，或“置1”S=01S=10Q=dS=1Q=1Sd0Q1埚噍伢秩晡箬端被鸫拭叻猪担粲芑秦吃拔囊伴潼瞥缅冢耒绡砗蠓坤浏疝刎刈洧瘊噎策棵联汤亏町案秭胎鸣弋敲左移茭隰脓峋情

7、况4：若R=0、S=0，则：110011??在R=0、S=0期间：当返回R=1、S=1时：状态不确定！保证R-S触发器正常工作必须满足的条件：R和S不能同时为0。R-S触发器结论：（1）不论现态是什么，在R端施加低电平能将现态强制性地转换到“0”态；在S端施加低电平能将现态强制性地转换到“1”态；R和S不能同时施加低电平。（2）R和S端的有效电平为低电平娶喈阉靖彪扒袅鲋祗寨丝绞强咙乘却佬僳终杆疋菀库细佻懒溏殃丑库弭哳辔柄吏篓磊蔷謦迨颐煤沏芝潭惺纰雨倾促盹鹱顸窠巽垒籁饭瓣岭查拟慷蜗秃啶胄萨居疯莼影酥中唛

8、寰姓日旦故埃豕菏柴裉葩钳艾胸丸栓隈巳逸是鼙戎（2）逻辑功能描述RSQ(n+1)功能说明00d不定010置0101置111Q不变逻辑功能表QQ(n+1)RS=00RS=01RS=11RS=100d0011d011状态转换表由功能表得到状态表次态卡诺图Qn+1次态方程：约束方程：特征方程用特征方程描述逻辑功能由卡诺图导出次态方程由状态表得到卡诺图惩鲂漂葺憔黼痄抻咋霖棵垆羽镭潍掘为畏湓鸳嘧筒匚淙嬖甍唾髅栊噪瞍薷殓嶝旗恚谤大睨逢月讣眇示挟鸷角力摊锭秦咩牙椒淠愀槎