数字电路2-3.ppt

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1、将二进制码翻译成一个有效的输出信号。§2.5译码器和编码器一、译码器(Decoder)常用译码电路二进制译码器二-十进制译码器七段显示译码器1)功能与结构：输入端：使能端、地址端。输出端：低电平有效。（1)3:8译码器（74138）二进制译码器输入：n位代码；输出：从2n个信息中译出一个有效信息。译码器的输出端对应一个最小项的非。A0Y0Y1Y2Y3Y4Y5Y6Y7A1A2G1G2AG2BLOWLOW(2)双2:4译码器74LS1391A11A01G2A12A02G74LS1391Y01Y11Y21Y32Y02Y12Y22Y3（1)提供片选用3－8译码器构成4－1

2、6译码器00000001001000110100010101100111100010011010101111001101111011113.应用举例“1”“0”G1用3-8译码器74138和2-4译码器74139扩展成5-32译码器G10000000111010000111110000101111100011111用4选1的数据选择器构成16选1的数据选择器0000000100100011010001010110011110001001101010111100110111101111(2)地址译码存储器、外设地址译码74LS138CBAG1G2AG2BY0’Y1’

3、Y2’Y3’Y4’Y5’Y6’Y7’A9A10A11A12A13A14Y0Y1Y2A15①1000H～1FFFH②Y0：1000H～11FFHY1：1200H～13FFHY2：1400H～15FFH写出：该译码器选择的地址范围；Y0、Y1、Y2的地址译码范围（用16进制数表示）A15A14A13A12A11A10A9A8A7A6A5A4A3A2A1A0××××××××0001ABC×A设备000010XXXXB设备000100XXXXC设备000111XXXX用3：8译码器实现Y2Y4Y7某计算机用地址A9～A0选择外设，设备A、B、C的选择地址分别为：20H～2

4、FH、40H～4FH、70H～7FH，请设计地址译码器。（用74LS138实现）A9A8A7A6A5A4A3……A0CBAG1G2A’G2B’74LS138Y0’Y1’Y2’Y3’Y4’Y5’Y6’Y7’ABC20H～2FH40H～4FH70H～7FH000010XXXX000100XXXX000111XXXXA9A8A7A6A5A4A3…A0(3）实现逻辑函数实现多输出组合逻辑电路，且无需化简过程。用译码器(低电平）和与非门实现逻辑函数。一般，n个地址端的译码器可实现n变量的逻辑函数。例：用译码器74LS138和适当的与非门实现全减器的功能。真值表输出表达式变为

5、最小项之非画电路图ABC“1”74LS138Y0A2Y1A1Y2A0Y3S1Y4S2Y5S3Y6Y7地址高低位对应使能端有效GiDi输入：主裁A，副裁B，C，D,同意为1输出：F＝1承认用1片74LS138和与非门设计一判定电路，在主裁同意的前提下，三名副裁多数同意，成绩才被承认。DCBA74LS138Y0A0Y1A1Y2A2Y3S1Y4S2Y5S3Y6Y7FA2A1A0G2AG1G2B(4)译码器作数据分配器由74LS138构成的1路-8路数据分配器A2A1A0G2AG1G2B数据输入端地址输入端TimeDivisionMultiplexing(TDM)（时分复

6、用）DA0A2A1“0”8路数据分配器2、二－－十进制译码器（74LS42）输入：8421BCD码；输出：与十进制数字相对应的10个信号。伪码输出：1111111111数字显示电路由显示译码器、驱动器和显示器三部分组成。3、七段显示译码器显示器LED发光二极管显示器LCD液晶显示器CRT阴极射线显示器共阴极共阳极YA0A1A2数码显示译码器译码器YYYYYY驱动器YYYYYYYA3a数码显示器bcdefgbcdefgabcdefga0101abcdefg(¡¤)hRabcdefg(¡¤)hR＋VCC共阴极共阳极输出A3A2A1A0（1）外部功能显示译码器74LS4

7、8（共阴极）显示功能：引脚复用技术LampTest，RippleBlankingInput,BlankingInput/RippleBlankingOutput（2)数码显示电路的动态灭零00译码器的特点：译中的输出通道为0；有使能控制端；提供地址译码、片选信号；可实现多输出的函数发生器，且输出加与非门。♦常用的MSI译码器有：·双2:4译码器74XX139·3:8译码器74XX138·4:16译码器74XX156典型显示译码器:·74LS47：驱动共阳极数码管·74LS48：驱动共阴极数码管将十进制数或其它信息转换成二进制代码。二、编码器(Encoder)二～十

8、进制优先编