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1、相关知识回顾：第四章触发器组合电路：不含记忆元件、无反馈、输出与原来状态无关。本章任务：（1）触发器：本章重点：通过学习触发器，建立时序的概念，为后续章节的学习打好基础。是记忆元件、有反馈、输出与原来状态有关。（2）触发器分类。（3）触发器外部逻辑功能、触发方式。第二节R-S触发器第三节主从触发器第四节边沿型触发器第五节触发器逻辑功能的转换第一节概述第四章触发器第六节小结见讲义P186~201第一节概述触发器：分单稳态触发器与双稳态触发器，有一个稳定状态和一个暂时状态。电路只有一个输出端，在没有触发信号时，电路的输出状态固定在高电平或低电平，当有触发信号时，电路的输出从稳态翻转到暂态

2、，维持一段时间后自动返回稳态。有两个稳定状态，简称为触发器。二、触发器特点：三、触发器分类：能够存储一位二进制信息的基本单元。1.有两个能够保持的稳定状态，分别用来表示逻辑0和逻辑1。2.在适当输入信号作用下，可从一种状态翻转到另一种状态；在输入信号取消后，能将获得的新状态保存下来。按触发方式分：电位触发方式、主从触发方式及边沿触发方式。按逻辑功能分：R-S触发器、D触发器、J-K触发器和T触发器。一、触发器第一节概述第二节R-S触发器11101101一、电路图与逻辑符号（2）由两个“与非”门构成的R-S触发器电路图RD=1，SD=1，Q=0：=1两个稳定状态：RD=1，SD=1，Q

3、=1：=0RD，SD：输入RD、SD为1输出不变（1）逻辑符号；Q，：输出10真值表RDSDQ0101101000不定（Ф）11不变0001100111二、真值表RD=0，SD=1：=1，Q=0RD=1，SD=0：=0，Q=1RD=1，SD=1：、Q（不变）RD=0，SD=0：=Q=1，不稳定RD、SD同时变为1时，输出不稳定。RD：置零或复位端（低电平置零，逻辑符号上用小圆圈表示。）：触发器非端或0端真值表RDSDQ0101101000不定（Ф）11不变SD：置1或置位端（低电平置１）Q：触发器原端或1端三、状态转换真值表及特征方程状态转换真值表RDSDQnQn+1000Ф001Ф

4、010001101001101111001111约束条件，不能同时为零。卡诺图特征方程Qn：原状态或现态Qn+1：新状态或次态状态转换真值表：输入信号与原态、次态之间的关系。四、钟控R-S触发器（1）电路图与逻辑符号CP=0：状态不变增加一个控制端，在其控制下，触发器的状态随输入变化。S=0，R=0：Qn+1=QnS=1，R=0：Qn+1=1S=0，R=1：Qn+1=0S=1，R=1：Qn+1=Ф控制输入端R、S通过“非”门作用于基本R-S触发器。CP=1：基本R-S触发器输入端均为1。（2）真值表约束条件不能同时为1。（3）特征方程CP=1：S=0，R=0：Qn+1=QnS=1，R

5、=0：Qn+1=1S=0，R=1：Qn+1=0S=1，R=1：Qn+1=ФRSQn+100Qn01110011Ф钟控R-S触发器真值表假设CP=1时，控制输入不改变。对脉冲宽度的要求严格：例如，构成移位寄存器时，脉宽大于三个、小于四个“与非”门的平均延迟时间。（4）时钟控制R-S触发器逻辑功能波形图第三节主从触发器（一）逻辑符号一、主从触发器二、主从Ｊ－Ｋ触发器Ｊ、Ｋ：输入ＲＤ、ＳＤ：异步置０、置１（不受ＣＰ限制）Ｑ、：输出钟控Ｒ-Ｓ触发器在CP＝１时，Ｒ、Ｓ变化引起输出多次改变。ＣＰ：时钟控制输入主从触发器有：Ｒ－Ｓ主从触发器、记数型主从触发器、Ｔ触发器及Ｊ－Ｋ主从触发器。主触发器

6、从触发器真值表KJQn+100Qn10001111（二）逻辑功能由两个钟控Ｒ－Ｓ触发器构成Ｋ与Ｒ对应，Ｊ与Ｓ对应。CP=0：从触发器接受主触发器状态并翻转稳定CP=1:主触发器接受激励信号并翻转稳定真值表KJQn+100Qn10001111（三）状态转换图与特征方程（１）状态转换图状态转换真值表QnQn+1JK0000110000011001011011100111101101状态0状态1J=0K=K=0J=J=1K=K=1J=状态转换图（２）特征方程状态转换真值表QnQn+1JK00001100000110010110111001111011卡诺图中对应格中填入1J-K触发

7、器的工作波形（四）J-K触发器对激励信号的要求CP=1,若J、K变化，触发器的状态与真值表不对应。（五）J-K触发器构成Ｔ触发器Ｊ－Ｋ触发器的Ｊ、Ｋ端连接在一起形成Ｔ触发器。真值表KJQn+100Qn10001111真值表TQn+10Qn1（１）逻辑符号（２）真值表激励表QnQn+1T000011101110（３）状态转换图（４）特征方程第四节边沿型触发器一、工作原理主从触发器：CP=1,若J、K变化，触发器的状态与真值表不对应。二、维持-阻塞D触发器（一